GUIA DE LABORATORIOS DEPARTAMENTO DE INGENIERIA ELECTRNICA

Versin 15 Febrero 2012

TIPO DE PRACTICA: TEMA:

Proyecto por Etapas

X
3 X

Demostrativa NUMERO DE SESIONES: 2

Dispositivos Lgicos programables (PLDs) y FPGAs #2 3 No GRUPO

No PRACTICA

No INTEGRANTES PROFESOR:

Laboratorios de Ingeniera

Juan Sebastin Rubiano L.

NOMBRE ASIGNATURA: Sistemas Digitales

FECHA DE ENTREGA: 10/04/2013 MATERIALES: - Resistencias de 470 - LEDs - Dip-switchs - Tarjeta FPGA Spartan-3E - GAL22V10 - Display de 7 segmentos - Los elementos a utilizarse en esta prctica los define el diseo a implementar. REFERENCIAS 1. BROWN, Stephen D. Fundamentals of digital logic with VHDL design. McGraw-Hill, 2005 2. UYEMURA, John P. Diseo de sistemas digitales. Thomson, 2000. 3. HAYES, John P. Introduccin al diseo lgico digital . 3 ed. Massachusetts: Addison Wesley Iberoamericana, 1996. 560p. 4. Morris, Mano M. Lgica digital y diseo de Computadores. 3 ed. Mxico. Prentice Hall, 2000. 491p. 5. FLOYD, Thomas Fundamentos de sistemas digitales . 3 ed. Madrid :Prentice Hall, 2000. 828p. 6. MANDADO, Enrique. Sistemas electrnicos digitales. 7 ed. Mxico: Alfaomega, 1991. 963p. 7. http://moodle.ucentral.edu.co/moodle/ 8. www.xilinx.com 9. www.AllDataSheet.com 10. www.atmel.com

COMPETENCIAS El presente trabajo experimental se debe desarrollar desde el tema de competencias acadmicas en tres etapas a saber: 1. Primera etapa. El grupo de estudiantes evaluar el problema planteado desde las siguientes competencias:

Interpretativa Argumentativa 2. Segunda etapa. En esta fase de desarrollo se analizar el problema desde las siguientes competencias: Propositiva Investigativa 3. Tercera etapa. En esta ltima fase de solucin al problema planteado, ste se debe ver a la luz de las siguientes competencias:

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Social Disciplinar Al final de las tres etapas, el grupo de trabajo deber entregar un informe de laboratorio en formato IEEE, incluyendo el proceso anterior. ASPECTOS TERICOS Simplificacin de funciones. Mapas de Karnaugh. Introduccin a los PLD's; PLA, PAL, GAL. Programacin de PLD's. FPGAs. Lenguajes de descripcin de hardware. Lenguaje VHDL. Descripcin flujo de datos y comportamental en VHDL. Decodificadores.

PREGUNTAS PREVIAS PARA EL DESARROLLO DE LA PRCTICA No aplica. DESARROLLO PRCTICO

LOS SIGUIENTES PUNTOS SE DEBE IMPLEMENTAR EN LA TARJETA SPARTAN-3E DE DIGILENT:

1. Disear e implementar realizando la descripcin en VHDL de un circuito que sume dos nmeros de 2 bits ( A1 A0 y B1 B0 ). A su vez el circuito deber tener una seal de salida X, que se activara (colocar en 1) para indicar que A es igual que B. (Valor=2.0) Visualice el resultado de la suma en un display de 7 segmentos, y la salida X en un LED. La descripcin puede realizarse por medio de las ecuaciones booleanas, o instrucciones concurrentes, o instrucciones secuenciales. Se debe emplear el PmodSSD - Seven-segment display de la empresa Digilent el cual trae dos displays de 7 segmentos.

Figura 1. PmodSSD - Seven-segment display. Tomado de www.digilentinc.com

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2. Disear e implementar realizando la descripcin en VHDL de un decodificador de 3 a 8 con entradas activas en alto y salidas activas en bajo, y un habilitador activo en bajo. Visualizar salidas en LEDs. (Valor=1.0)

LOS SIGUIENTES PUNTOS SE DEBEN IMPLEMENTAR EN LA GAL22V10:

3. Disear e implementar realizando la descripcin en VHDL de un decodificador para un display de 14 o 16 segmentos. Disear e implementar un circuito que visualice en un display de 14 o 16 segmentos las siguientes combinaciones dependiendo de un valor de entrada de 4 bits. Solo se debe utilizar un display de 14 o 16 segmentos. (Valor=2.0) 0000 0001 0010 0011 0100 0101 0110 0111 1000 1001 1010 1011 1100 1101 1110 1111 I L O V E F P G A ** ** **

** Con estas combinaciones se deben visualizar la letra inicial de cualquiera de los nombres o apellidos de cada uno de los integrantes del grupo de laboratorio (no se debe repetir ninguna). Puede realizar la descripcin del diseo de forma flujo de datos o comportamental (se puede utilizar de nodo o ctodo comn).

Figura 2. Tipos de displays basado en LEDs. Tomado de http://www.screens.ru/photo/2003/7/fig6.gif GRFICAS (s aplica) Realizar los diagramas circuitales de los diseos realizados en esta prctica. Realizar las simulaciones de los diseos realizados en esta prctica.

CUESTIONARIO - Cunto fue el porcentaje de utilizacin del dispositivo en cada diseo?

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REGLAS: - Grupos mximo de tres (3) personas. - Todos los integrantes deben estar presentes el da de la sustentacin. - Se debe entregar el informe de laboratorio utilizando las normas designadas. - El informe debe contener objetivos, resumen, descripcin clara del proceso de diseo y simplificacin, tablas de verdad, mapas de Karnaugh, cdigo en VHDL comentariado, simulacin de las descripciones realizadas, diagramas de bloques, diagramas circuitales, solucin a las preguntas planteadas y conclusiones. - El da de la fecha de entrega del laboratorio deben traer ya armados los circuitos y entregar el informe. - Prevea cualquier inconveniente logstico. - Cdigos fuente diferentes, evitar copia o plagio. Cualquier tipo de fraude en los trabajos, tareas, talleres y exmenes es considerado como una falta grave en la Universidad. - El informe se presenta en hojas tamao carta, todo en computador, y con diagramas circuitales hechos en un software de captura de esquemticos (Ejemplo: PROTEUS, Altium Designer, etc.). - Entregar el trabajo en la fecha y hora indicadas, subir los archivos de simulacin y soportes en el Aula virtual del curso. Adjuntar archivo de texto con nombres de integrantes. - Seguir las normas de diseo y entrega indicadas por el docente en la sesin de inicio. Etiquetar claramente las entradas y salidas del diseo realizado. - Adjuntar archivos de los diseos y proyectos realizados en el link habilitado en el Aula virtual.