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Logique séquentielle
Fonction Mémoire
1 – Introduction
Logique combinatoire :
Logique séquentielle :
at ma at km
km ma
KM KM
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Qn : sortie à l’état n
Qn-1 : sortie à l’état précédent
Bascules : système électronique de mémorisation
3 – 2 Représentation
Entrées Sorties
3 – 3 Horloges
Certaines bascules sont synchronisées avec des horloges. Une horloge est un signal périodique
carré précis produit par des circuits RC ou quartz
H
Synchronisation sur le front montant de l’horloge
H
Synchronisation sur le front descendant de l’horloge
H
Synchronisation sur le niveau bas de l’horloge
H
Synchronisation sur le niveau haut de l’horloge
3 – 4 Principe
Des entrées mettent à 1 (Set) ou à 0 (Reset) des sorties. Il faut en plus tenir compte de l’état
précédent de la sortie. Les sorties sont électroniquement mémorisées et conservées jusqu’à un
autre ordre.
• RS S Q D Q J Q
• D H
H
• JK R K
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4 - Bascule RS
Q : Sortie complémentée
On peut réaliser l’équation précédente avec des portes NAND ou des NOR.
S & Q
&
Q
&
R &
A chaque front montant, on regarde les niveaux des entrées et on fait évoluer la sortie.
T
T R S Q
0 X X µ t
0 0 0 S
0 1 1
t
1 0 0
R
1 1 0/1
t
Q
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6 - Bascule D synchrone
Il s’agit d’une bascule RS dont on a modifié le comportement en ajoutant une fonction NON
entre S et R.
H D Q
D S Q
X 0/1 µ
1 T 1 1
H R Q 0 0
Exemple 40174
Ici H s’appelle CLOCK et la fonction CLEAR est active au niveau bas quelles que soient les
entrées.
Clock
t
D
t
Clear
t
Q
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7 – Bascule JK
Cette bascule permet de prendre en compte les états indéterminés de la bascule RS.
⇒ lorsque les deux entrées sont à 1, la sortie bascule (toggle) vers le complément de l’état
précédent.
J = K = 1 ⇒ Qn = Qn−1
PRE
H J K Qn
J Q 0 X X Qn-1
H 0 0 Qn-1
K 0 1 0
1 0 1
CLR 1 1 Qn−1
Exemple 74LS78a
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1 – Mise en situation
mise en paquet de 6 œufs après le marquage
c b a Valeur e
décimale
t
0 0 0 0
0 0 1 1 a
0 1 0 2 t
0 1 1 3
b
1 0 0 4
t
1 0 1 5
1 1 0 6 c
1 1 1 7 t
0 1 2 3 4 5 6 7 0
4 – Diviseur de fréquence
On branche en permanence J et K à 1, la sortie passera au complément de l’état précédent à
chaque front ici descendant.
1
H
J Q
t
H
K Q
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5 – Compteur asynchrone
Le compteur asynchrone est constitué de diviseurs de fréquence branchés en cascade.
Qa Qb Qc
J Q J Q J Q
H
K R K R K R
CLR
6 – Compteur synchrone
On utilise la particularité du changement d’état de c quand a et b ont simultanément un front
descendant.
Qa Qb Qc
&
1
J Q J Q J Q
H
K R K R K R
CLR
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Schéma structurel
b
CLR
c &
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