INSTITUTO TECNOLGICO DE PACHUCA

Carlos Andrs Islas Maldonado Galindo Alvarez Mayra Berenice Chavarria Alvarado Amairani Ins Espinosa Lorenzo Emanuel

Eric len olivares

Arquitecturas de Cmputo

Cuadro Comparativo de los Modelos Arquitecturas de Cmputo

Pachuca Hgo a 5 de febrero del 2014

Cuadro Comparativo de los Modelos Arquitecturas de Cmputo

ARQUITECTURAS CLASICAS

OTRAS ARQUITECTURAS

Arquitectura Mauchly-Eckert ARQUITECTURA (Von Neumann) Harvard ARQUITECTURAS SEGMENTADAS

ARQUITECTURAS DE MULTIPROCSAMIENTO

DEFINICIN

Este tipo de arquitecturas buscan mejorar el desempeo realizando paralelamente varias etapas Es una familia de arquitectura de Es la arquitectura que utiliza dispositivos de Cuando se requiere utilizar ms de un del ciclo de instruccin al mismo tiempo. El computadoras que utilizan el mismo almacenamiento fsicamente separados procesador para la ejecucin del programa de procesador se divide en varias unidades funcionales dispositivo de almacenamiento tanto para las para las instrucciones y para los datos. aplicacin. independientes y se dividen entre ellas el instrucciones como para los datos. procesamiento de las instrucciones. Surgen con la necesidad de aumentar la velocidad de procesamiento. Con la implementacin de este modelo se logr realizar ms procesos al mismo El tener una memoria de programa y una tiempo, sin embargo, este no fue sinnimo de memoria de datos la hace una arquitectura rapidez. mucho ms estable y con ms velocidad Esto debido a que no todos los procesos se toman al aunque no sea tan utilizada. mismo tiempo para ejecutarse, lo que ocasiona una gran competencia respecto al uso de los recursos del CPU. Por excelencia es utilizada en supercomputadoras, en los micro controladores, y sistemas embebidos en general. Esta arquitectura suele utilizarse en DSPs, o procesador de seal digital, usados habitualmente en productos para procesamiento de audio y video. Tambin es utilizada en telfonos celulares. Esta arquitectura es muy comn en el desarrollo de programas para el intrprete de comandos, ya que se pueden concatenar comandos fcilmente con tuberas (pipe). Pipe-lines de software o tuberas: consiste en mltiples procesos ordenados de tal forma que el flujo de salida de un proceso alimenta la entrada del siguiente proceso. Varios procesadores comparten la misma memoria principal y perifricos de I/O, Normalmente conectados por un bus comn.

VELOCIDAD

La arquitectura de Von Neumann a pesar de ser la ms utilizada en nuestros das es ms lenta que la arquitectura de Harvard, esto se debe a su flexibilidad para el uso de diferentes tipos de programas

ES UTILIZADA EN:

Esta arquitectura es la ms empleada en la actualidad ya, que es muy verstil (Ejemplo de ello son los compiladores). Esta arquitectura es la variante adecuada para las PC. Ya que es lenta pero flexible, adaptable y modificable en ciertos casos.

USO DE LA MEMORIA

Las instrucciones y los datos se almacenan Se utiliza una sola cach para datos e en cachs separadas para mejorar el instrucciones (programas), lo cual merma el rendimiento. desempeo

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COSTO

Esta arquitectura es la variante adecuada para las PC, porque permite ahorrar una buena cantidad de lneas de E/S, que son bastante costosas, sobre todo para aquellos sistemas como las PC, donde el procesador se monta en algn tipo de socket alojado en una placa madre (motherboard). Tambin esta organizacin les ahorra a los diseadores de motherboards una buena cantidad de problemas y reduce el costo de este tipo de sistemas.

Consume muchas lneas de E/S del procesador; por lo que en sistemas donde el procesador est ubicado en su propio encapsulado, solo se utiliza en supercomputadoras. Los diseadores de motherboards tienen una cantidad grande de problemas ya que es un poco ms compleja su conexin y este tipo de sistemas suele ser ms costoso.

Ventajas

Tiene un solo bus ya que al haber un nico cableado para para el acceso a datos e instrucciones, se facilita en gran medida la conexin de memoria externa a travs de las lneas de e/s con una mnima implementacin extra de hardware.

El tiempo de acceso a las instrucciones puede superponerse con el de los datos, logrando una mayor velocidad en cada operacin. Disminuyo el cuello de botella en el acceso a memoria.

En este esquema se sigue tomando el mismo nmero de ciclos de reloj ( el mismo tiempo), pero como se trabaja en varias instrucciones al mismo tiempo, el numero promedio de instrucciones por segundo se multiplica.

Desventajas

Es que el bus de datos y direcciones nico se convierte en un cuello de botella por el cual debe pasar toda la informacin que se lee de o se escribe a la memoria, obligando a que Cuando solo hay una memoria cache la todos los accesos a esta sean secuenciales. divide en dos disminuyendo el rendimiento Limita el grado de paralelismo. en caso de que las instrucciones o los datos no tengan el mismo espacio. La limitacin de la longitud de las instrucciones por el bus de datos, que hace que el Microprocesador tenga que realizar varios accesos a memoria para buscar instrucciones complejas.

La mejora en el rendimiento no es proporcional al nmero de segmentos en el cauce debido a que cada etapa no toma el mismo tiempo en realizarse, adems de que se puede presentar competencia por el uso de algunos recursos con la memoria principal. Cuando se encuentra un salto en el programa y todas las instrucciones que ya se buscaron y se encuentran en la cola, deben descartarse y comenzar a buscar instrucciones desde cero a partir de la direccin a la que se salt. Esto reduce el desempeo del procesador y an se investigan maneras de predecir los saltos para evitar este problema

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DIAGRAMA

http://www.fing.edu.uy/tecnoinf/mvd/cursos/arqcomp/material/teorico/arq-teorico05.pdf http://www.slideshare.net/jesus199025/arquitectura-harvard-2010-1 http://prezi.com/eiho_afo9czw/von-neumann/ http://www.scribd.com/doc/6190163/Arquitectura-de-Von-Neumann

http://www.elec.canterbury.ac.nz/PublicArea/Staff/hof/p10-embed/p10-tutorial/p13.html

http://comping.galeon.com/productos2326864.html

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