Familias Logicas

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ELECTRNICA DIGITAL
CIRCUITOS LOGICOS COMBINATORIOS
FAMLIAS LGICAS
FAMLIAS LGICAS
Famlias lgicas uma expresso usada para referir o conjunto de alternativas tecnolgicas que existem para o fabrico de circuitos integrados digitais As primeiras famlias lgicas diferiam entre si essencialmente pelo facto de os respectivos circuitos integrados serem construdos com base em transstores bipolares (TTL - Transistor-Transistor Logic) ou com base em transstores MOS-FET (MOS - Metal-OxideSilicon).
Electrnica Digital - Implementao de Circuitos Lgicos Combinatrios
FAMLIAS LGICAS
Cada CI (Circuito Integrado) precisa de uma determinada potncia elctrica para operar. Tal potncia fornecida por uma ou mais fontes de tenso, ligadas aos pinos de alimentao do chip. Normalmente, s necessrio ligar um nico pino para alimentao do chip Denomina-se como VCC para a famlia TTL e VDD para os dispositivos MOS. Assim como GND e VSS respectivamente.
FAMILIAS LOGICAS
FAMILIAS LOGICAS
FAMILIA TTL
uma das famlias mais conhecidas e mais utilizadas Os transstores bipolares permitem maior rapidez (maior frequncia), mas custa de maior consumo. TTL e CMOS constituram as alternativas principais durante muitos anos, mas a evoluo tecnolgica permitiu o aparecimento regular de outras solues de compromisso entre a velocidade e o consumo: L (low power), S (Schottky), LS (low-power Schottky), etc.
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FAMILIA TTL
Em 1964, a Texas Instruments Corporation introduziu as sries 54/74 de circuitos integrados TTL-padro. A srie 54 difere da 74 por operar em valores de temperatura e de tenso mais altas. Cada fabricante acrescenta um prefixo na descrio do CI, por exemplo: SN7400 (Texas); DM7400 (National Instruments) ou S7400 (Signetics).
FAMILIA TTL
TTL significa Transistor-Transistor Logic (Lgica TransistorTransistor). A tenso de alimentao restringe-se a 5V contnuos, tendo, porm, uma faixa de tenso correspondente aos nveis lgicos 0 e 1. A figura abaixo mostra as faixas de tenso correspondentes aos nveis lgicos de entrada de um circuito integrado da famlia TTL.
VIH Tenso de entrada correspondente ao nvel lgico alto (1). VIL Tenso de entrada correspondente ao nvel lgico baixo (0). Electrnica Digital - Implementao de Circuitos Lgicos Combinatrios 9
FAMILIA TTL
A figura abaixo mostra as faixas de tenso correspondentes aos nveis lgicos de sada de um circuito integrado da famlia TTL.
V0H Tenso de sada correspondente ao nvel lgico alto (1). V0L Tenso de sada correspondente ao nvel lgico baixo (0).
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FAMILIA TTL
Dentro da famlia TTL existem varias sub-famlias
O fan-out, tambm chamado factor de carga, definido como o nmero mximo de entradas de circuitos lgicos que uma sada pode alimentar
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FAMILIA TTL
Uma sada TTL age como um absorvedor de corrente no nvel lgico BAIXO, recebendo corrente da entrada da porta lgica a que ela estiver conectada.
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FAMILIA TTL
Uma sada TTL age como uma fornecedora de corrente quando estiver no nvel lgico ALTO, sendo uma corrente de fuga pequena da ordem de 10 A.
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FAMILIA TTL - EXEMPLO
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TEMPO DE PROPAGAO
uma das mais importantes caractersticas que diferencia as famlias lgicas, e uma das que define a nossa escolha em funo da velocidade de resposta que pretendemos obter. Tempo que demora a propagao da variao de um sinal, desde a entrada da gate at sada. A velocidade de funcionamento ser tanto menor quanto maior for o atraso de propagao.
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TEMPO DE PROPAGAO
Apresenta-se abaixo um exemplo de um diagrama de nveis de sada, considerando os respectivos tempos de propagao.
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TEMPO DE PROPAGAO
Apresenta-se abaixo um exemplo de um diagrama de nveis de sada, considerando os respectivos tempos de propagao.
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TEMPO DE PROPAGAO-VERIFICAO
Para realizar uma anlise simplificada do pior caso de propagao na lgica de um circuito sem qualquer realimentao, basta estimarmos o pior dos casos de atrasos. Considere o seguinte circuito:
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A at S dois caminhos 22ns + 20ns = 42ns (mais longo) 15ns + 20ns = 35ns A at C um caminho 15ns + 15ns = 30ns B at S dois caminhos 22ns + 20ns = 42ns (mais longo) 15ns + 20ns = 35ns B at C um caminho 15ns + 15ns = 30ns
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Conclui-se ento que a situao ou situaes mais desfavorveis so: A at S, passando por X 42ns B at S, passando por X 42ns
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FAN-OUT
Fan-Out (ou sada em leque) a quantidade de portas lgicas que podem ser conectadas na sada de uma outra porta lgica da mesma famlia. dada pela frmula: Fan-Out = min (nH, nL)
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FAN-OUT
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FAN-OUT
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FAN-OUT
Para conectar mais cargas, a porta de sada deveria ser capaz de fornecer mais corrente. Uma forma de realizar isso seria atravs das portas de colector aberto. Por exemplo, para alimentar 15 cargas TTL pode-se usar o C.I. 7401 (4 portas NAND de colector aberto):
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FAN-OUT
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ACCIONAMENTO DE DISPOSITIVOS
Um LED para ser acesso precisa ter uma queda de tenso de cerca de 1,5V e uma corrente de cerca de 10 mA at 25 mA. As figuras abaixo mostram como se pode accionar ou no um LED:
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TTL COLECTOR ABERTO
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TTL COLECTOR ABERTO

So dispositivos em que as suas sadas possuem um transstor nos quais o colector no tem ligao (ou est em aberto). Nestes componentes as sadas devem ser ligadas alimentao (Vcc) atravs de uma resistncia (conhecido com resistncia elevadora ou de Pull-up). A vantagem deste componente est na possibilidade de poder alimentar um outro circuito que exija uma corrente maior do que aquela que a famlia TTL consegue fornecer.
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TTL - TRISTATE
um TTL modificado que permite conectar as sadas directamente, sem a necessidade de usar os dispositivos de colector aberto, possui uma capacidade maior de fornecer corrente. A vantagem a reduo do tempo de comutao necessrio para mudar o estado de sada. A figura seguinte mostra uma porta NAND com sada em tri-state.
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TTL - TRISTATE
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TTL - PORTAS
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FAMILIA CMOS
A tecnologia MOS normalmente a preferida para a implementao de circuitos mais complexos, quer por apresentar menores requisitos de rea por transstor, quer por apresentar menor consumo. TTL e CMOS constituram as alternativas principais durante muitos anos, mas a evoluo tecnolgica permitiu o aparecimento regular de outras solues de compromisso entre a velocidade e o consumo: Em CMOS, temos as variantes HC (high-speed CMOS) e HCT (compatvel pino a pino com os TTL).
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FAMILIA CMOS
CMOS significa Complementary Metal Oxide Semiconductor (Semicondutor de xido-Metal Complementar), usa tanto FETs canal-N quanto canal-P no mesmo circuito, de forma a aproveitar as vantagens de ambas as famlias lgicas. As caractersticas principais desta famlia so o reduzido consumo de corrente (baixa potncia), alta imunidade a rudos e uma faixa de alimentao que se estende de 3V a 15V ou 18V dependendo do modelo.
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FAMILIA CMOS
O processo de fabricao do CMOS mais simples que o do TTL, possuindo tambm uma densidade de integrao maior, porm so mais lentos do que os TTL, apesar da nova srie CMOS de alta velocidade competir em p de igualdade com as sries TTL 74 e 74LS. A famlia CMOS possui, tambm, uma determinada faixa de tenso para representar os nveis lgicos de entrada e de sada, porm estes valores dependem da tenso de alimentao e da temperatura ambiente.
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FAMILIA CMOS -SERIES

As Sries 4000/14000. As sries 4000 e 14000, introduzidas pela RCA e Motorola Inc, respectivamente, foram as primeiras sries da famlia CMOS. A srie 4000B possui alguns melhoramentos com relao srie 4000A, suportando correntes de sada mais altas. A Srie 74C. Essa srie CMOS compatvel ao CI TTL de mesmo nmero com relao funo e pinagem. A performance da srie 74C semelhante da srie 4000.
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FAMILIA CMOS -SERIES

A Srie 74HC (CMOS de Alta Velocidade). A srie 74HC possui tempos de comutao compatveis com a srie TTL 74LS e 10 vezes menor que a srie 74C, alm de suportar maiores correntes de sada. A Srie 74HCT. Esta tambm uma srie CMOS de alta velocidade e foi desenvolvida para trabalhar com tenses compatveis com a lgica TTL. Desse modo, CIs 74HCT podem ser ligados diretamente com CIs TTL.
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FAMILIA CMOS - EXEMPLO
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CMOS - PORTAS
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INTERFACE TTL/CMOS
O problema na ligao entre uma porta TTL e uma porta CMOS acontece no nvel alto. O TTL pode fornecer um nvel alto de sada de 2,4 V at 5 V, mas o CMOS s reconhece o nvel alto a partir de 3,5 V. Para o nvel baixo o problema no ocorre, uma vez que a janela TTL baixa se encaixa na janela CMOS baixa:
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INTERFACE TTL/CMOS (SOLUO?!)

A soluo seria utilizar uma resistncia elevatria Ou na outra opo seria utilizar um TTL de colector aberto
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LIMITADOR SCHMITT-TRIGGER
Converte variaes lentas na entrada em transies rpidas na sadas. Indicado para interface entre sinais de variaes lentas e circuitos lgicos. til para recepo de sinais com rudo. Entradas no ligadas: forar a L: ligar a GND forar a H: ligar a Vcc (atravs de uma resistncia de pull-up 1k e, std TTL -)
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LIMITADOR SCHMITT-TRIGGER
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FAMILIA ECL
ECL significa Emitter Coupled Logic (Lgica Acoplada por Emissor) A ECL a famlia de circuitos lgicos mais rpida, tendo sido projectada de forma a no permitir a saturao dos transstores bipolares com objectivo de aumentar a velocidade de comutao O ECL emprega um par diferencial de transstores bipolares operando como interruptor de corrente. Propicia tcnicas de switching por lgica de modo de corrente. A ECL utilizada em circuitos SSI, MSI, LSI e VLSI.
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FAMILIA ECL
O circuito menos afectado por rudo dado sua natureza diferencial. A corrente drenada de fonte permanece constante durante o switching. A disponibilidade de sadas complementares simplifica o projecto lgico de ECL. Os nveis de sada so definidos em relao a VCC e podem ser estveis fazendo VCC=0.
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FAMILIA ECL
Funo de Transferncia para um par diferencial bipolar
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FAMILIA ECL
SUB-FAMILIAS ECL ECL 10 K ECL 100 Tempo de atraso de propagao Dissipao de potncia por porta Produto atraso potncia 2 ns 25 mW 50 pJ 0.75 ns 40 mW 30 pJ
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FAMILIA ECL
Exemplo de Porta Lgica
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ACCIONAMENTO DE DISPOSITIVOS
Na primeira figura: Corrente de sada baixa da porta NAND = 16mA (Usar uma corrente de 15 mA) R= U/I = (5-1,5)/15mA = 0,233 K Na segunda figura, a corrente de sada alta da porta NAND = 400 A. Esta corrente muito baixa, no d para accionar o LED, uma vez que o LED precisa de pelos menos 10-15 mA. Na terceira figura, temos uma forma de accionar o LED utilizando um transstor como drive. Calcular primeiro resistncia R1. Considerando a queda do LED de 1.5 V e uma corrente de 15 mA. NOTA: Para funcionar correctamente transstor deve ter a resistncia de base pelo menos igual a 10 vezes a resistncia no colector.
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PARMETROS DE COMPARAO ENTRE FAMILIAS LGICAS DIGITAIS

FAN-IN especifica o nmero de entradas disponveis numa gate FAN-OUT especifica o nmero de cargas padro que uma sada de uma gate tpica pode alimentar sem comprometer o seu desempenho MARGEM DE RUDO tenso de rudo externa mxima que sobreposta a um valor de entrada normal no causa comutaes indesejveis na sada do circuito DISSIPAO DE POTNCIA potncia consumida pela gate, disponibilizada pela fonte de alimentao. Muita da potncia consumida dissipada na forma de calor, de modo que este factor deve tomar-se em considerao em relao aos requisitos de temperatura de funcionamento e arrefecimento do dispositivo ATRASO DE PROPAGAO tempo que demora a propagao da variao de um sinal, desde a entrada da gate at sada. A velocidade de funcionamento ser tanto menor quanto maior for o atraso de propagao. O atraso de propagao o parmetro mais importante ao nvel do projecto lgico FREQUNCIA DE TRABALHO a frequncia para a qual a porta lgica consegue fornecer uma resposta aceitvel, de acordo com o que foi especificado na elaborao do circuito.
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EVOLUO DA TECNOLOGIA LOGICA

Com objectivo de aumentar a escala de integrao, vrias sries lgicas operam com tenses de 3,3V e novas sries funcionam com 2,5V. Os CPUs mais recentes so dispositivos de 2,5-2,7V e chips de RAM dinmica de 3,3V so usadas em PCs.
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EVOLUO DA TECNOLOGIA LOGICA

Famlia CMOS 74LVC (CMOS de baixa tenso - Low-voltage CMOS): pode lidar com lgica de 3,3V e 5V; 74ALVC (CMOS de baixa tenso avanada - Advanced low-voltage CMOS): aplicaes de interface de barramento de 3,3V; 74LV (baixa tenso - Low-voltage): opera apenas com lgica de 3,3V; 74AVC (CMOS de tenso muito baixa avanada - Advanced very-low-voltage): optimizada para sistemas de 2,5V a 2ns, rivalizando com 74AS. 74LVT (BiCMOS de baixa tenso - Low-voltage BiCMOS technology): pode lidar com lgica de 3,3V e 5V; 74ALVT (BiCMOS de baixa tenso avanada - Advanced low-voltage BiCMOS technology): operao de 3,3V ou 2,5V a 3ns; 74ALB (BiCMOS de baixa tenso avanada - Advanced low-voltage BiCMOS): interfaces de barramento de 3,3V com accionamento de 25mA a 2,2ns.
Famlia BiCMOS:
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FIM
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PORTAS LGICAS
Porta lgica AND (e)

Smbolo novo Smbolo antigo A S B Expresso da funo Tabela de verdade
A 0 0 B 0 1 0 1 S 0 0 0 1
S=AxB
Analogia da porta lgica AND com um circuito elctrico: +

A B S
1 1
Quando as duas entradas (A e B) so zero (interruptores desligados) a sada (S) tambm zero (lmpada apagada). Quando uma s das entradas 1 (um s interruptor ligado) a sada (S) zero (lmpada apagada). Quando as duas entradas (A e B) so 1 (os dois interruptores ligados) a sada (S) tambm 1 (lmpada acesa), CONCLUSO: S temos o nvel lgico 1 na sada quando todas as entradas forem 1 (neste caso, A e B) Electrnica Digital - Implementao de Circuitos Lgicos Combinatrios 54
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Porta lgica NAND (no e)

Smbolo novo Smbolo antigo A Expresso da funo Tabela de verdade
A B 0 1 0 1 S 1 1 1 0
S=AxB
0 0
Negao
1 1
A porta lgica NAND uma porta lgica AND com a sada negada. Pode observar-se que os nveis lgicos da sada (S) da tabela de verdade NAND a negao dos nveis lgicos da sada (S) da tabela de verdade AND.
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Porta lgica OR (ou)

Smbolo novo Smbolo antigo A S B Expresso da funo Tabela de verdade
A B 0 1 0 1 S 0 1 1 1
S=A+B
0 0 1
Analogia da porta lgica OR com um circuito elctrico:
Quando as duas entradas (A e B) so zero (interruptores desligados) a sada (S) tambm zero (lmpada apagada).
A
Quando uma s das entradas 1 (um s interruptor ligado) a sada (S) um (lmpada acesa). Quando as duas entradas (A e B) so 1 (os dois interruptores ligados) a sada (S) tambm 1 (lmpada acesa), CONCLUSO: S temos o nvel lgico 0 na sada quando todas as entradas forem 0.
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28
Porta lgica NOR (no ou)

Smbolo novo Smbolo antigo Expresso da funo Tabela de verdade
A B 0 1 0 1 S 1 0 0 0
1
B
S=A+B
0 0
Negao
1 1
A porta lgica NOR uma porta lgica OR com a sada negada. Pode observar-se que os nveis lgicos da sada (S) da tabela de verdade NOR a negao dos nveis lgicos da sada (S) da tabela de verdade OR.
57
Porta lgica NOT (negao)

A S 1 0
S=A
0 1
O nvel lgico da sada (S) a negao do nvel lgico da entrada (A).
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Porta Exclusive OR(ou exclusivo)

A B 0 1 0 1 S 0 1 1 0
=1
B
S=AB
0 0 1 1
A sada 1 se uma entrada 1 ou a outra entrada 1, mas no ambas. De outro modo: o valor da sada (S) 1 se as entradas (A ou B) so diferentes e 0 se so iguais.
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Porta EXclusive NOR(no ou exclusivo)

A B 0 1 0 1 S 1 0 0 1
=1
B
S=AB
0 0
Negao
1 1
A porta lgica abreviadamente designada por EX-NOR uma porta lgica EX-OR com a sada negada. Pode observar-se que os nveis lgicos da sada (S) da tabela de verdade EX-NOR a negao dos nveis lgicos da sada (S) da tabela de verdade EX-OR.
60
30
TEOREMAS ALGEBRA
61
FIM
31

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