Académique Documents
Professionnel Documents
Culture Documents
Introduccin
#egistros
Contadores
Subsistema secuencial
Se$ales de control
Entradas de datos
Salidas de datos
Salidas de estado
Estructura modular
Introduccin
#egistros
Clasificacin
#egistro %aralelo%aralelo
#egistro de des%la*amiento
#egistro universal
Contadores
9%eraciones bsicas,
Entrada en %aralelo
Entrada serie
Salida en %aralelo
Salida serie
Introduccin
#egistros
Contadores
Contador descendente
Contador reversible
Contadores no binarios
Dise$o
9%eraciones t0%icas
Cuenta ascendente
Cuenta descendente
Salidas t0%icas
Estado de cuenta
Ain de cuenta
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
Bdulo
Cinario
Bdulo 2
n
Cuenta de ! a 2
n
21 &n bits'
Cuenta c0clica
Cuenta ascendente
=i > (
i
si (
)
>13 )Ki
Si no3 =i > (
i
J
i
=K
i
=q
i1
q
i2
... q
0
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
C95T
CK
CL
z
3
z
2
z
1
z
0
9%eracin Et. t0%ica Et. !
( < (D1E
mod 1F
?
i
>@
i
>(
i21
... (
!
?
!
>@
!
>1
biest. C.C.
C.C.
control
datos
estado
*
i
(
i
Tabla de o%eracin s0ncrona
K
i
q
i
J
i
CL
i
q
i-1
q
0
CL
CK
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
. Circuito
. Circuito
K
0
q
0
J
0
CL
0
CL
CK
K
1
q
1
J
1
CL
1
K
2
q
2
J
2
CL
2
K
3
q
3
J
3
CL
3
1
z
0
z
1
z
2
z
3
K
1
q
1
J
1
CL
1
K
0
q
0
J
0
CL
0
CL
CK
K
1
q
1
J
1
CL
1
K
2
q
2
J
2
CL
2
K
3
q
3
J
3
CL
3
1
z
0
z
1
z
2
z
3
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
con
con
%uesta a cero + 4abilitacin
%uesta a cero + 4abilitacin
C95T
CK
EN
CL
z
3
z
2
z
1
z
0
C.3 E5 9%eracin Ti%o
17 ( < ! s0nc.
!1 ( < (D1E
mod 1F
s0nc.
!! ( < ( s0nc.
Tabla de o%eracin
module count%mod$*(
input ck,
input cl,
input en,
output [3:0] z
);
reg [3:0] q;
always (posedge ck)
i! (cl "" $)
q #" 0;
else i! (en "" $)
q #" q + $;
assign z " q;
endmodule
Cdigo ;erilog
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
con
con
%uesta a cero + 4abilitacin
%uesta a cero + 4abilitacin
C95T
CK
EN
CL
z
3
z
2
z
1
z
0
C.3 E5 9%eracin Et. t0%ica Et. !
17 ( < ! ?
i
>!3 @
i
>1 ?
!
>!3 @
!
>1
!1 ( < (D1E
mod 1F
?
i
>@
i
>(
i21
... (
!
?
!
>@
!
>1
!! ( < ( ?
i
>@
i
>! ?
!
>@
!
>!
biest. C.C.
C.C.
control
datos
estado
*
i
(
i
Tabla de o%eracin s0ncrona
K
i
q
i
J
i
q
i-1
q
0
CL
CK
0
1
2
3
0 1
0
1
2
3
0 1
EN
0
0
0
0
1
1
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
con
con
%uesta a cero + 4abilitacin. Circuito
%uesta a cero + 4abilitacin. Circuito
6abilitacin
Ain de cuenta
Departamento de Tecnologa Electrnica Universidad de Sevilla
Unin de contadores
Unin de contadores
0
=x, !
0
=x
!1 ( < (D1E
mod 1F
?
i
>@
i
>(
i21
... (
!
?
!
>@
!
>1
!! ( < ( ?
i
>@
i
>! ?
!
>@
!
>!
biest. C.C.
C.C.
control
datos
estado
*
i
(
i
Tabla de o%eracin s0ncrona
C95T
CK
EN
LD
z
3
z
2
z
1
z
0
x
3
x
2
x
1
x
0
K
i
q
i
J
i
q
i-1
q
0
LD
CK
0
1
2
3
0 1
0
1
2
3
0 1
EN
0
0
x
i
x
i
x
i
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador binario mdulo 2
Contador binario mdulo 2
n n
con
con
%uesta a cero3 4abilitacin + carga
%uesta a cero3 4abilitacin + carga
Casos
Estrategia
Cuenta descendente
=i > (
i
si (
)
>!3 )Ki
Si no3 =i > (
i
J
i
=K
i
=q
i1
q
i2
...q
0
J
i
=K
i
=q
i1
q
i2
...q
0
Departamento de Tecnologa Electrnica Universidad de Sevilla
Salida de fin de cuenta
Salida de fin de cuenta
5ativos
Contadores de des%la*amiento
Contador en anillo
Contador ?o4nson
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador :ra+ con convertidor de
Contador :ra+ con convertidor de
cdigo
cdigo
C95T
CK
z
3
z
2
z
1
z
0
CL
CI5:#8Q
module graycounter%mod$*(
input ck,
input cl,
output [3:0] z
);
reg [3:0] q;
always (posedge ck)
i! (cl "" $)
q #" 0;
else
q #" q + $;
assign z = q ^ (q >> 1);
endmodule
Cdigo ;erilog *
G
*
2
*
1
*
!
!!!!
!!!1
!!11
!!1!
!11!
!111
!1!1
!1!!
11!!
11!1
1111
111!
1!1!
1!11
1!!1
1!!!
Departamento de Tecnologa Electrnica Universidad de Sevilla
Contador en anillo
Contador en anillo
! ! 1 !
CK
q
3
D
3
PR
q
3
D
3
CL
q
3
D
3
CL
q
3
D
3
CL
CK
START
z
3
z
2
z
1
z
0
*
G
*
2
*
1
*
!
1!!!
!1!!
!!1!
!!!1
1!!!
...
Departamento de Tecnologa Electrnica Universidad de Sevilla
Dise$o con subsistemas secuenciales
Dise$o con subsistemas secuenciales
Introduccin
#egistros
Contadores
E)em%los
Departamento de Tecnologa Electrnica Universidad de Sevilla
:enerador de secuencia
:enerador de secuencia
Con contador + CC
C95T
CK
z
START
C.C.
CL
CK
z
START
0
1
2
3
0 1
C95T
CL
q
1
q
0
0
0
1
1
module seq%gen(
input ck,
input start,
output z
);
reg [$:0] q; reg z;
always (posedge ck)
i! (start "" $)
q #" 0;
else
q #" q + $;
case (q)
(4&0: z " $4.0;
(4&$: z " $4.0;
(4&(: z " $4.$;
(4&3: z " $4.$;
endcase
endmodule
Cdigo ;erilog
Departamento de Tecnologa Electrnica Universidad de Sevilla
Detector de secuencia
Detector de secuencia
CK
z
1 ! 1 !
x
C.C.
det. sec.
CK
x
z
CK
z
x
S6#
RESET CL
module seq%det(
input ck, input reset,
input x,
output z
);
reg [3:0] q;
always (posedge ck)
i! (reset "" $)
q #" 0;
else
q #" 'x, q[3:$]);
assign z " ,q;
endmodule
Cdigo ;erilog
Departamento de Tecnologa Electrnica Universidad de Sevilla
E)em%lo
E)em%lo