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Un Sistema Electrnico

Sistemas Electrnicos



Digiyal audio broadcasting


chip (4.000.000 transistores)

Integracin de un PCB en un solo die

Incremento de la complejidad: 40 % por ao


Incremento de la productividad en el diseo: 15 % por ao

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Alternativas/Estilos/Etapas A. Diguez

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P Pentium IV 42 millones de transistores

Alternativas/Estilos/Etapas A. Diguez

Diseo de Sistemas VLSI: ASICs

Encapsulado

Ventajas de un ASIC:
 Permiten implementar circuitos de gran complejidad
 Reduccin del nmero de componentes
Fabricante:
 Disminucin del consumo
 Capacidad de produccin
 Mayor velocidad de trabajo
 Tiempo de fabricacin
 Mayor fiabilidad
 Coste de desarrollo
 Menor disipacin trmica
 Caractersticas AC
 Reduccin del tiempo de desarrollo
 Caractersticas DC
 Menor coste
 Encapsulado
 Dificultad para ingeniera inversa
 Soporte tcnico
Especificaciones iniciales:
 Calidad (Yield)
Es un proceso en el que intervienen 3 partes
 El cliente
 El centro de diseo / diseador
 El fabricante (foundry)
 Caractersticas AC (frec. Max.)
 Alimentacin (Vss, Vdd)
 Tipo de encapsulado (DIP, PGA, LCC, QFP)
 Nmero mximo de puertas
 Nmero de pines I/O
 Prestaciones, medidas, tecnologa, estilo de diseo
 Coste

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DIP - Dual-in-line package

Plastic Ball Grid Array

PQFP - Plastic Quad Flat Pack

PLCC - Plastic Leaded Chip Carrier


Plastic Pin Grid Array

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Alternativas/Estilos/Etapas A. Diguez

Diseo de Sistemas VLSI


 Por el mtodo antiguo: manual
 Diseadores de layout expertos
 Diseo completo del CI a mano
 Bueno para CIs pequeospero imposible para millones de
transistores
 El nuevo mtodo: usando herramientas de CAD de alto nivel
 Las herramientas hacen el trabajo sucio
 Altos niveles de abstraccin
 Librerias con cores reusables, mdulos y celdas
Cada vez el diseo de hardware se aproxima ms al diseo de software

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[Adapted from http://infopad.eecs.berkeley.edu/~icdesign/. Copyright 1996 UCB]


Alternativas/Estilos/Etapas A. Diguez

ASICs: Principios


Valor aadido en un ASIC para oportunidades de gran produccin


en masa; componentes standard para aplicaciones con una rpida
salida al mercado
 Economia del Diseo
Prototipado Rpido, Bajo Volumen
Diseo a Medida, Elevado Volumen
 CAD Necesario para Conseguir las Estrategias de Diseo
Diseo a nivel de Sistema: Concepto a VHDL/C
VHDL/C a silicon (Monterey, Magma, Synopsys, Cadence,
Avant!)
 Estrategias de Diseo: Jerarqua, Regularidad, Modularidad,
Localidad

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Alternativas de implementacin: Tecnologas

Estrategias de diseo de ASICs

 Viabilidad econmica afectada fuertemente por el tiempo de diseo


 Tiempo de diseo afectado por la eficiencia
 El diseo es una continua lucha para conseguir las especificaciones
de prestaciones con resultados adecuados en el resto de parmetros.

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Prestaciones funcionalidad, velocidad, consumo


Size of Die coste de fabricacin
Time to Design coste de ingenieros y temporizacin
Facilidad de Generacin del Test & Testabilidad coste de ingenieros,
coste de fabricacin, temporizacin

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