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INTRODUO
Um computador digital uma mquina projetada para armazenar e manipular
informaes representadas por algarismos ou dgitos que podem assumir dois valores distintos 0
ou 1, por isso so chamados de computadores digitais binrios, ou simplesmente, computadores
digitais.
Fisicamente, os valores 0 ou 1 so representados no computador pelas tenses 0,5 V ou
3,0 V, respectivamente. Estes valores so entendidos pelo computador respeitando uma faixa de
tolerncia, uma vez que impossvel construir equipamentos ou chips que mantenham
exatamente aquelas tenses.
O computador fabricado com circuitos eletrnicos que precisam armazenar os sinais
binrios e realizar certos tipos de operaes com eles. Estes circuitos so chamados de circuitos
digitais e so formados por pequenos elementos capazes de manipular as grandezas binrias.
Estes pequenos elementos so conhecidos como portas (gates) por permitirem (ou no) a
passagem destes sinais, e os circuitos que contm portas lgicas so conhecidos como circuitos
lgicos.
Uma porta um elemento do hardware, que recebe um ou mais sinais de entrada e
produz um sinal de sada, cujo valor depende da lgica estabelecida para sua construo.
2.1
A porta AND definida como sendo o elemento que produz um resultado verdade (1)
se e somente se todas as entradas forem verdade. O seu smbolo e a sua Tabela Verdade, ento
so os seguintes:
ENTRADA
A
B
0
0
0
1
1
0
1
1
SADA
X=A.B
0
0
0
1
Uma das mais importantes utilidades desta porta a ativao de uma linha de dados
para controlar o fluxo de bits em um computador (Ver Captulo 3).
2.2
Porta OR (OU):
A porta OR definida para produzir um resultado verdade (1) se pelo menos uma das
entradas for verdade. O seu smbolo e a sua Tabela Verdade, ento so os seguintes:
ENTRADA
A
B
0
0
0
1
1
0
1
1
12/05/06 - Pg. 2
SADA
X=A+B
0
1
1
1
2.3
SADA
A
0
1
X=A
1
0
___
2.4
Importante: A . B
____ ____
A.B
A
0
0
1
1
B
0
1
0
1
__________
X=A.B
1
1
1
0
__________
B
0
1
0
1
X=A.B
1
1
1
0
___
___
X=A.B
1
0
0
0
SADA
DIAGRAMA 1
2.5
SADA
X=A B
0
1
1
0
2.6
Assim como a porta NAND, a porta NOR o complemento ou o inverso da porta OR.
A sada de um circuito lgico NOR obtida ao se efetuar a operao lgica OR sobre as entradas
e inverter o resultado. O seu smbolo e a sua Tabela Verdade, ento so os seguintes:
ENTRADA
A
0
0
1
1
12/05/06 - Pg. 4
B
0
1
0
1
SADA
__________
X=A+B
1
0
0
0
__________
Importante: A+ B
____ ____
A+B
A
0
0
1
1
B
0
1
0
1
__________
X=A+B
1
0
0
0
DIAGRAMA 2
12/05/06 - Pg. 5
___
___
X=A+B
1
1
1
0
B
0
1
0
1
Z
I0
I1
I2
I3
12/05/06 - Pg. 6
4.1
lgebra Boolena:
A lgebra booleana uma rea da matemtica que trata de regras e elementos de lgica.
O nome uma homenagem ao matemtico ingls George Boole (1815-1864), que desenvolveu
uma anlise matemtica sobre a lgica. Suas regras bsicas so:
13
X 1 1
14
15
16
X X 1
X 0 0
17
X 1
18
19
20
2
3
4
(Y
Z)
(X
X (Y Z )
X (Y
Z)
Y) Z
(X Y) Z
X Y
X Z
X X Y X
X (X Y) X
(X
Y) (X
X
X Y
Z)
X Y
Y Z
Y Z Y Z X Y
(X Y ) X Y
21
22
11
X X
X Y Y X
X X 0
23
X Y
X Y
12
X Y
24
X Y
X Y
10
12/05/06 - Pg. 7
(X Y )
As equaes bsicas 1 a 9 podem ser provadas atravs do emprego das Tabelas Verdade
j mostradas anteriormente. As equaes 10 a 20 podem ser demonstradas a partir das Tabelas
Verdade e das equaes bsicas 1 a 9. A equao 19 pode ser resolvida substituindo X por
X+X.Y (equao 16). As equaes 21 e 22 referem-se ao Teorema de Morgan e podem ser
provadas a partir dos Diagramas 1 e 2 vistos anteriormente. As equaes 23 e 24 representam a
Tabela Verdade do circuito XOR e NOT-XOR, mas muitas vezes no lembramos deste fato, por
isso esto acrescentadas na tabela acima.
Todas as equaes podem ser utilizadas para simplificao dos circuitos lgicos
projetados, a fim de diminuir a quantidade de portas necessrias e, consequentemente, diminuir
o custo do mesmo. Analisemos os seguintes casos:
X
4.2
A B C A B C A B C A B C
A B (C C ) A C ( B B ) A B A C
Circuitos Combinatrios:
BCD8421
S0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
S3
S2
S1
S0
AB C D
AB C D
A B CD
AB C D
AB C D
AB C D
AB CD
A BC D
A BC D
ABCD
ABC D
AB C D
AB CD
ABCD
ABC D
ABC D
AB C D
AB C D
A B CD
AB C D
AB C D
AB C D
ABCD
A BC D
ABCD
A BC D
AB C D
AB C D
ABCD
ABCD
AB C D
ABCD
S3 = A
S1 = B
S 2 AB AB A
S0 = C
D
12/05/06 - Pg. 9
12/05/06 - Pg. 10
A sada ter tambm 4 bits para o resultado da operao matemtica (soma). Porm,
existe a possibilidade de que a soma ultrapasse a capacidade do nosso somador (neste caso, 4
bits). Para isso, precisamos incluir um 5 bit, um bit de overflow.
Obs.: Como o somador de entrada no deve receber nenhum bit de carry in, preciso forar que
o Ci desse somador seja zero.
4.3
CIRCUITOS SEQENCIAIS:
FLIP-FLOP RS BSICO
A Tabela Verdade deste circuito a seguinte (Qa = Estado anterior, Qf = Estado final).
0
1
2
3
4
5
6
7
Qa
Qf
Qf
Transio
Concluso
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
0
1
1
1
1
1
0
1
1
0
0
1
1
Estvel
Estvel
Estvel
Instvel
Instvel
Estvel
No Permitido
No Permitido
Qf = Qa
Qf = Qa
Qf 0
Qf 0
Qf 1
Qf 1
Q=Q
Q=Q
12/05/06 - Pg. 11
Qf
0
0
1
1
0
1
0
1
Qa
0
1
No Permitido
Quando CLOCK = 0, as sadas das portas NAND de entrada sero sempre iguais a 1, ou
seja, semelhantes situao Qf = Qa. Quando CLOCK = 1 o circuito ir comportar-se como um
Flip-Flop RS bsico.
Tal circuito ainda tem o defeito de apresentar indefinio quando R e S forem iguais a 1
simultaneamente. Isto pode ser resolvido mantendo uma entrada D ligada ao S, e um D ligado
ao R (atravs de um inversor).
4.4
MEMRIA RAM:
MEMRIA RAM DE 1 BIT
Estando a entrada de endereos em nvel lgico 1, as portas AND (P1 e P2) liberaro a
passagem para os terminais R e S do Flip-Flop, do dado de entrada ligado na entrada D.
12/05/06 - Pg. 12
ESCRITA (WRITE)
END = 1
Informao D
Controle Escrita/Leitura (Write/Read)
LEITURA (READ)
END = 1
Controle Escrita/Leitura (Write/Read)
Bit
SL
A memria RAM de 1 bit descrita anteriormente insuficiente para termos uma noo
completa de acesso (leitura ou gravao) de dados. Para tal devemos ter um conjunto de bits
referenciado por um endereo. O diagrama a seguir mostra quatro memrias de trs bits cada:
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LISTA DE EXERCCIOS
1) Desenvolva a tabela verdade para as seguintes expresses booleanas:
a) A B C
b) A (C
A B C
( A B) ( A C ) ( A
e) A
f)
D)
c) A B C
d)
A B C
B)
A B
A (B
A C)
Respostas:
a) Entradas
A B C
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
Entradas
A B C
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
d)
A B C
D
b)
Sada
1
1
1
1
1
1
1
1
Sada
0
0
1
0
0
0
0
0
A
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
Entradas
B C
0
0
0
0
0
1
0
1
1
0
1
0
1
1
1
1
0
0
0
0
0
1
0
1
1
0
1
0
1
1
1
1
e)
D
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Entradas
A
B
0
0
0
1
1
0
1
1
Sada
0
0
0
0
0
0
0
0
1
1
1
0
1
1
1
1
Sada
0
0
1
1
c) X
A B B A C D E C D E E C D
A B C (A B C
A B C
A B
A C
A B
A C
A B C)
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c)
f)
A
0
0
0
0
0
0
0
0
Entradas
B C
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
D
0
1
0
1
0
1
0
1
A
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
Entradas
B C
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
D
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Sada
1
0
0
0
1
0
0
1
Sada
1
0
1
0
0
1
0
1
0
1
0
1
0
1
0
1
d)
e)
f)
( X Y Z ) (W V ) ( R S T ) (Y Z X )
A C
(A C
A B
B C) A ( A
X Y
h) A
(X
i)
X Z
j)
( A 1) ( B 0) D D 1
Y ) (X
Y)
X Y Z
D
W
f)
A C C C 0 C
d)
i) A
A B
X Y
( A 1) B B
Respostas:
a) X
A
A C
A B) C C
g) A
k) X
A B
(Z
b)
Y)
X
S
g) A
j) X
A B (C D E )
b)
A ( B C D) ( B
c)
( A B) (C
d)
A B (C
e) Y
( A B ) (C
Respostas:
a)
A)
D) E
D) E
D) E
b)
c)
d)
e)
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c)
e)
h)
k)
(B
C)
4) A partir das seguintes tabelas verdade encontre as expresses booleanas, simplifique-as e faa os
diagramas lgicos correspondentes:
a)
0
0
1
1
b)
0
1
0
1
Entradas
A
B
0
0
1
1
c)
Resposta: S1 A B
Entradas Sai.
A
B
S1
0
1
0
1
Entradas
A
B
0
0
1
1
0
1
0
1
1
1
1
0
Resposta:
Sadas
S1 S2
1
0
1
0
0
0
0
1
Sadas
S1 S2 S3
0
1
1
0
1
1
0
0
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
Sadas
S1 S2
1
0
0
0
1
0
1
1
Resposta:
S1 A B
S2 A
S3 B A
Resposta:
S1 B C A B
S2 A B C
1
0
1
1
d)
Entradas
A
B
C
S1
S2 A B
0
1
0
1
1
1
0
1
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