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TECNOLGICO
SUPERIOR DE
MISANTLA
INVESTIGACIN DE LA UNIDAD 3
CARRERA: Ing. Electromecnica
SEMESTRE: 4
GRUPO: 404 A
ELECTRONICA DIGITAL
TITULAR: ING. VICTOR JOEL LOEZA Y
HERNNDEZ
ALUMNOS:
URIEL CRUZ HERNANDEZ
se menciono
una
Biestables
Como se ha indicado, los biestables o flip-flops son elementos capaces
Biestable JK
Sncrono
con
cambio
por
flanco
de
reloj
Contadores
Los contadores son circuitos secuenciales que cambian de estado ante
Registros
En su visin bsica un registro paralelo de n bits realiza la misma funcin
que el biestable D para 1 bit, es decir, ante pulso de reloj cambia el estado
para que refleje el valor de un conjunto de entradas. Dicho estado se
mantiene hasta el siguiente pulso de reloj. En la Figura siguiente se
presenta un registro paralelo de 4 bits, ante flanco descendente de reloj,
las variables de estado (y salida) Q0 a Q3 toman los valores de las
entradas D0 a D3.
Q a 0.
Latch SR sncrono
En la figura 5.2 (a) se muestran los circuitos internos de un Flip flop SR, el
lazo SR lo realiza con dos compuertas NOR por lo tanto este FF tienen
entradas activas altas.
Tabla caracterstica
La tabla caracterstica, puede ser til para el anlisis de la definicin de la
operacin del FF. sta especifica al estado siguiente Q(t+1) cuando las entradas
y el estado presente Q(t) se conocen. El comportamiento completo se puede ver
en tabla 5.1.
Flip-flop JK
El Flip Flop J-K es simplemente una versin modificada del S-R para que ambas
entradas puedan activarse al mismo tiempo. Para el FF S-R est condicin fue
considerada no vlida, en el caso del FF JK est en una condicin de salida
permitida sobre ciclos de reloj sucesivos. ste comportamiento y la representacin
estndar del FF J-K se ilustra en la figura 5.3.
Flip-flop D
El Flip flop D (Data) tiene una entrada de control D y dos salidas Q y Q. Es una
versin modificada del S-R mediante un inversor colocado entre las terminales S y
R. La disposicin del circuito se puede observar en la figura 5.4 (b). Se observa
Flip-flop T
El Flip flop T (Toggle) tiene slo una entrada de control y es una variante del FF JK. Esta se obtiene interconectando las dos entradas J y K para generar una sola
entrada T. Observar figura 5.5.
Observamos que la nica diferencia es que se le aade una salida a cada una de
las salidas Q del biestable: de esta manera se pueden obtener todos los datos a la
vez. Por otro lado, tambin se puede obtener una salida en serie de cualquier
salida Q o Q.
Habitualmente se suele aadir una entrada de puesta a cero asncrona (CLEAR)
cuya funcin es inicializar el registro.
En ltimo lugar destacar que estos registros se suelen utilizar para el cambio de
una palabra de serie a paralelo.
4.5. CONTADORES
En electrnica digital, Un contador (counter en ingls) es un circuito secuencial
construido a partir de biestables y puertas lgicas capaz de realizar el cmputo de
los impulsos que recibe en la entrada destinada a tal efecto, almacenar datos o
actuar como divisor de frecuencia. Habitualmente, el cmputo se realiza en un
cdigo binario, que con frecuencia ser el binario natural o el BCD natural
(contador de dcadas).
Todos los tipos de bsculas que vamos a exponer pueden adoptar ambos tipos de
sincronizacin, y esto lo reflejamos en la simbologa utilizada As:
Sncronas sencillas Sincronizadas sencillas ( Edge-Triggered )
La entrada CP ("Clock Pulse"), es la correspondiente a los pulsos del reloj.
Bascula "RS" (sncrona)
Esta bascula tiene el siguiente diagrama de tiempos (la vamos a realizar con
activacin por nivel "1" de CP).