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Industrielles

LOGIQUE COMBINATORE
Fiche rfrence professeur

Date :

1 Dfinitions.
1.1 Reprsentation dun systme logique combinatoire n entres
et p sorties :
S1

e1
e2

S2
SYSTEME

en

Sp

Le but de la logique combinatoire est donc de dfinir une quation logique des sorties
en fonction des entres.
S1= (e1,e2,,en)
S2= (e1,e2, ,en)
.
Sp= (e1,e2,,en)
1.2 Convention des tats logiques :
1.2.1 Cas dune entre :
a

contact lectrique fermeture NO :

Cest un contact qui est normalement ouvert quand il est au


repos. Le contact se ferme quand il est actionn, on le dsignera
gnralement par une lettre en minuscule.
- contact lectrique ouverture NC :
Cest un contact qui est normalement ferm quand il est au
repos et qui souvre quand on lactionne. On le dsignera
gnralement par une lettre en minuscule avec une barre audessus de celle-ci. On lira donc a barre dans notre exemple.
1.2.2 Cas dune sortie :
Une sortie est ferme quand elle est active (exemple lampe allume) et
ouverte quand elle est inactive (exemple lampe teinte).

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Logique COMBINATOIRE

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a
a

1
1

S
S

2 Les oprateurs logiques de base.


Pour chacune des fonctions dcrites ci-dessous, vous trouverez une fiche dcrivant :
le nom de la fonction
une phrase dcrivant le fonctionnement de loprateur
son symbole normalis
son quation
sa reprsentation lectrique
sa table dite de vrit complter laide de la phrase
un chronogramme complter
2.1 Le OUI :
Cette fonction reproduit lidentique le niveau logique prsent sur son entre.
a
0
1

Sa

S
0
1

a
S

S
t

REMARQUE : Cette fonction logique peut paratre inusite, mais elle peut servir pour de la
mise en forme de signaux ou plus couramment pour intgrer des retards..
2.2 Le NON :
Cette fonction complmente le niveau logique prsent sur son entre.

Sa

a
0
1

a
a

S
1
0
S

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a
a
b
b

&
1

S
S

2.3 Le ET :
Cette fonction positionne sa sortie au niveau logique haut si ses entres sont au
niveau haut.
a
0
0
1
1

S ab

b
0
1
0
1

S
0
0
0
1

a
t
b

S
a

S
t

2.4 Le OU (INCLUSIF) :
Cette fonction prsente un niveau logique haut sur sa sortie ds quau moins
lune de ses entres est au niveau logique haut.
a
0
0
1
1

S a +b
a
t
b

b
0
1
0
1

S
0
1
1
1

S
a

t
b

Fiche N2 Fiche rfrence professeur t

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& =1 S

2.5 Le OU EXCLUSIF :
Cette fonction prsente sur sa sortie un niveau logique haut si ses entres sont
un niveau logique diffrent.
a
0
0
1
1

S ab
ou
S=ab ab

b
0
1
0
1

S
0
1
1
0

S
b

t
b
t
S

2.6 Le ET NON (NAND) :


t

Cette fonction prsente un niveau logique haut en sortie lorsquau moins lune
de ses entres est au niveau logique bas.

S ab

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a
0
0
1
1

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b
0
1
0
1

S
1
1
1
0

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t
a

b
t

S
K

2.7 Le OU NON (NOR) :


Cette fonction prsente un niveau logique haut en sortie si ses entres sont au
niveau logique bas.

a
b

a
0
0
1
1

Sab

b
0
1
0
1

S
1
0
0
0

a
t
S

t
S
t

2.8 Symboles normaliss en Europe et aux USA :

EURO (ANSI/IEEE)
NON (Inverseur)

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USA
NOT

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AND
&

ET

OU

OR

OU Exclusif

= 1

Exclusive OR

NON-ET

&

NAND

NON-OU

NOR

3 Association doprateurs logiques.


Il est possible dassocier des oprateurs en les connectant en cascade .
Un oprateur, dont lune des entres est relie la sortie dun autre oprateur, se verra
applique sur son entre le rsultat obtenu sur la sortie de loprateur prcdent. On
combinera chaque nouvelle valeur des entres dans lquation de celui-ci pour obtenir
lquation de sortie.
Appliquez cet nonc dans les schmas suivants :

a
a
b

&

S= (a.b)/

&
S=

&
c
d

1
(a.b.(c+d))/

a
b

&

a
b

S=

=1

((a.b)+b)/

=1
((a b) a)/

4 Proprits et quations (Algbre de BOOLE).


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S=

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4.1 La commutativit :
abba
ab ba

4.2 Lassociativit :

4.3 La distributivit :

(a b) c a (b c)
(a b) c a (b c)

a (b c) (a b) (a c)
a (b c) (a b) (a c)

4.4 Les lments neutres :

a0a
a 1 a

4.5 La complmentation :
aa1
aa 0

4.6 Lidempotence :

aaa
aaa

4.7 Les lments absorbants :

a0 0
a 1 1

4.8 Linvolution :
(a) a
(a) a

4.9 Linclusion :
abab a

4.10 Thorme de De Morgan :


a b ab
ab a b

5 Recherche dquations partir dune table de vrit.


En supposant que, suite une tude dun cahier des charges, nous obtenons la table de
vrit suivante :
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Sciences
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0
0
1
1

b
0
1
0
1

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S
0
1
0
0

Nous nous apercevons que S =1 quand a = 0 et b=1.


Si nous codons S=1 par S, a=0 par a et b=1 par b, nous pouvons crire :
S ab

Selon la mme mthode, crivez lquation pour les tables de vrit suivantes :
a
0
0
1
1

b
0
1
0
1

S
0
0
1
0

a
0
0
1
1

b
0
1
0
1

S
1
0
1
1

Nous nous apercevons que les lignes o S=0 sont minoritaires (une seule ici). Il
est, dans ce cas, nettement plus intressant dcrire que S=0 quand a=0 et b=1, ce qui
se traduit par le codage S a b
Pour dcrire S, il suffit de savoir que S S , ce qui donne :
S S ab

7 Simplification dquations avec les tableaux de Karnaugh.


Pour un cahier des charges dun systme donn on peut reprsenter les sorties
en fonctions des entres dans un tableau de Karnaugh (autre reprsentation de la table
de vrit).
Ce tableau permet de simplifier les expressions logiques du systme.
7.1 Rgles de construction :
Il y a autant de cases que de lignes du tableau de vrit.
Une case correspond une combinaison des variables dentres.
Quand on passe dune case sa voisine horizontale ou verticale, une seule variable
doit changer dtat.
On recopie dans chaque case la valeur correspondante de la sortie.
7.2 Rgles de simplification :
Principe : chaque case ayant ltat logique 1 correspond un terme de
lquation non simplifie. Le regroupement des cases avec 1 simplifie
lexpression du groupement.
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LOGIQUE COMBINATORE
Industrielles *rgle 1 : on ne peut regrouper
Fichequun
rfrence
professeur
nombre
de cases correspondant une puissance

de 2. (2=1 ; 21=2 ; 22=4 ;)


*rgle 2 : un groupement doit tre en ligne, colonne, carr, rectangle.
*rgle 3 : faire les plus grands groupements possibles.
*rgle 4: on fait des groupes jusqu' ce que tous les 1 fassent partie dun
groupement.
*rgle 5: Rechercher les groupements en commenant par les plus grands et aprs les
cases nayant quune seule faon de se grouper.
*rgle 6 : lquation dun groupement est donn par le ET logique des variables qui
ont le mme tat pour toutes les cases du groupement.
*rgle 7 : lquation recherche est obtenue par le OU logique des quations des
groupements.

7.3 Reprsentation des groupements :


Groupements de 2 :
b\a
0
1

c\ab 00
0
1

01

11

1
b\a
0
1

10
c\ab 00
0
1
c\ab 00
0
1

01

11

01

11

10

10

Groupements de 4 :
c\ab 00
0
1

01

11

10

c\ab 00
0
1

01

11

10

c\ab 00
0

01

11

10

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a
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1

b
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1

c
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1

cd\ab
d 00S
0 011
1 111
0 101

1 0
0 1
1 0
0 1
1 0
0 1
1 0
0 1
cd\ab
1 1
000 0
101 1
011 0
1 0

Date :

LOGIQUE COMBINATORE
1Fiche rfrence professeur
00

00

01

01

11

11

10

cd\ab
00
01
11
10

00

01

11

10

cd\ab
00
01
11
10

00

01

11

10

10

10

Exemple : Commencer par donner lquation de S sans simplification :


S = a/.b/.c/.d/ + a/.b/.c/.d + a/.b/.c.d/ + a/.b.c/.d/ + a/.b.c.d/ + a.b/.c/.d/ +
a.b/.c.d/ + a.b/.c.d + a.b.c/.d
Complter le tableau de Karnaugh et donner lquation de S simplifie :
cd\ab
00
01
11
10

00
1
1
0
1

01
1
0
0
1

11
0
1
0
0

10
1
0
1
1

S = b/.d/ + a/.d/ + a/.b/.c/.d + a.b/.c + a.b.c/.d

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Fiche rfrence
Tracer le logigramme avec les symboles
normalissprofesseur
des fonctions ET, OU et NON.

Date :

REMARQUE : Il est aussi possible de simplifier une quation partir de lalgbre de


BOOLE et du thorme de DE MORGAN. Cependant, pour un nombre de variables
importantes, cela peut vite devenir prilleux et inadapt.

8 Ralisations pratique des systmes combinatoires.


8.1 Par des composants discrets :
Il est en effet possible dutiliser des composants discrets ralisant les
diffrentes fonctions logiques de base. Ces composants discrets se prsentent sous la
forme dun Circuit Intgr (CI) composs de plusieurs portes logiques (de mme
nature)(1, 2, 4, ou 8 portes).

DM74 LS 10
DM 74 LS 08
de chez FAIRCHILD SEMICONDUCTOR
8.2 Par des circuits logiques programmables :
Les circuits logiques programmables (galement appels PLD) sont utiliss
pour remplacer lassociation de plusieurs botiers logiques. Le cblage est simplifi,
lencombrement et le risque de pannes est rduit.
Ces circuits disposent dun certain nombre de broches dentres et de sorties.
Lutilisateur associe ces broches aux quations logiques (plus ou moins complexes)
quil programme dans le circuit.
Le terme PLD regroupe 4 familles de composants :

PLD
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PAL

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GAL

CPLD

FPGA

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9 Les circuits logiques programmables (PLD).


9.1 Introduction :
Il y a quelques annes la ralisation dun montage en lectronique numrique
impliquait lutilisation dun nombre important de circuits intgrs logiques. Ceci avait
pour consquences un prix de revient lev, une mise en oeuvre complexe et un circuit
imprim de taille importante.
Le dveloppement des mmoires utilises en informatique fut lorigine des
premiers circuits logiques programmables (PLD : programmable logic device). Ce
type de produit peut intgrer dans un seul circuit plusieurs fonctions logiques
programmables par lutilisateur. Sa mise en oeuvre se fait facilement laide dun
programmateur, dun micro-ordinateur et dun logiciel adapt.
9.2 Structure de base dun PLD :
La plupart des PLDs suivent la structure suivante :
Un ensemble doprateurs ET sur lesquels viennent se connecter
les variables dentre et leurs complments.
Un ensemble doprateurs OU sur lesquels les sorties des
oprateurs ET sont connectes.
Une ventuelle structure de sortie (Portes inverseuses, logique 3 tats,
registres...).
E n tr e s

E n tr e s
F u s ib le

P o r te "ET "

P o rte "O U "

Les deux premiers ensembles forment chacun ce quon appelle une matrice.
Les interconnexions de ces matrices doivent tre programmables. Cest la raison pour
laquelle elles sont assures par des fusibles qui sont grills lors de la
programmation. Lorsquun PLD est vierge toutes les connexions sont assures.
Un exemple de ce type de structure est prsent ci dessous. On peut remarquer
que la reprsentation dune telle structure est complexe alors que le nombre de portes
intgres est peu important. Les constructeurs ont donc trs rapidement adopts un
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Logique COMBINATOIRE

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LOGIQUE COMBINATORE
Industrielles autre type de reprsentation
Fiche rendant
rfrenceles
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schmas beaucoup plus lisibles. On

remarquera que la norme adopte est amricaine (normal, la plupart des constructeurs
sont amricains). Un exemple de cette reprsentation est donn ci dessous.
b
b
1

a
1

&

&

&

&

: Fusible intact
>1

>1

Q0

Q0

Q1

Si on veut obtenir les fonctions Q0 a. b a.b et


fusibles de faon obtenir le schma suivant :
b

Q1 a. b a. b ,

Q1

on grillera des

: Fusible intact
Q0

Q1

9.3 Les diffrentes familles de PLDs :


Il existe plusieurs familles de PLD qui sont diffrencies par leur structure interne. Le
tableau suivant prsente certaines de ces familles.
TYPE
PROM

Nombre de portes intgres


2 000 500 000

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Matrice ET
Fixe

Matrice OU
Programmable

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Effaable
Non

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PAL

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professeur
10 100
Programmable

GAL
CPLD
FPLA

10 100
100 3000
2000 3000

Programmable
Programmable
Programmable

Fixe
Fixe
Fixe
Programmable

Date :
Non
Electriquement
Aux U-V
Electriquement

REMARQUES :

Certaines de ces familles possdent en plus des matrices ET et OU , de la logique


squentielle (Bascules D , JK ...) place aprs les entres ou avant les sorties du
PLD.
Les PROMs sont des circuits utiliss en informatique pour mmoriser de faon
dfinitive des donnes : ce sont des Mmoires mortes . Il existe des versions effaables
comme les UVPROM (aux U-V) et les EEPROM (lectriquement).

10 Les PALs (Programmable Array Logic).


10.1 Prsentation :
Ce sont les premiers circuits programmables tre utiliss pour raliser des
fonctions logiques. Le constructeur AMD a dvelopp ce type de circuit il y a prs de
20 ans. Ils possdent des matrices ET programmables et des matrices OU fixes.
La fusion des fusibles est obtenue en appliquant leurs bornes une tension de 11,5 V
pendant 10 50 S (leur tension de fonctionnement est environ de 5V). Cette
opration est bien sr effectue en utilisant un programmateur adapt. Ils ne sont donc
programmables quune fois, ce qui peut tre gnant en phase de dveloppement. La
structure de base de ce PLD est prsente par le schma suivant.

Convention de reprsentation :
La reprsentation simplifie ne
montre pas tous les fusibles, les

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Fusible intactPage 14 sur 20

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Fiche sur
rfrence
professeur
entres de la porte ET sont regroupes
une seule
ligne. Une croix reprsente un fusible

intact.
Certaines broches de ces circuits peuvent tre utilises aussi bien en entre quen sortie grce
un systme de logique 3 tats. La commande de cette dernire est configure au moment de
la programmation. La structure de sortie permet aussi de rinjecter les sorties en entre (Feedback).
P o r t e t r o is t a t s p e r m e t t a n t
d e d c o n n e c t e la b r o c h e
d e la m a t r ic e " E T "

I/O

Selon le type de PAL la structure de sortie peut tre constitue dune porte NON, dune
porte OU Exclusive , dune bascule D ou dune combinaison des trois. Le nombre
dentres et de sorties est lui aussi li la rfrence du PAL.
10.2 Rfrence des PALs (selon AMD) :
Les diverses possibilits de ces circuits et leur standardisation ont conduit les
constructeurs dfinir une nomenclature permettant de dcoder assez facilement la rfrence
des PALs.
PAL (CE) XX AB YY C ZZ DEF
Type de botier
Vitesse
Consommation
Nombre de sorties
Structure de sortie
Nombre dentres
CE pour version CMOS
PAL
Lettre(s) Code(s)
L
H
C
R
RA
X
V

Structure de sortie
Combinatoire active bas
Combinatoire active haut
Combinatoire complmentaire
Registre synchrone (D)
Registre asynchrone
Registre et OU exclusif
Versatile

Remarques :

Le nombre dentres varie entre 10 et 22.


Le nombre de sorties varie entre 1 et 10.
La puissance est indique par une lettre code.
La vitesse indique le temps de propagation en nS.

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Les versions versatiles ont une Fiche
cellulerfrence
de sortie programmable
permettant dobtenir

nimporte quel autre type de structure de sortie (L, H, R ...).

Exemple :

PAL 16 L 8 H 15 PC
Type de botier : DIL
plastique civile
Vitesse : 15 ns
Consommation : puissance
Nombre de sorties : 8
Structure de sortie : Combinatoire active Bas
Nombre dentres : 16

10.3 Exemple de PAL : Le PAL 16L8 :


Ce type de circuit est uniquement constitu de logique combinatoire. Il possde
20 broches agences de la faon suivante :
- 10 broches configurables uniquement en entre
- 2 broches configurables uniquement en sortie
- 6 broches configurables en entre et en sortie
- 2 broches dalimentation.
Lensemble des sorties provient de portes 3 tats inverseuses. Ltat haute
impdance peut tre commande par lensemble des entres.
Chaque porte de la matrice OU possde 7 entres. Ceci signifie que chaque sortie
peut rsulter, au maximum, dune fonction OU entre 7 termes produits. Chaque
porte de la matrice ET possde 32 entres . Ceci signifie que chaque terme
produit peut rsulter, au maximum, dune fonction ET entre 16 variables et leurs
complments.

- Figure 9 : Brochage du PAL 16L8 -

10.4 Exemple de PAL : Le PAL 16R6 :


Ce type de circuit est constitu de logique combinatoire et squentielle. Il
possde 20 broches agences de la faon suivante :
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8 broches (n 2 Fiche
9) configurables
uniquement en entre
1 broche (n 1) dentre dhorloge de lensemble des 6 bascules D
1 broche (n 11) de validation des 8 sorties (0utput Enable)
6 broches (n13 18) de sorties des bascules D et pouvant tre rinjecter en
entre
2 broches (n 12 et 19) configurables en sortie et pouvant tre rinjecter en
entre
2 broches dalimentation (n 10 et 20).

Lensemble des sorties provient de portes 3 tats inverseuses provenant elles-mmes de


bascules D. Ltat haute impdance est commande par lentre OE (broche n11).
Chaque porte de la matrice OU possde 7 entres. Ceci signifie que chaque sortie peut
rsulter, au maximum, dune fonction OU entre 7 termes produits.
Chaque porte de la matrice ET possde 32 entres . Ceci signifie que chaque terme
produit peut rsulter, au maximum, dune fonction ET entre 16 variables et leurs
complments.

11 Les GALs (Generic Array Logic).


11.1 Prsentation :
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Fiche
Linconvnient majeur
desrfrence
PALs est professeur
quils ne sont programmables quune seule
fois. Ceci impose un gaspillage important de ces circuits lorsquon veut dvelopper un
nouveau produit. Ceci a donc donn naissance aux GALs que lon pourrait traduire par
Rseau logique Gnrique . Ces circuits peuvent donc tre reprogramms volont
sans pour autant avoir une dure de vie restreinte.
Par soucis de remplacer les PALs, la plupart des GALs sont quip de macro
cellules programmables permettant dmuler nimporte quel PAL. Ces structures de
sortie sont donc du type Versatile (V).

11.2 Macro cellule de sortie (OLMC) :


Comme cela a t spcifi auparavant, ces structures de sortie sont
programmables et permettent dmuler nimporte quelle autre structure de sortie. Elles
possdent en tout 2 bits de programmation communs toutes les cellules (CG1 et
CG0) et 2 bits spcifiques chaque cellule (CL0x et CL1x).

11.2.1 Registre synchrone / sortie 3 tats :

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Date :

11.2.2 E/S combinatoire / sortie 3 tats :

11.2.3 E/S combinatoire :

Remarques : La programmation des cellules de sortie est transparente pour loprateur. Cest le logiciel de
dveloppement qui, en fonction de certaines indications (sortie / entre registre ou combinatoire), effectue la
configuration des structures de sortie.

11.3 Exemple de GAL : Le GAL 16V8 :

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12 Les CPLD et les FPGA.


12.1 Les CPLDs :
Ces circuits ont une capacit en nombre de portes et en possibilits de
configuration suprieures celle des GALs. Ils sont composs dau moins 2 GALs,
avec des macro cellules supplmentaires permettant des liaisons supplmentaires
(rebouclages) entre chaque GALs (combinatoires et/ou squentielles)
12.2 Les FPGAs :
Apparus il y a seulement quelques annes, les FPGA sont assimilables des
ASIC programmables par lutilisateur.

Ce sont de gros ensembles de blocs logiques


lmentaires (plusieurs milliers de portes)
que lutilisateur peut interconnecter loisir.

13 Programmation des PLDs.


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LOGIQUE COMBINATORE
Industrielles La programmation des PLDs
Fiche
rfrence
professeur
ncessite
un logiciel
adapt pour le dveloppement du

programme et un programmateur permettant de griller le circuit. En outre il est conseill


de suivre la dmarche dcrite par lorganigramme suivant :
Cahier des charges

Mise en quation du problme

Rsolution du problme sous forme dquation logique, de


logigramme ou dalgorithme

Choix du PLD en fonction du nombre dentres et de


sorties

Saisie des quations logiques, de la table de vrit, du


logigramme ou de lalgorithme avec le logiciel

Simplification logique

Gnration dun fichier au format JEDEC

Ces
Cestapes
tapessont
sont
effectues
effectuespar
parlele
logiciel
logiciel

Simulation

Programmation du PLD laide du fichier JEDEC et du


programmateur

PLD programm

* Le logiciel de dveloppement permet de simplifier les quations et de gnrer un fichier JEDEC partir des
donnes rentres par loprateur. Il simule aussi le fonctionnement du PLD avec le programme obtenu.
* Le fichier JEDEC est un ensemble de donnes binaires indiquant au programmateur les fusibles griller .

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