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Laboratoire gnie lectrique 3Sctech

Srie dexercices N3

Oprations arithmtiques

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Exercice 1 :
Effectuer en binaire les oprations suivantes :
1

+
1

1
+

Exercice 2 :
En utilisant la reprsentation en complment 2, reprsenter sur un format de 8 bits les nombres dcimaux
suivants :
a) 48(10)

b) 23(10)

c) -25(10)

d) -92 (10)

Exercice 3 :
Voici la reprsentation en complment 2 des nombres dcimaux suivant, trouver la valeur dcimale
correspondante.
a) 00101011(2)

b) 10011110(2)

c) 10011000(2)

d) 10000000(2)

Exercice 4 :
Quel est lintervalle de valeurs dcimales signes quon peut reprsenter sur un format de 6 bits puis sur un
format 8 bits y compris le bit de signe ?

Exercice 5 :
Raliser les oprations suivantes avec la notation en complment 2.Utiliser le format dun octet pour
reprsenter chaque nombre (y compris le bit de signe). Vrifier les rsultats par conversion de la rponse en
dcimal :
a) 45 - 17

b) -15 - 28

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c) 12 - 42

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a a

Exercice 6 :

+ b1 b0
1 0

On dsire raliser un additionneur binaire de deux nombres deux bits (A : a1 a0), (B : b1 b0) .

S2 S1 S0

1) Complter la table de vrit suivante :


b1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1

b1b0

b0
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1

a1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1

a0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1

a1a0

S2

S1

S0
2) Etablir les quations simplifies des sorties
S2 S1 S0 en utilisant les tableaux de Karnaugh
b1b0

a1a0

S0

S0 =

b1b0

a1a0

S1

S2

3) Tracer le logigramme de ladditionneur en utilisant les oprateurs : XOR, OR et AND


b1 b0 a1 a0

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4) Complter les circuits suivants pour raliser le mme additionneur avec un demi additionneur et un
additionneur complet.
a a

+ b1 b0
1 0
. .
Add

. .

S2 S1 S0

. .
R0

1/2 Add

Add

Add

Add

Add

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Exercice 7 :
1) Complter le schma du circuit qui permet laddition de deux mots binaires de deux bits :
A(2) = a1a0 ; B(2) = b1b0 en utilisant deux additionneurs complets
b1

a1

b0

0V Vcc

a0

Opration A+B
R1in

Add
R1out
S2

R0in

Add
R0out

S1

S0

2) On veut maintenant raliser lopration A-B (rsultat sur 2 bits) en utilisant 2 additionneurs complets et
deux inverseurs.
2-1) Rappeler lopration de soustraction avec la reprsentation en complment 2
A B = A + .+ ..
2-2) Quel est lintervalle des valeurs dcimales que lon peut crire avec 2 bits en tenant compte du bit de
signe.

2-3) Complter le schma

b1

a1

b0

a0
0V Vcc

Opration A - B
R1in

Add
R1out

R0in

Add
R0out

S1

S0

3) On veut maintenant exploiter les deux additionneurs complets et deux portes OU exclusif pour raliser soit
une addition soit une soustraction (rsultat sur 2 bits) selon ltat logique dune entre note K comme suit :
K=0

on ralise A + B

K=1

on ralise A - B
b 0 = ; b 1 =

3-1) Donner les rsultats des oprations suivantes :


3-2) Complter alors le schma

b1

a1

b0

a0
0V Vcc

R1in

Add

R0in

Add

K
R1out

R0out
S1

S0

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