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Prctica No. 4
Circuito Combinacional con Compuertas
Docente
Ing. Rosanna Jaimes
Alumno:
Seccin: 501-G5
Rodrguez, Ricardo C.I. 21426812
Pre-Laboratorio
Mapas de Karnaugh
Es un mtodo grfico utilizado para la simplificacin de funciones algebraicas
booleanas para convertir su tabla de la verdad a su circuito lgico correspondiente,
generando expresiones de Sumas de Productos o Producto de Sumas simplificadas.
Externamente, un mapa de Karnaugh muestra todos los valores posibles de las variables de
entrada y salida en una matriz de celdas, en la que cada celda representa un valor binario de
las variables de entrada. El nmero de celdas de un mapa de Karnaugh es igual al nmero
de combinaciones de las variables de entrada, al igual al nmero de filas de una tabla de la
verdad.
Adyacencia de celdas: La adyacencia en los mapas de Karnaugh se define como el cambio
de una nica variable. Las celdas que difieren en una nica variable son adyacentes, es
decir, fsicamente, cada celda es adyacente a otra igual por cualquiera de sus 4 lados. Las
celdas con valores que difieren en ms de una variable no son adyacentes, o dicho de otra
forma, una celda no es adyacente a aquellas que tocan diagonalmente alguna de sus
esquinas.
Adyacencia Cclica: Consiste en la idea de que el mapa de Karnaugh se puede doblar de tal
forma que se toquen en los extremos superior e inferior, y derecho e izquierdo, haciendo
que el mapa adopte la forma particular de una Dona. Dicho en otras palabras, las celdas
de la fila superior son adyacentes a las de la fila inferior y las celdas de la columna
izquierda son adyacentes a las situadas en la columna derecha.
Mapas de Karnaugh de 4 variables de entrada
La simplificacin de expresiones lgicas mediante el mapa de Karnaugh se logra
por medio de un mtodo grfico basado en la Suma de Productos (S.D.P.) o Producto de
Sumas (P.D.S.). La construccin del mapa se realiza por medio de una matriz de
2n
El mapa se
la tabla de la verdad
que se expresa de
como sigue:
Lne
a
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
m0
m1
m3
m2
construye a partir de
de la funcin lgica
forma genrica tal y
m4
m5
m7
m6
01
A B C D Mintrmino/Maxtrmin
Mintrmino mx/
A
B
m
m
m
m14 Mx
12
13
15
o
Maxtrmino
0 0 0 0 A.BCD/ ABCD
m0/M0
11
0 0 0 1 ABCD/
ABCD
1/M1
m8
m9
mm
m10
A B
11
0 0 1 0 ABCD/ ABCD
m2/M2
0 0 1 1 ABCD/ ABCD
m3/M3
10
0 1 0 0 ABCD/ ABCD
m4/M4
0 1 0 1 ABCD/ ABCD
m5/M5
0 1 1 0 ABCD/ ABCD
m6/M6
0 1 1 1 ABCD/ ABCD
m7/M7
1 0 0 0 ABCD/ ABCD
m8/M8
1 0 0 1 ABCD/ ABCD
m9/M9
1 0 1 0 ABCD/ ABCD
m10/M10
1 0 1 1 ABCD/ ABCD
m11/M11
1 1 0 0 ABCD/ ABCD
m12/M12
1 1 0 1 ABCD/ ABCD
m13/M13
1 1 1 0 ABCD/ ABCD
m14/M14
1 1 1 1 ABCD/ ABCD
m15/M15
Funcin de Salida
F(0,0,0,0)
F(0,0,0,1)
F(0,0,1,0)
F(0,0,1,1)
F(0,1,0,0)
F(0,1,0,1)
F(0,1,1,0)
F(0,1,1,1)
F(1,0,0,0)
F(1,0,0,1)
F(1,0,1,0)
F(1,0,1,1)
F(1,1,0,0)
F(1,1,0,1)
F(1,1,1,0)
F(1,1,1,1)
Suma de Productos (S.D.P.) o Mintrminos: En este caso, las celdas se disponen tal y como
sigue:
Las celdas estn dispuestas de tal forma que se cumpla con el principio de la
adyacencia, es decir, que entre celdas inmediatas, se presenta un nico cambio en una sola
variable.
El mapa es utilizado de la siguiente manera: Por ejemplo, la celda m 12, corresponde
al mintrmino 12, ubicado en la interseccin entre la fila donde se ubica el nmero en
sistema binario 11 y la columna donde se ubica el numero en sistema binario 00. La
reduccin por medio de un mapa de 4 variables se realiza agrupando aquellas celdas
adyacentes entre s o aquellas que se encuentren en los bordes superior e inferior del mapa,
estas deben contener un 1 o un 0 correspondiente a los mintrminos o maxtrminos de la
funcin de salida, por ejemplo: El termino F(1,1,1,1)=A.B.C.D=1 y se ubica en la celda m 15
conformada por la interseccin entre 11 y 11. Luego de haber hecho la agrupacin de 1s o,
se procede con la determinacin del trmino que puede ser escrito por mintrminos. Para
los mintrminos no presentes se coloca un 0 en la celda correspondiente y son descartados.
Por ejemplo:
m1
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
y en las filas B,
A . B .
.- El segundo grupo
lo conforman los
10
.- El tercer grupo lo conforman los mintrminos m8, m10, m12, m14 en las filas slo vara
B
A . B+ B+ B . A
La
siguiente
salida
viene
M 3 , M 5 , M 7 , M 8 , M 9 , M 10, M 11 , M 12 , M 13
dada
por:
M1
F1=
.- El primer grupo lo conforman los maxtrminos M1, M3, M5 y M7, en las columnas solo
vara
CD
A B
A B
AB
A B
AB
00
01
11
10
A B
.- El segundo grupo
lo conforman los
01
AB
CD
x
AB
1
A B
0
A B
0
A B
11
AB
AB
00
x
01
0
11
0
10
0
AB
10
00
A B
B=
B
.
B+
.-
El
tercer
grupo lo
conforman
los
A + B
01
A B
F1 es ( A+ B
) . ).( A + B
11
A B
Condiciones
Irrelevantes:
Son
aquellas
F1= A . A+B . A =
A + B . A
m1 , m4 , m5
X(
m8 ,m12
X(
m8 ,m12 :
Post-Laboratorio
Se dise, simul e implement un circuito combinacional de compuertas que
produjera el encendido de varios diodos led de forma simultnea mostrando en la salida,
una serie de 11 caracteres utilizando un display de 7 segmentos.
Un display o visualizador de 7 segmentos, es un dispositivo electrnico que
contiene dentro unos leds conectados y con forma de pequeas lneas que se encuentran
posicionadas adecuadamente. Cada segmento o lnea se enciende individualmente, lo cual
permite que se puedan visualizar una cantidad de caracteres. A cada segmento se le asigna
una letra para denotarlos individualmente, tal como lo muestra la Figura 1. El punto
decimal se denomina como P, este ltimo es otro led, lo cual totaliza 8 leds en el display.
Figura 1.
Se observa que para obtener el circuito lgico que produzca las salidas, es necesario
realizar 11 combinaciones, dado que se desean mostrar 11 caracteres en el encendido. Para
lograr dichas combinaciones se utiliz el sistema de numeracin binario, el cual es idneo
para lograr establecer los estados lgicos de encendido y apagado. Se determin que son
necesarias 4 (n=4) variables de entrada, estas proporcionan 16 combinaciones
2n=216=16
combinaciones.
A
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
Entradas
B C D
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
Sa
0
1
0
1
1
0
0
1
0
1
0
x
x
x
x
x
Sa
1
1
0
0
1
0
1
1
0
0
0
x
x
x
x
x
Sc
0
0
0
0
1
0
1
1
0
0
1
x
x
x
x
x
Salidas
Sd
0
0
0
1
0
0
1
1
1
1
0
x
x
x
x
x
Caracter
Se
1
1
1
1
1
1
1
1
0
1
0
x
x
x
x
x
Sf
0
1
1
1
1
0
0
1
0
1
1
x
x
x
x
x
Sg
1
0
0
0
1
1
1
0
0
0
1
x
x
x
x
x
Sa= (C.D.B)+(D.B)+(C.D)=C.D.B.+D.(B+C)
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
.- Salida a (Sb).
Forma Cannica (Mintrminos):
10
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+
A.B.C.D
Forma Cannica (Maxtrminos):
(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+
C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)
0
(, 1, 4, 6,7)
Simplificacin (Mintrminos): Sb=
X(11 , 12,13, 14,15
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
CD
01
AB
AB
D
C
CD
CD
x
00
x
01
x
11
x
10
A11B
A B
00
A10B
1
0
1
0
0
x
0
1
01
AB
11
A B
.- Salida a (Sc)
Forma Cannica (Mintrminos):
10
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D
Forma Cannica (Maxtrminos):
(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+
C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)
4
(, 6, 7,10)
Simplificacin (Mintrminos): SC =
X(11 , 12,13, 14,15
.- Salida a (Sd)
Forma Cannica (Mintrminos):
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+
A.B.C.D
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
10
(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+
C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)
3
(, 6, 7,8, 9)
Simplificacin: Sd=
X(11 , 12,13, 14,15
CD
D
C
CD
CD
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
.- Salida e (Se)
Forma Cannica (Mintrminos):
10
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D
Forma Cannica (Maxtrminos):
(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+
C+D)
0
(, 1,2, 3, 4, 5,6,7,9)
Simplificacin (Mintrminos): Se=
X(11 , 12,13, 14,15
Sd= A +D
Entradas
B C D
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
Salidas
Se
1
1
1
1
1
1
1
1
0
1
0
x
x
x
x
x
CD
CD
CD
C
C
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
10
.- Salida f (Sf)
CD
A B
A B
AB
A B
AB
00
01
11
10
A B
00
A B
01
AB
11
A B
.- Salida a (Sg)
Forma Cannica (Mintrminos):
10
A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+A.B.C.D+
A.B.C.D+A.B.C.D
Forma Cannica (Maxtrminos):
(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+
C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)x(A+B+C+D)
0
(, 4, 5, 6,7, 9, 10)
Simplificacin (Mintrminos): Sg=
X(11 , 12,13, 14,15
Luego de haber obtenido las expresiones de las siete salidas correspondientes a los
segmentos del Display y de haber simulado con simulador Logisim, se procedi a
Simulacin las expresiones obtenidas con los Mapas de Karnaugh: Combinacin 0101