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SOMADORES

E
SUBTRATORES
Em sistemas digitais, muitas vezes necessitamos de circuitos que realizem
operaes de soma e subtrao. Em computao, esses circuitos ocupam uma posio
de extrema importncia, uma vez que so responsveis por todas as operaes
aritmticas.
SOMADORES E SUBTRATORES BINRIOS
I - SOMADORES:
Existem basicamente dois tipos de somadores:
1- srie
2- paralelo
O somador srie caracteriza-se pelo fato de efetuar a soma bit a bit e o
somador paralelo caracteriza-se quando a soma dos diversos bits feita
simultaneamente.
Em ambos os tipos, o circuito que desempenha efetivamente a operao de
soma nico.
Vamos supor que desejamos implementar um circuito que efetue a seguinte
operao:

111 + 101
Teremos ento:
1

1
1
1
1

1
1
0
0

1
1
0

<=== transporte (carry)


+
<=== sada

Podemos ento visualizar essa operao com mais detalhes, separando-a em


partes, as quais denominaremos colunas:
1

1 1
1 1 1
1 0 1
1 1 0 0
4 3 2 1

<=== transporte (carry)


+
<=== sada
<=== colunas

Na 1 coluna: 1 + 1 = 0 e vai um (carry)


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Prof. Edgar Zuim

Necessitamos ento de um circuito que some apenas 2 bits, neste caso, um OU


EXCLUSIVO.
A sada de uma porta OU EXCLUSIVO ser igual a 1 se, e apenas se, existir
um nmero mpar de entradas igual a 1.
Para uma porta OU EXCLUSIVO de 2 entradas, podemos ento dizer que a
sada ter nvel lgico 1 se e somente se os nveis lgicos da entrada forem
diferentes. Veja a tabela abaixo:

Se observarmos os valores de X, podemos verificar que eles correspondem


exatamente soma das variveis A e B, conforme mostra a tabela abaixo:

A tabela da verdade de S = A + B, nos fornece as funes de S e C:

Neste caso, o transporte (carry) estar presente na sada C, conforme mostra o


circuito abaixo:

Esse circuito, suficiente para realizar a operao da 1 coluna designado


circuito meio somador , pelo fato de somar apenas 2 bits e no levar em conta o
transporte durante a operao. O meio somador (HA, do ingls Half-Adder) tem uma
simbologia prpria, mostrada abaixo, onde: S = sada e Co = carry (transporte).

A diferena bsica de operao da 1 coluna para as demais, que na 1 coluna


soma-se apenas 2 bits no considerando o transporte. As 2, 3 e 4 colunas, por
considerarem o transporte somam 3 bits. Assim sendo, o meio somador no pode ser
utilizado, uma vez que no dispe de 3 entradas.
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Vejamos ento como fica as situaes possveis para uma soma de 3 bits:

O circuito lgico correspondente mostrado abaixo:

Verifica-se ento que esse circuito resulta na combinao de dois meio


somadores, conforme representado a seguir:

Pelo fato de considerar o transporte durante o processo de soma, o circuito


para tal finalidade deve ser o somador completo (FA, do ingls Full-Adder).

Ci (carry in), significa transporte anterior


Co (carry out), significa sada de transporte
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O circuito abaixo mostra um somador completo a partir da 2 coluna. Esse


somador denominado somador paralelo, pelo fato de que o transporte obtido a cada
soma conectado entrada do prximo mdulo somador.

Utilizando apenas um mdulo somador, podemos construir um somador


completo, conforme mostra a figura abaixo:

ANLISE:
1. As entradas A e B do somador so provenientes de registradores de deslocamento,
no caso, registradores A e B, cujo resultado armazenado no registrador S, que
tambm um registrador de deslocamento;
2. Supondo que a primeira soma gere um transporte, este ser armazenado no FF tipo
D. O prximo comando ser liberar o FF e o transporte ser considerado na soma,
atravs da entrada Ci ;
3. O comando tanto para o FF como para os registradores deve ser proveniente de um
nico gerador de clock;
4. Essa configurao recebe o nome de somador srie pelo fato da operao ser
executada serialmente (seqencialmente).
Para uma melhor compreenso do que foi exposto acima, passaremos a
analisar um somador srie, conforme mostra a figura a seguir, para a operao: 111 +
101.
Alguns fatores devem ser considerados para a anlise desse somador:

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1. Os registradores A, B e S so constitudos de FFs tipo D, com deslocamento de


dados na transio L-H do pulso de clock;
2. O FF acoplado a sada do mdulo somador (FFC) ou seja, FF de transporte,
provido de uma entrada reset, que encontra-se inicialmente resetado (Q = 0).
3. LSB designado como o bit da extrema direita para os registradores e os dados so
deslocados da esquerda para a direita.

A tabela da verdade correspondente mostrada a seguir:

CONSIDERAES GERAIS:
1. O somador completo, que pode ser utilizado em qualquer das colunas da soma,
prev uma entrada para o transporte Ci (do ingls, carry in).
2. Tanto o meio somador como o somador completo efetuam a soma de dois bits
correspondentes primeira e demais colunas. Um nmero porm, compe-se de
diversos bits ou colunas e para se efetuar a soma sero necessrios diversos
somadores.
3. Para se efetuar a soma de diversos bits ou colunas que compe um nmero, os
somadores podem estar dispostos em paralelo, efetuando simultaneamente a soma
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desses diversos bits. A quantidade de somadores portanto, funo do nmero ou da


quantidade de bits que compe esse nmero.
4. A soma dos diversos bits que constituem um nmero, pode tambm ser feita bit a
bit no tempo ou seqencialmente, ou ainda um seguido ao outro, dito em srie. Para
isso, basta um nico somador FA que vai efetuando a soma e, fornecendo o resultado
bit a bit. Para isso so necessrios alguns registradores de deslocamento e uma
memria. Esse tipo somador conhecido como srie ou serial. O somador paralelo
tem a vantagem de ser mais rpido do que o somador serial, porm mais complexo.
A figura a seguir mostra um somador paralelo de 3 bits, onde o resultado da
soma aparece na sada S, com exceo do bit mais significativo que a prpria sada
Co.

Na soma de cada par de bit, gera-se a sada da soma em S e o bit de transporte


Co (carry out), que tambm o bit de transporte do somador seguinte, que ser
somado com o par de bit desse somador e assim por diante.
II - SUBTRATORES:
Os subtratores so obtidos de forma anloga aos somadores, ou seja, a partir de
mdulos meio subtratores e subtratores completos.
A exemplo dos somadores os subtratores classificam-se em: srie e paralelo.
A tabela abaixo nos mostra as regras gerais de subtrao. Trata-se de um
circuito meio subtrator, HS (do ingls, Half-Subtractor).

Logo, o circuito lgico correspondente :

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O circuito meio subtrator recebe esse nome por no considerar o emprstimo


anterior, subtraindo apenas 2 bits.
Sua simbologia mostrada na figura a seguir, onde Bo o emprstimo.

A tabela abaixo representa os casos possveis de subtrao, com 3 bits:

O circuito lgico mostrado a seguir:

Observa-se ento que o circuito lgico acima exatamente a conexo de dois


meio subtratores, conforme ilustrado abaixo:

O smbolo para o subtrator completo FS (do ingls Full-Subtractor)


mostrado a seguir.
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Observa-se que no subtrator completo leva-se em considerao o emprstimo


anterior Bi .

Similarmente ao somador paralelo, o subtrator paralelo obtido pela conexo


de blocos meio subtratores completos. Por exemplo:
A4
B4
S4
4

A3
B3
S3
3

A2
B2
S2
2

A1
B1
S1
1

<=== sadas
<=== colunas

Na 1 coluna A1 - B1 = S1 no precisamos considerar o emprstimo, pois tratase da 1 operao.


Nas demais colunas:
A2 - B2 = S2
A3 - B3 = S3
A4 - B4 = S4
Como no sabemos os valores das variveis e considerando que possamos
necessitar de emprstimos, devemos utilizar o subtrator completo:

Um subtrator paralelo caracteriza-se por efetuar a subtrao simultnea de


diversos bits, composto de subtratores completos FS cujo nmero depende de
quantos bits possua o maior dos nmeros que se deseja efetuar a subtrao.
Veja a seguir um subtrator paralelo completo de 3 bits:

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Um subtrator serial pode ser construdo de forma idntica a um somador serial,


onde so utilizados registradores de deslocamento e um subtrator completo.
O circuito abaixo ilustra um subtrator completo do tipo serial:

SOMADORES BCD
O somador BCD efetua somas de dgitos binrios codificados em binrio, ou
mais propriamente, em BCD. No somador binrio, o processo diferente pois
efetuada a soma dos dgitos binrios e o resultado binrio.
Um somador BCD efetua a soma de 4 bits simultaneamente, fornecendo dessa
forma alm do resultado, o transporte correspondente (Co).
A tabela abaixo mostra os dez dgitos codificados em binrio (BCD) e das
dezesseis combinaes, seis no pertencem ao cdigo BCD.

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Podemos mostrar atravs de um exemplo, onde sero somados os nmeros


decimais 29 e 12 em binrio, traduzidos pelos bits 11101 e 1100. No somador BCD
entretanto, cada dgito decimal traduzido por 4 bits binrios:

A soma feita dgito a dgito j convertidos em BCD. No exemplo acima foi


necessria a correo no resultado de 1011 para 0001, uma vez que 1011 no pertence
ao cdigo BCD.
Conforme pode-se observar no exemplo, nessa correo tambm gerado um
dgito de transporte que coincidentemente tambm 0001. Em funo disso o
resultado da soma do segundo dgito tambm se altera.
Para corrigir o resultado da adio, no caso, dos dgitos D1 e D2, adiciona-se 6
(decimal) ou 0110 (binrio) ao resultado a ser corrigido sempre que o valor for
superior ou igual a 10, por no pertencer ao cdigo BCD.
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Como na adio pode ocorrer o transporte para o algarismo mais significativo,


embora esse resultado seja menor do que 1010 ou 10102, tambm necessita de
correo, pois se houve o transporte, significa que o resultado ultrapassou a 16
combinao ou 11112 e portanto, preciso efetuar uma correo desse resultado.
Vejamos outro exemplo, onde efetua-se a soma dos nmeros 18 e 19:

Verifica-se que o procedimento idntico. O transporte (carry) proveniente do


dgito menos significativo (LSB), somado posteriormente ao bit mais significativo
(MSB).
O exemplo a seguir mostra a soma de 9810 + 7810 , que corresponde a 17610,
onde o procedimento adotado idntico aos anteriores. Observe que o transporte
correspondente ao LSB somado automaticamente ao MSB.

SOMADOR PARALELO BCD


Pelo que foi visto, o somador BCD efetua a soma simultnea de 4 bits
binrios, correspondente a um dgito decimal. Assim, o somador paralelo BCD
composto de 4 somadores binrios FA, dispostos em paralelo, conforme ilustra a
figura a seguir:

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O somador paralelo pode ainda ser representado por um nico bloco, conforme
ilustra a figura:

DETECO DE ERRO DE SOMA


Para a construo desse detetor, deve-se elaborar uma tabela da verdade com
as dezesseis possibilidades, conforme figura a seguir:

importante observar que o somador, na forma apresentada no efetua a


correo do resultado, conforme j exposto anteriormente.
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Para que isso acontea torna-se necessrio a construo de um circuito lgico


que determine a necessidade ou no da correo e que, em caso positivo, adicione o
algarismo 610 ou 01102 ao resultado, efetuando assim a segunda soma.
O detetor deve atuar sempre que o resultado da soma, ou os 4 bits da soma
apresentar um um resultado ilegal no cdigo BCD, ou sempre que ocorrer um
transporte natural Co.
Observa-se que na rea sombreada a sada D igual a 1, e neste caso o detetor
deve atuar, segundo a expresso: D = S4S3 + S4S2 , obtida atravs do M.K. Como o
detetor deve atuar tambm quando houver um transporte natural a expresso fica
ento:

D = S4S3 + S4S2 + Co
Como o transporte de sada Co de um dgito o transporte de entrada Ci do
dgito subseqente, conclui-se que sempre que houver uma deteco D, ocorre um
transporte de entrada Ci , ou seja:

Ci = D = S4S3 + S4S2 + Co
A figura a seguir ilustra um circuito detetor:

Para a correo do resultado da soma em BCD, necessrio que o detetor


indique nvel lgico 1 e que adicione 01102 ao resultado. Podemos utilizar para isso
um outro somador paralelo para fazer essa operao quando for necessrio. Veja a
figura abaixo:

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Neste caso, o prprio nvel 1 do detetor pode ser utilizado para compor o
nmero. Observe nas entradas do segundo somador paralelo (inferior), que temos a
seguinte condio: A1 = A4 = 0 e A2 = A3 = 1. Portanto, o primeiro somador efetua a
soma e o segundo junta esse resultado a correo.
A sada do somador de correo (segundo somador) no precisa ser conectada,
pois ser utilizada a prpria sada do detetor como entrada de transporte do somador
seguinte, que no caso a mesma sada utilizada para compor o nmero 01102 de
correo.
importante notar que quando no houver correo a ser efetuada, a sada do
segundo somador ser igual a do primeiro, pois o detetor no atua e sada do
primeiro somador ser adicionado o dgito 0.
SUBTRATORES BCD
A subtrao BCD transforma-se em uma soma BCD pura.
Existem vrios mtodos para se obter a subtrao. Estudaremos o
complemento de 9 do subtraendo decimal.
Veremos a seguir que o complemento de 9 corresponde ao complemento de 1
em binrio. Faamos ento uma breve recordao dos complementos de 1 e de 2, com
o intuito de melhor elucidar futuras operaes.
Complemento de 1 e de 2:
Tomemos como exemplo a subtrao: 8 - 5

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O complemento de 2 do subtraendo encontrado aps o complemento de 1.

Da:

O bit desprezado no exemplo acima muitas vezes chamado de transbordo;


quando for 1 o resultado da subtrao positivo; quando for 0 o resultado negativo.
Vejamos um outro processo de subtrao, por exemplo:

1000 - 0101
1 passo: achar o complemento de 1 do subtraendo:

2 passo: somar o complemento de 1 do subtraendo ao minuendo:

3 passo: somar 1 ao resultado (que corresponde determinar o complemento


de 2):

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O transbordo obtido no segundo passo denominado EAC (End Around


Carry), que traduzindo significa: transporte final ao redor.
O bit EAC alm de indicar se o resultado positivo ou negativo, somado ao
resultado da operao: minuendo + complemento de 1 do subtraendo:

Complemento de 9 e complemento de 10:


Analogamente aos complementos de 1 e de 2 no sistema binrio, os
complementos de 9 e de 10 so aplicveis no processo de subtrao no sistema
decimal.
Exemplo: 835 - 676
Processo 1:
1 passo:
Achar o complemento de 10 do subtraendo:

O complemento de 10 de um nmero decimal a diferena entre esse nmero


e uma potncia de 10 imediatamente superior sua mais alta potncia. No exemplo a
mais alta potncia de 10 de 676 2:

Logo, sua potncia de 10 imediatamente superior ser:

2+1=3
Ento o complemento de 10 do nmero 676 ser:
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2 passo:
Somar o complemento de 10 de subtraendo ao minuendo:

3 passo:
Subtrair 1000 (valor considerado no primeiro passo, quando da obteno do
complemento de 10) do resultado encontrado:

Processo 2:
1 passo:
Achar o complemento de 9 do subtraendo decimal e som-lo ao minuendo:

O complemento de 9 de um nmero decimal sua diferena para 9 dgito a


dgito.
Da:

2 passo:
Somar o EAC ao resultado obtido:

importante acrescentar que casos em que o nmero de dgitos do subtraendo


menor do que o do minuendo, exigiro acrscimos de zeros ao subtraendo para a
obteno de seu complemento de 9.
Subtrao BCD pelo complemento de 9:
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Este mtodo baseia-se na subtrao decimal pelo complemento de 9.


Exemplo: 821 - 312

Teremos:

Em BCD, os passos so anlogos.


1) Somar o minuendo com o complemento de 9 do subtraendo:

2) Corrigir os valores no vlidos em BCD antes de somar o EAC:

3) Somar o EAC ao resultado corrigido:

Subtrao BCD com resultados negativos:


Casos em que o subtraendo maior que o minuendo, exigiro nova
complementao do resultado final.
Exemplo: 329 - 411
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1 passo:
Efetuar a subtrao normalmente:

Como no houve transbordo, isto significa que EAC = 0, e por isso no haver
necessidade de som-lo ao resultado obtido. Com EAC = 0, significa tambm que o
resultado negativo.
2 passo:
Complementar novamente o resultado final obtido:

Em BCD:

Ou seja:

Gerador de complemento de 9:
Um gerador de complemento de 9 poder ser implementado a partir de portas
lgicas. Para isso, constroi-se a tabela da verdade, conforme mostra a figura a seguir:

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Observa-se que na referida tabela no foram includas as linhas que


correspondem s condies ilegais no BCD, mas que devero ser consideradas na
simplificao atravs dos M.K.

Dada a expresso obtida atravs da simplificao, obtm-se o circuito abaixo:

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Portanto, esse circuito recebe o nome de circuito gerador de complemento de


9.
Uma outra maneira de se obter o complemento de 9 atravs do somador
paralelo de 4 bits. Neste caso, usa-se o seguinte algoritmo:
1) Obter o complemento de 1;
2) Somar o complemento de 1 com uma constante igual 10102.
Exemplo: achar o complemento de 9 de 0011

Soma-se ento 1100 a uma constante 1010:

Da:

Termos ento a seguinte configurao para o somador paralelo:

Que corresponde a tabela abaixo:


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Dec
0
1
2
3
4
5
6
7
8
9

Ci
0
0
0
0
0
0
0
0
0
0

A4
0
0
0
0
0
0
0
0
1
1

A3
0
0
0
0
1
1
1
1
0
0

A2
0
0
1
1
0
0
1
1
0
0

A1
0
1
0
1
0
1
0
1
0
1

B4
1
1
1
1
1
1
1
1
1
1

B3
0
0
0
0
0
0
0
0
0
0

B2
1
1
1
1
1
1
1
1
1
1

B1
0
0
0
0
0
0
0
0
0
0

S4
1
1
0
0
0
0
0
0
0
0

S3
0
0
1
1
1
1
0
0
0
0

S2
0
0
1
1
0
0
1
1
0
0

S1
0
1
0
1
0
1
0
1
0
1

Co
1
1
1
1
1
1
1
1
1
1

O bit EAC obtido pela realimentao da sada Co para a entrada Ci.

PARTE PRTICA
MATERIAIS NECESSRIOS:
1 - CI 7404
1 - CI 7408
1 - CI 7432
1 - CI 7483
1 - CI 7486
1 - Multmetro analgico ou digital
1 - Display 7 segmentos, com decodificador
1 - Treinador lgico
1- Monte o circuito da figura abaixo:
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2 - Complete a tabela 1. Monitore as sadas C e S atravs de leds (use os indicadores


de nveis lgicos do treinador lgico).

A
0
0
0
0
1
1
1
1

B
0
0
1
1
0
0
1
1

TABELA 1
C
S
0
1
0
1
0
1
0
1

3 - Qual a denominao desse circuito?


_____________________________________________________________________
4 - Monte o circuito abaixo:

5 - Complete a tabela 2, monitorando as sadas S e Bo com leds.


TABELA 2
A
B
C
S
B0
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0
0
0
0
1
1
1
1

0
0
1
1
0
0
1
1

0
1
0
1
0
1
0
1

6 - Qual a denominao desse circuito?


_____________________________________________________________________
7 - Cite algumas caractersticas importantes, que diferenciam um meio somador (HA)
de um somador completo (FA).
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
8 - O que um somador binrio? Qual sua principal utilizao?
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
9 - Alimente corretamente o CI 7483 (somador completo), conforme pinagem
mostrada abaixo:

10 - Some os nmeros 1010 e 1001, colocando-os na entrada do somador, conforme


ilustra a figura a seguir (o resultado esperado mostrado nas sadas S4 a S1 e Co).

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11 - Monitore as sadas do somador (1 a 4, que correspondem a S1 a S4) com um


display de 7 segmentos e respectivo decodificador. Monitore tambm as sadas Co de
cada somador (use os leds indicadores de nveis lgicos do treinador lgico), nas
seguintes condies: Ci = 0 e Ci = 1 (primeiro somador). Complete a tabela abaixo:

A1

A2

A3

A4

B1

B2

TABELA 3
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

12 - Seguindo os mesmos procedimentos anteriores, efetue agora a soma de:


a) 0110 + 0010
b) 0100 + 0011
c) 1111 + 1110
d) 0111 + 0010
e) 0001 + 0001
Complete ento as tabelas 4, 5 ,6 , 7 e 8.

A1

A1

A1

A1

A2

A2

A2

A2

A3

A3

A3

A3

A4

A4

A4

A4

B1

B1

B1

B1

B2

TABELA 4
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

B2

TABELA 5
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

B2

TABELA 6
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

B2

TABELA 7
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

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A1

A2

A3

A4

B1

B2

TABELA 8
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

13 - Se a soma exceder 9, verifique os erros no resultado. Apresente concluses.


_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
14 - Caracterize ento, segundo exposto no item acima, a diferena entre uma soma
em binrio e uma soma em BCD.
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
_____________________________________________________________________
15- Faa as modificaes necessrias
(Subtrator Binrio Paralelo).

no CI 7483 e monte o circuito a seguir

O subtrator paralelo, soma um nmero N1 em binrio com at 4 bits, com o


complemento de 2 do outro N2. O complemento de 2 conforme visto anteriormente,
o complemento de 1 do nmero mais 1.
O mais 1 efetuado colocando-se nvel lgico 1 na entrada do primeiro
somador FA.
Monitore as sadas S4 a S1 com display de 7 segmentos e respectivo
decodificador.
Monitore as sadas Co e a entrada Ci do primeiro somador, usando os
indicadores de nveis lgicos do treinador lgico.
Proceda ento as seguintes subtraes:
a) 1001 - 0110
b) 1000 - 0101
c) 0101 - 0011
d) 0011 - 0001
Complete ento as tabelas 9, 10, 11 e 12.
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A1

A1

A2

A2

A3

A3

A4

A4

B1

B1

B2

TABELA 9
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

B2

TABELA 10
B3 B4 Co4

Co3

Co2

Co1

Ci
0
1

Dec

Bin

Co3

Co2

Co1

Ci
0
1

Dec

Bin

Co3

Co2

Co1

Ci
0
1

Dec

Bin

A1

A2

A3

A4

B1

B2

TABELA 11
B3 B4 Co4

A1

A2

A3

A4

B1

B2

TABELA 12
B3 B4 Co4

16 - Projete um circuito somador BCD, utilizando o CI 7483, com correo de soma,


todas as vezes que o resultado apresentar condio ilegal no BCD. Utilize para isso 2
CIs 7483 e circuito detetor com portas lgicas.

LABORATRIO DE ELETRNICA DIGITAL SOMADORES E SUBTRATORES


Prof. Edgar Zuim

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