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SOLA ETAPA
I. OBJETIVOS:
III. PROCEDIMIENTO:
1. Implemente el circuito de la figura 4
VCE = 7.77 V
ICQ = 1.92 mA
VBE=0.645V
Fo
(Hz)
100
200
300
500
700
900
1,5k
3k
4k
5k
6k
7k
8k
Ce=4,7
Vo
40mv 104mv 160mv 280mv 380mv 500mv 720mv 880mv 940mv 960mv 970mv 972mv 976mv
Ci=0,01 (Vpp)
Fo(Hz
)
Ce=0.47
Ci=0,1
Vo
100
500
700
1k
1,5k
3k
4k
6k
7k
87k
9k
Av =- 5.55
11k
195mv 380mv 440mv 520mv 640mv 820mv 840mv 926mv 960mv 965mv 980mv 984mv 995mv
10k
Fo (Hz)
100
200
300
500
700
1.5k
Ce=47uF Vo
136mv 270mv 380mv 640mv 800mv 1.28v
Ci=0,01 (Vpp)
3k
4k
5k
6k
7k
8k
3v
4v
2.6v
2.7v
2.7v
2.7v
Estos son los factores por el cual los clculos tericos con los experimentales a
veces no son cercanos, para poder evitar estas diferencias se recomienda
trabajar con capacitares que estn operando bien y tener cuidado con las
capacidades parsitas de las lneas de conexin
CONCLUSIONES
CORTE
Y este valor de