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SOROCABA
ENGENHARIA ELTRICA
SISTEMAS DE COMPUTAO
MDULO 01-01
HARDWARE
PROF FERREIRA
email: ferreira@facens.br
2012
NDICE
1 EVOLUO DO COMPUTADOR.................................................................................4
1.1 INTRODUO.................................................................................................................. 4
1.2 BACO (APROX. 3500 A.C.)............................................................................................4
1.3 GERAO ZERO (SCULO XVII).....................................................................................4
1.3.1- CALCULADORA DE PASCAL (1642).............................................................................. 4
1.3.2- MQUINA DIFERENCIAL DE BABBAGE (1823)..............................................................5
1.3.3- MQUINA ANALTICA DE BABBAGE (1823)..................................................................6
1.3.4- MQUINA DE HOLLERITH (1886)..................................................................................6
1.4 1 GERAO - VLVULA (1.945 1.955).......................................................................8
1.4.1 ENIAC.........................................................................................................................8
1.4.2 MQUINA DE VON NEUMANN............................................................................9
1.4.3 2 GERAO TRANSISTOR E MEMRIA MAGNTICA (1.956 1.965)....10
1.4.4 3 GERAO CIRCUITO INTEGRADO E MICROPROCESSADOR (1.966
1.980).................................................................................................................................... 11
1.4.5 4 GERAO VLSI E COMPUTADOR PESSOAL (1.981 1.990)...........................12
1.4.6 5 GERAO ULSI (ULTRA LARGE SCALE OF INTEGRATION) CIRCUITO
INTEGRADO 3-D.....................................................................................................................13
2 ORGANIZAO DE UM COMPUTADOR.................................................................15
2.1 A UNIDADE CENTRAL DE PROCESSAMENTO ................................................. 15
2.1.1 INTRODUO E UNIDADES............................................................................... 16
2.2 OS REGISTRADORES DA CPU .............................................................................. 18
2.3 FUNES DO MICROPROCESSADOR .................................................................19
3 HARDWARE DE UM SISTEMA DE COMPUTAO ............................................. 20
3.1 - PLACA ME - MOTHERBOARD.......................................................................... 20
3.2 INTERFACES PARA CONTROLAR PERIFRICOS.........................................21
3.2.1 IDE (INTEGRATED DRIVER ELECTRONICS).............................................. 21
3.2.2 SCSI (SMALL COMPUTER SYSTEMS INTERFACE)................................... 22
3.2.3 ADB (APPLE DESKTOP BUS) ............................................................................23
3.2.4 USB ( UNIVERSAL SERIAL BUS ) ( BARRAMENTO SERIAL UNIVERSAL
) ............................................................................................................................................ 23
3.2.5 FIREWIRE ............................................................................................................. 24
3.2.6 ATAPI (ATA PACKET INTERFACE) ...............................................................25
1 EVOLUO DO COMPUTADOR
1.1 Introduo
O primeiro elemento com que o homem contou para fazer seus clculos foi o conjunto de
dedos de suas mos, da veio a palavra digital, vindo de dgito, que significa dedo. Com a evoluo
da humanidade fez-se necessrias novas invenes para auxiliar os clculos:
1.2 baco (aprox. 3500 a.C.).
A palavra CLCULO tem sua origem no termo latino CALCULUS. Que a milhares de anos
servia para denominar pequenas pedras que eram usadas para contar deslizando-se por sulcos
cavados no cho. Essa espcie de baco foi descoberta em recentes escavaes arqueolgicas.
A partir desse elemento de clculo,
outros similares apareceram em diversos
forma
final
de
Suan-Pan,
de
modo
mais
antigo
data
de
baco
Dos trabalhos conhecidos deste perodo, destaca-se o trabalho de Blaise Pascal, que em 1642
desenvolveu uma mquina de calcular totalmente mecnica. A mquina, tambm chamada de
Pascaline, era baseada na existncia de um disco para cada potncia de 10, cada disco sendo
dotado de 10 dgitos (de 0 a 9).
Embora fosse capaz de realizar
apenas
adies
subtraes,
outras
podiam
ser
realizadas
atravs
da
1.3.2
Aps 10 anos de trabalho, tudo que Babbage havia conseguido era uma pequena mquina
de 3 registros e 6 caracteres, sendo que deveria ser, de acordo com o projeto, uma mquina de 7
registros e 20 caracteres cada, alm de apresentar seus resultados impressos!
1.3.3
Em 1833, Babbage projetou uma mquina bastante aperfeioada (com o auxlio de Ada
Lovelace), que chamou de Mquina Analtica. Ada uma das poucas mulheres a figurar na histria
do computador. Matemtica talentosa compreendeu o funcionamento da Mquina Analtica e
escreveu os melhores relatos sobre o processo. Ela criou programas para a mquina, tornando-se
a primeira programadora de computador do mundo.A Mquina Analtica poderia ser programada
para calcular vrias funes diferentes, era constituda de unidade de controle de memria
aritmtica e de entrada e sada. Sua operao era governada por conjunto de cartes perfurados,
de modo que, de acordo com os resultados dos clculos intermedirios, a mquina poderia saltar
os cartes, modificando dessa forma o curso dos clculos.
Mquina Tabuladora
Em 1924, esta firma mudou de nome, tornando-se a International Business Machines
Corporation, hoje mais conhecida como IBM. No incio, as vendas da IBM eram baseadas na linha
de equipamentos de escritrio e, em particular, mquinas tabulares.Com isso a empresa orientou
suas atividades para o mercado externo, abrindo sua
0 equipamento recebeu o nome de ENIAC (Electrical Numerical Integrator and Calculator) a foi
o primeiro computador a vlvulas. Possua 18.000 vlvulas, 1.500 rels a emitiam o equivalente a
200 quilowatts de calor e executava cerca de 5000 adies por minuto. Essa enorme mquina foi
alojada
em
uma
sala
de
por
30m.
comeavam
queimar
dois
minutos
depois
de
ligar-se
equipamento.
Foto do ENIAC
1.4.2 MQUINA DE VON NEUMANN
MEMRIA
ENTRADA
UNIDADE DE
CONTROLE
ULA
SADA
armazenado,
introduzida por John Von Neuman. Von Neuman tinha sido consultor no projeto ENIAC e conhecia
os problemas da programao destas mquinas.
Os programas para os computadores da poca eram feitos atravs de modificaes nos
circuitos, o que correspondia a um trabalho de dias para um programa relativamente simples.
A proposta de Von Neuman foi inspirada na tecnologia de entrada de dados utilizada na
poca, fazendo com que os programas fossem introduzidos atravs de cartes perfurados como se
fazia com os dados. John Von Neuman assim desenvolveu a lgica dos circuitos, os conceitos de
programa e operaes com nmeros binrios. Este conceito, adotado nos computadores atual,
revolucionou o conceito de programao de computadores da poca, tornando muito mais flexveis
e versteis.
O novo conceito de programao introduzido por Von Neuman deu origem a muitos outros
projetos nos quais ele prprio esteve envolvido, como por exemplo, o EDVAC (Electronic Discret
Variable Automatic Computer), o IBM 650 (o primeiro computador da IBM), e o UNIVAC (Universal
Automatic Computer), que foi o primeiro computador a ser fabricado em linha. Juntamente com o
ENIAC, ocorreu tambm o desenvolvimento na rea de perifricos de computador com o
aparecimento de equipamentos tais como as unidades de fita magntica, impressoras, etc...
Em 1961 chegou o primeiro computador no Brasil: um UNIVAC 1105, ainda com vlvulas,
para o IBGE.
Transistor
Com a segunda gerao apareceram as memrias com anis ferromagnticos. As fitas
magnticas foram forma dominante de armazenamento secundrio: permitiam capacidade muito
maior de armazenamento e o ingresso mais rpido de dados que as fitas perfuradas.
Tambm nesse perodo houve avanos no que se refere s unidades de memria principal,
como por exemplo, a substituio do sistema de tubos de raios catdicos pelo de ncleos
magnticos, utilizado at hoje nos chips de memria RAM. Os dispositivos de memria auxiliar
introduzidos na primeira gerao continuam a ser utilizados.
Esses computadores, alm de menores, eram mais rpidos e eliminavam quase que por
completo o problema do desprendimento de calor, caracterstico da gerao anterior.
Exemplos de computadores dessa gerao . O IBM 1401 apareceu na dcada de 60 e
com ele a IBM assumiu uma posio dominante na indstria de computadores.
Surgiram tambm nessa poca as primeiras linguagens de programao (Assembly e
Fortran). Vemos tambm nessa poca o surgimento dos primeiros sistemas operacionais.
Um dos computadores mais comercializados nesta poca foi o IBM 7090, que eram
comercializados a um custo de trs milhes de dlares. J no incio dos anos 60, a IBM passou a
produzir os computadores da linha IBM 7040, que eram menos poderosos que seus
predecessores, mas de custo bastante inferior.
10
A tecnologia utilizada na poca era a de pequena escala de integrao (SSI Small Scale
of Integration) com a qual ao redor de mil transistores pode-se integrar no circuito de uma pastilha.
O exemplo tpico dessa gerao foi o IBM 360, srie que introduziu o conceito de famlia
de computadores compatveis, facilitando a migrao dos sistemas quando necessrio mudar
para um computador mais potente. Esta estratgia permitiu que a IBM se posicionasse, j neste
perodo, como lder do mercado de computadores.
11
As redes distribudas (WANs Wide rea Network) se difudiram por todo o mundo
As primeiras redes locais (LANs Local Area Network)
12
1.4.6 5 GERAO ULSI (Ultra large scale of Integration) Circuito Integrado 3-D
Podemos destacar a evoluo desta gerao como sendo:
Aumento da capacidade de processamento e armazenamento de dados
Evoluo das aplicaes
Sistemas especialistas
Sistemas multimdia
Banco de dados distribudos
Inteligncia artificial
Redes neurais
Componentes:
Os principais componentes dos neurnios so:
Os dentritos, que tem por funo, receber os estmulos transmitidos pelos outros
neurnios;
O corpo de neurnio, tambm chamado de somma, que responsvel por coletar e
combinar informaes vindas de outros neurnios;
E finalmente o axnio, que constitudo de uma fibra tubular que pode alcanar at alguns
metros, e responsvel por transmitir os estmulos para outras clulas.
13
Clula Neura
Esquema de um Neurnio Artificial
neurofisiologista McCulloch e matemtico Walter Pitts (1943), cujo trabalho fazia uma
analogia entre clulas vivas e o processo eletrnico, simulando o comportamento do
neurnio natural, onde o neurnio possuia apenas uma sada, que era uma funo de
entrada (threshold) da soma do valor de suas diversas entradas.
14
2 ORGANIZAO DE UM COMPUTADOR
Um microprocessador usado, junto a outros componentes SVLSI(Very-Large Scale Integration =
Integrao em Altssima Escala), para implementar um computador. O microprocessador
implementa as funes da unidade de processamento, enquanto os outros componentes fornecem
a memria, entrada/sada e outras funes necessrias. A organizao lgica de um sistema
"computador" descrita nesta seo e cada uma das funes explicada.
15
FECHADO
LIGADO
16
SEM
COM TENSO
TENSO
Se 0 representa uma determinada situao, ento 1 representa a situao complementar,
porm estamos mais acostumados a trabalhar com lgica positiva,como por exemplo:
Nvel lgico 0
Nvel lgico 1
aberto
fechado
sem tenso
com tenso
desligado
ligado
apagado
aceso
Decimal
000
001
010
011
100
101
110
111
17
23
22
21
20
2-1
2-2
2-3
2-4
2-5
A menor unidade lgica em um sistema digital o bit, dizemos ainda que oito bits forma um
18
da CPU analisa os dados. Operaes lgicas (como "and" ou "or") e operaes aritmticas (como
multiplicao ou diviso) podem ser efetuadas sobre informaes contidas nos registradores. O
valor de um nico dgito, um bit (binary digit), ou a combinao de bits pode ser lida ou gravada
(escrita) nos registradores.
2.3 FUNES DO MICROPROCESSADOR
O microprocessador o circuito mais importante existente em um microcomputador. Tratase de um chip que realiza todo o controle do computador. Comanda a leitura e gravao de dados
nos discos, l e grava dados na memria, executa os programas, recebe dados de dispositivos
como o vdeo e a impressora. Para realizar este trabalho, o microprocessador conta com a ajuda
de diversos circuitos chamados de INTERFACES (controladoras de perifricos).
Todo microprocessador capaz de realizar operaes bsicas como:
Operaes matemticas
Operaes lgicas
A memria vista como um grande armazm de dados que pode ser acessado pelo
microprocessador em altssima velocidade. J a E/S (Entrada e Sada) representa todos os
dispositivos pelos quais o microprocessador pode receber e/ou transmitir dados: teclado, vdeo,
discos, mouse, impressora, etc.
Entre as operaes matemticas executadas pelo microprocessador podemos citar adies,
subtraes, multiplicaes, divises, e diversas outras menos usadas na vida cotidiana, mas muito
comuns entre as instrues que formam os programas. As principais operaes lgicas so: OR,
AND e NOT. Com base nesses trs operadores possvel formar sentenas lgicas mais
complexas.
O microprocessador tambm realiza comparaes entre nmeros, descobrindo qual dos
dois o maior, o menor, ou se so iguais. Pode tambm executar decises em funo dessas
comparaes: Se A for maior que B, executa um comando; caso contrrio executar um comando
diferente. Esse tipo de construo muito freqente entre as instrues que formam os programas.
19
Tambm podem ser realizadas operaes com caracteres. Por exemplo, procurar uma
palavra em um texto, trocar todas as ocorrncias de um caracter por outro, e diversas operaes
muito comuns nos programas que realizam processamento de texto.
Os desvios tambm so muito teis e comuns nos programas. Os programas so
seqncias de instrues, mas dependendo dos resultados das operaes, o programa pode
efetuar uma quebra nesta seqncia, passando a executar uma seqncia diferente.
Do ponto de vista microscpico, essas so as principais operaes executadas pelos
microprocessadores. Deve ficar claro que o usurio no comanda diretamente o microprocessador,
e sim os programas. Os programas, por sua vez, que contm as instrues para o
microprocessador. Portanto, podemos dizer que o usurio comanda o microprocessador apenas de
forma indireta.
20
IDE (Integrated Drive Electronics) uma interface que foi criada para conectar dispositivos
ao computador. Foi desenvolvida pela Western Digital e pela Compaq em 1986, inicialmente foi
muito usada em discos rgidos, a ponto de hoje em dia a pessoa acharem que IDE uma
caracterstica do disco rgido.
Dentre outras caractersticas, uma bastante interessante que seu padro no exige
que um controlador externo esteja atuando, por exemplo, o disco rgido. Uma parte do prprio
disco rgido usado no seu controle e dessa forma poupado desenvolvimento eletrnico.
21
slave)
pode
ser
conectada
um
mesmo
controlador.
2.1 MByte/s
PIO mode 0
3.3 Mbyte/s
PIO mode 1
5.2 MByte/s
8.3 MByte/s
controla at 16 perifricos (disco rgido, fita DAT, CD-ROM, scanner, impressora) os quais
podem ser interligados ao microcomputador atravs de uma nica controladora.
necessita de um adaptador para se conectar no barramento do microcomputador.
dados podem ser transferidos de forma sncrona ou assncrona
todas mensagens e comandos so sempre transferidos no modo assncrono.
multitarefa
mais cara.
16-bit
8-bit
(50 wire data cable)
5 MBytes/s
22
10 MByte/s
20 MBytes/s
20 MByte/s
40 MBytes/s
40 MByte/s
80 MBytes/s
Ultra-160 SCSI
160 MByte/s
Ultra-320 SCSI
320 Mbyte/s
23
Caractersticas
o
Cabos: compostos por quatro fios, sendo dois para dados, um para energia e um terra.
Plug USB
3.2.5 FIREWIRE
Tambm conhecido que IEEE 1394, a Sony, Panasonic, Sharp, Canon e JVC foram as
primeiras companhias a lanarem produtos com o FireWire (cerca de 7 milhes de codificadores de
vdeo digital - MPEG). O mercado de computadores tambm j est abastecido com modelos da
Apple, Compaq, Sony e NEC. Aguardam-se tambm a oferta de outros modelos de outras
companhias lderes. Atualmente, a Castlewood Systems desenvolve um drive de disco que recebe
diretamente a massa de dados de uma cmera digital, que promete eliminar o uso de fitas num
estdio de vdeo de alta qualidade.
Caractersticas
o
24
25
26
27
3.6 MEMRIA
RAM: uma memria voltil, que permite leitura e gravao.
Existe RAM Esttica e RAM Dinmica.
RAM Esttica: a informao armazenada em transistores e consome bastante energia.
RAM Dinmica: a informao armazenada em capacitores e necessita de refrescamento
peridico para regenerar a informao.
3.6.1 MEMRIA PRINCIPAL
A Memria Principal composta por memrias RAM Dinmica.
3.6.2 MEMRIA CACHE
uma memria de altssima velocidade de acesso.
28
efetivo
um
aumento
na
velocidade
de processamento (melhor
desempenho).
3.6.3 MEMRIA SECUNDRIA
a memria que fica armazenada em fita magntica, disco magntico, disco ptico, etc
Normalmente de 4 a 6 vezes mais lenta que a Memria Principal.
A figura abaixo representa a Hierarquia das Memrias em um Microcomputador
29
Composto por um conjunto de pratos cobertos por uma camada magntica, arranjados de
uma forma que seus centros estejam alinhados. Cada prato logicamente subdividido em crculos
concntricos, denominados trilhas, cada trilha subdividida em setores. Veja a figura abaixo.
Os conjuntos formados pelas trilhas, dos diversos pratos, de mesmos raios do se o nome
de cilindro. Veja a figura abaixo.
30
chamado de tempo de seek, tempo de gasto para o posicionamento da cabea sobre o setor
desejado chamado de latncia rotacional e o tempo de transferncia do disco para a cabea
chamado de tempo de transferncia. Veja exemplo abaixo.
Exemplo de clculo de tempo de acesso de um disco rgido
Determine a taxa de transferncia de um disco rgido, considerando:
por segundo.
Taxatransferncia= bytes transferidos / tacesso
tacesso = tseek + tlatncia + ttransferncia
onde:
tseek o tempo que a unidade despende para posicionar o cabeote de leitura e gravao
sobre o cilindro desejado.
tlatncia o tempo despendido na espera pelo setor desejado; varia de 0 a 16,67 ms para
disco girando a 3.600 rpm.
ttransferncia o tempo despendido na transmisso dos dados (leitura ou gravao).
3600 rpm - 16,67 ms
4800 rpm x
relao inversa. Logo, x = (3600 . 16,67) / 4800
x = 12,50 ms
Para 4800 rpm varia de 0 a 12,50 ms.
Na mdia:
tlatncia = 12,50 ms / 2
tlatncia = 6,25 ms
tseek = 1/2 tlatncia mdio = 1/2 . 6,25 ms
31
tseek = 3,125 ms
tacesso = tseek + tlatncia + ttransferncia
tacesso = 3,125 ms + 6,25 ms + 800 ms
tacesso = 809,375 ms
Taxatransferncia = 2 Mbytes/809,375 ms
Taxatransferncia = 2,47 Mbytes/s
3.7 BARRAMENTOS
3.7.1 INTRODUO
O termo barramento (bus) refere-se aos percursos entres os componentes de um
computador. H dois barramentos principais em um computador: o barramento de dados e o
barramento de endereos. O mais conhecido o barramento de dados, portanto, quando as
pessoas falam apenas "barramento", em geral esto querendo referir-se ao barramento de dados.
Barra
ment
os de
32
33
caso do EISA, era uma arquitetura aberta ao contrrio do MCA, e tratava-se de um padro
industrial, uma grande vantagem sobre os barramentos proprietrios. fisicamente representada
por um conector especial de expanso.
Havia um problema inerente conexo de dispositivos diretamente ao barramento da
CPU: a interface entre o barramento da CPU e o barramento VESA era dependente da CPU. Isso
implicava em que, ao fazer o upgrade da CPU, havia necessidade de fazer o upgrade da placa
VESA em conjunto.
Com a evoluo dos processadores, o padro VESA "A" foi se tornando relativamente
cada vez mais lento. Para resolver o problema de latncia do barramento inerente a essa situao,
foi criado um virtual local bus e conectado ao barramento da CPU via buffer. Essa soluo ficou
conhecida como VESA "B".
Os buffers permitiam que os sinais fossem armazenados por breves perodos, enquanto o
barramento estivesse ocupado. Mesmo assim, havia outros problemas: o que aconteceria quando
mais de um dispositivo necessitava utilizar o barramento da CPU ao mesmo tempo? Aconteceria
uma arbitragem e apenas um dispositivo utilizaria o barramento enquanto os demais aguardariam a
sua liberao. Com isso, poderia ocorrer uma latncia e o sistema poderia operar ineficientemente.
Surge ento o barramento PCI (Peripheral Component Interconnect).
A arquitetura PCI semelhante a VESA quanto conexo ao local bus da CPU, mas
muito mais elegante e completa ao utilizar uma ponte PCI-HOST, um dispositivo de cache que
prov uma nica interface entre a CPU, memria e o PCI local bus. A arquitetura PCI permite que a
CPU continue a buscar informao do cache enquanto o controlador de cache possibilita a um
dispositivo de expanso acessar a memria do sistema, ou seja, operaes concorrentes no
mesmo barramento.
Outra grande vantagem do barramento PCI que at 256 dispositivos podem ser
atachados a um nico PCI local bus, e 256 barramentos PCI podem existir em um nico sistema.
O barramento AGP (Accelerated Graphics Port) uma nova porta ou slot introduzida no
chipset LX do Pentium II (na placa me), para prover uma conexo de grande largura de banda
entre a memria do sistema e o subsistema grfico. Com isso, removeu-se o acelerador grfico do
gargalo do barramento PCI, liberando este e consequentemente aumentando a largura de banda
para operaes de E/S e trfego de rede.
3.7.2 BARRAMENTO ISA (INDUSTRY STANDARD ARCHITECTURE)
o
Caractersticas
34
uma parte 100% compatvel com o slot ISA de 8 bits utilizado pelo XT; e
Recursos
Interrupes: 15 linhas.
35
36
37
38
Pinagens
Nome
A0-A19
Pino
A31
E/S
S
a
AEN
Address
A12
A11
Descrio
Barramento de endereos (sinal A0 pino A31, sinal
A19 pino A12).
Enable
decodificador
no
capture
um
dado
Address
A11
Latch Enable
7CLK
Clock
micro.
Indica que h um endereo vlido no barramento de
endereos. No ativado durante operaes de
B20
DMA.
Clock do barramento ISA, de 8 MHz. Ele no
simtrico, apresentando um ciclo de carga de 33%,
D0-D7
D0-D7
A9 a
E/S
/DACK1
DMA
A2
B17
Acknowledge
/DACK2
1
DMA
2
DMA
B26
Acknowledge
/DACK3
B15
Acknowledge
DRQ1
3
DMA
B18
DRQ2
Request 1
DMA
B6
DMA.
Faz um pedido de DMA nvel 2 ao controlador de
DRQ3
Request 2
DMA
B16
DMA.
Faz um pedido de DMA nvel 3 ao controlador de
/I/O CH CK
Request 3
I/O Channel
A1
DMA.
Ativando este sinal, gera-se uma interrupo no-
Check
39
/I/O CH RDY
I/O Channel
A10
Ready
para
no
inserirmos
wait
states
I/O Read
A14
est
sendo
I/O Write
A13
DMA.
Indica que uma escrita em I/O est sendo
executada. tambm ativado durante operaes de
IRQ3
Interrupt
B25
DMA.
Faz um pedido de interrupo nvel 3 ao controlador
IRQ4
Request 3
Interrupt
B24
de interrupes.
Faz um pedido de interrupo nvel 4 ao controlador
IRQ5
Request 4
Interrupt
B23
de interrupes.
Faz um pedido de interrupo nvel 5 ao controlador
IRQ6
Request 5
Interrupt
B22
de interrupes.
Faz um pedido de interrupo nvel 6 ao controlador
IRQ7
Request 6
Interrupt
B21
de interrupes.
Faz um pedido de interrupo nvel 7 ao controlador
IRQ9
Request 7
Interrupt
B4
de interrupes.
Faz um pedido de interrupo nvel 9 ao controlador
/MEMR
Request 9
Memory
B12
de interrupes.
Indica que est sendo executada uma operao de
Read
/MEMW
Memory
Write
OSC
Oscilador
operaes de DMA.
Indica que est sendo executada uma operao de
escrita em memria. tambm ativado durante
B30
operaes de DMA.
Sinal com freqncia de 14, 31818 MHz, utilizado
para a sincronizao do vdeo CGA. No
sincronizado com o clock do micro, portanto
40
RESET DRV
TC
Reset Driver
Terminal
B2
B27
S
S
cuidado.
Sinal de reset do sistema.
Indica que um dos canais de DMA acabou de
+5V
Count
+5V
B3,
-12V
-5V
GND
-12V
-5V
Terra
B29
B7
B5
B1,
S
S
S
-12V
-5V
Terra
B10,
B31
Sinais precedidos do smbolo "/" so ativados em nvel "0".
Parte 2 - Poro C/D
Sinal
A17-A23
Nome
A17-A23
Pino
C8 a
E/S
S
C2
Descrio
Barramento de endereos, parte alta. Estas linhas
no so vlidas durante todo o ciclo do barramento,
por
isto
devemos
utilizar
um
latch
para
D8-D15
C11
E/S
a
/DACK0
DMA
C18
D8
Acknowledge
/DACK5
0
DMA
5
DMA
D10
6
DMA
D12
Acknowledge
/DACK7
Acknowledge
/DACK6
D14
Acknowledge
DRQ0
7
DMA
D9
DRQ5
Request 0
DMA
D11
DMA.
Faz um pedido de DMA nvel 5 ao controlador de
DRQ6
Request 5
DMA
D13
DMA.
Faz um pedido de DMA nvel 6 ao controlador de
DRQ7
Request 6
DMA
D15
DMA.
Faz um pedido de DMA nvel 7 ao controlador de
41
/IOCS16
Request 7
I/O Chip
D2
Select 16 bits
DMA.
Indica que haver uma transferncia de 16 bits no
barramento de dados, utilizando endereamento em
I/O (Obs: este sinal deve ser utilizado com um
IRQ10
Interrupt
D3
IRQ11
Request 10
Interrupt
D4
controlador de interrupes.
Faz um pedido de interrupo nvel 11 ao
IRQ12
Request 11
Interrupt
D5
controlador de interrupes.
Faz um pedido de interrupo nvel 12 ao
IRQ14
Request 12
Interrupt
D7
controlador de interrupes.
Faz um pedido de interrupo nvel 14 ao
IRQ15
Request 14
Interrupt
D6
controlador de interrupes.
Faz um pedido de interrupo nvel 15 ao
/MASTER
Request 15
Master
D17
controlador de interrupes.
Este sinal ativado quando queremos que algum
outro dispositivo assuma o controle do barramento
(bus master). Deve ser acionado em conjunto com o
sinal DRQ. Quando o sinal /DACK correspondente
for devolvido, todos os circuitos conectados ao
barramento so colocados em tri-state, permitindo
que o dispositivo manipule o barramento como bem
entender. O novo mestre de barramento dever
obedecer aos sinais de temporizao e devolver o
/MEMCS16
Memory Chip
D1
Select 16 bits
controle no mximo em 15 m s.
Indica que haver uma transferncia de 16 bits no
barramento de dados, utilizando endereamento em
memria (Obs: este sinal deve ser utilizado com um
/MEMR
Memory
C9
/MEMW
Read
Memory
C10
SBHE
Write
System Bus
C1
High Enable
+5V
+5V
D16
42
A0
0
1
0
1
Funo
Transferncia de 16 bits
Transferncia do byte alto
Transferncia do byte baixo
Invlido
Caracterstica
Utilizado a 33 MHz;
Possui largura de 32 bits em uma conexo de 124 pinos;
Desempenho calculado = 32 (bits) x 33 (MHz) / 8 (bits) = 132 MB/s;
Suporta muitos dispositivos
3.7.3.2 Verso 2.0
o
Caractersticas
43
O clock externo sempre igual a uma frao do clock interno. Esta frao pode ser 2/3,
1/2, 2/5, ou 1/3 dependendo do valor do clock interno. Estas diviso feita pelo
microprocessador.
Clock do barramento PCI, o clock do barramento PCI sempre igual metade do clock
externo do microprocessador que feita por um VLSI(chip responsvel pela integrao dos
componentes) que controla o acesso ao barramento PCI.
Clock Interno
75 MHz
100 MHz
133 MHz
150 MHz
166 MHz
200 MHz
Frao
2/3
2/3
1/2
2/5
2/5
1/3
Clock Externo
50 MHz
66 MHz
66 MHz
60 MHz
66 MHz
66 MHz
Clock PCI
25 MHz
33 MHz
33 MHz
30 MHz
33 MHz
33 MHz
O barramento PCI o barramento mais utilizado atualmente, j que ele muito mais rpido
que os barramentos ISA, tem como vantagem o fato de trabalhar independentemente do
processador ( trabalhar paralelamente a ele), alm de possuir uma grande compatibilidade, uma
44
vez que ele no funciona para computadores com processador Pentium, diferentemente dos
barramentos intermedirios entre ele e o ISA.
Inclusive, nas placas atuais o barramento ISA acessado atravs do barramento PCI.
Agora sero relacionadas as caractersticas principais deste barramento :
como
tambm
possibilitando
uma
reduo
na
energia
consumida
pelo
microcomputador.
At pouco tempo, a maioria dos PCs equipados com processadores Pentium e
superiores utilizavam placas de vdeo PCI. Depois da criao do barramento AGP, placas
de vdeo AGP tm se tornado cada vez mais comuns, sendo que as vantagens deste tipo
de barramento sero explicadas adiante.
Alm das placas PCI para vdeo(caso de placas VGA e SVGA), podemos utilizar esse
barramento possui outros tipos de placa, como por exemplo:
Placa de rede PCI
Digitalizadoras de vdeo PCI
Controladoras SCSI PCI
Placas de som PCI
Placas de modem PCI
45
PCI
|
|
optional
____
|___|
|
64-bit pins _____|
|||||||--|||||||||||||||||--|||||||--||||||||||||||
^
^ ^
^ ^
^ ^
b94
optional
____
|___|
|
64-bit pins _____|
||||||||||||||||||||||||||--|||||||--||||||||||||||
optional
____
|___|
|
64-bit pins _____|
|||||||--||||||||||||||||||||||||||--||||||||||||||
46
Pin
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
A14
A15
A16
A17
A18
A19
A20
A21
A22
A23
A24
A25
A26
A27
A28
A29
A30
A31
A32
A33
A34
A35
A36
A37
A38
A39
A40
A41
A42
A43
A44
A45
A46
A47
A48
A49
A52
A53
A54
A55
+5V
TRST
+12V
TMS
TDI
+5V
INTA
INTC
+5V
RESV01
+5V
RESV03
GND03
GND05
RESV05
RESET
+5V
GNT
GND08
RESV06
AD30
+3.3V01
AD28
AD26
GND10
AD24
IDSEL
+3.3V03
AD22
AD20
GND12
AD18
AD16
+3.3V05
FRAME
GND14
TRDY
GND15
STOP
+3.3V07
SDONE
SBO
GND17
PAR
AD15
+3.3V10
AD13
AD11
GND19
AD9
C/BE0
+3.3V11
AD6
AD4
+3.3V
Universal
+3.3V
Signal Rail
(OPEN)
(OPEN)
(OPEN)
(OPEN)
+3.3V
Signal Rail
Description
Test Logic Reset
+12 VDC
Test Mde Select
Test Data Input
+5 VDC
Interrupt A
Interrupt C
+5 VDC
Reserved VDC
+V I/O (+5 V or +3.3 V)
Reserved VDC
Ground or Open (Key)
Ground or Open (Key)
Reserved VDC
Reset
+V I/O (+5 V or +3.3 V)
Grant PCI use
Ground
Reserved VDC
Address/Data 30
+3.3 VDC
Address/Data 28
Address/Data 26
Ground
Address/Data 24
Initialization Device Select
+3.3 VDC
Address/Data 22
Address/Data 20
Ground
Address/Data 18
Address/Data 16
+3.3 VDC
Address or Data phase
Ground
Target Ready
Ground
Stop Transfer Cycle
+3.3 VDC
Snoop Done
Snoop Backoff
Ground
Parity
Address/Data 15
+3.3 VDC
Address/Data 13
Address/Data 11
Ground
Address/Data 9
Command, Byte Enable 0
+3.3 VDC
Address/Data 6
Address/Data 4
47
A56
A57
A58
A59
A60
A61
A62
GND21
AD2
AD0
+5V
REQ64
VCC11
VCC13
A63
A64
A65
A66
A67
A68
A69
A70
A71
A72
A73
A74
A75
A76
A77
A78
A79
A80
A81
A82
A83
A84
A85
A86
A87
A88
A89
A90
A91
A92
A93
A94
GND
C/BE[7]#
C/BE[5]#
+5V
PAR64
AD62
GND
AD60
AD58
GND
AD56
AD54
+5V
AD52
AD50
GND
AD48
AD46
GND
AD44
AD42
+5V
AD40
AD38
GND
AD36
AD34
GND
AD32
RES
GND
RES
B1
B2
B3
B4
B5
B6
B7
B8
B9
B10
B11
B12
B13
-12V
TCK
GND
TDO
+5V
+5V
INTB
INTD
PRSNT1
RES
PRSNT2
GND
GND
+3.3V
Signal Rail
+3.3V
Signal Rail
+3.3V
Signal Rail
+3.3V
Signal Rail
(OPEN)
(OPEN)
(OPEN)
(OPEN)
Ground
Address/Data 2
Address/Data 0
+V I/O (+5 V or +3.3 V)
Request 64 bit ???
+5 VDC
+5 VDC
Ground
Command, Byte Enable 7
Command, Byte Enable 5
+V I/O (+5 V or +3.3 V)
Parity 64 ???
Address/Data 62
Ground
Address/Data 60
Address/Data 58
Ground
Address/Data 56
Address/Data 54
+V I/O (+5 V or +3.3 V)
Address/Data 52
Address/Data 50
Ground
Address/Data 48
Address/Data 46
Ground
Address/Data 44
Address/Data 42
+V I/O (+5 V or +3.3 V)
Address/Data 40
Address/Data 38
Ground
Address/Data 36
Address/Data 34
Ground
Address/Data 32
Reserved
Ground
Reserved
-12 VDC
Test Clock
Ground
Test Data Output
+5 VDC
+5 VDC
Interrupt B
Interrupt D
Reserved
+V I/O (+5 V or +3.3 V)
??
Ground or Open (Key)
Ground or Open (Key)
48
B14
B15
B16
B17
B18
B19
B20
B21
B22
B23
B24
B25
B26
B27
B28
B29
B30
B31
B32
B33
B34
B35
B36
B37
B38
B39
B40
B41
B42
B43
B44
B45
B46
B47
B48
B49
B50
B51
B52
B53
B54
B55
B56
B57
B58
B59
B60
B61
B62
RES
GND
CLK
GND
REQ
+5V
AD31
AD29
GND
AD27
AD25
+3.3V
C/BE3
AD23
GND
AD21
AD19
+3.3V
AD17
C/BE2
GND13
IRDY
+3.3V06
DEVSEL
GND16
LOCK
PERR
+3.3V08
SERR
+3.3V09
C/BE1
AD14
GND18
AD12
AD10
GND20
(OPEN)
(OPEN)
AD8
AD7
+3.3V12
AD5
AD3
GND22
AD1
VCC08
ACK64
VCC10
VCC12
B63
B64
B65
B66
RES
GND
C/BE[6]#
C/BE[4]#
+3.3V
Signal Rail
GND
GND
(OPEN)
(OPEN)
Reserved VDC
Reset
Clock
Ground
Request
+V I/O (+5 V or +3.3 V)
Address/Data 31
Address/Data 29
Ground
Address/Data 27
Address/Data 25
+3.3VDC
Command, Byte Enable 3
Address/Data 23
Ground
Address/Data 21
Address/Data 19
+3.3 VDC
Address/Data 17
Command, Byte Enable 2
Ground
Initiator Ready
+3.3 VDC
Device Select
Ground
Lock bus
Parity Error
+3.3 VDC
System Error
+3.3 VDC
Command, Byte Enable 1
Address/Data 14
Ground
Address/Data 12
Address/Data 10
Ground
Ground or Open (Key)
Ground or Open (Key)
Address/Data 8
Address/Data 7
+3.3 VDC
Address/Data 5
Address/Data 3
Ground
Address/Data 1
+5 VDC
Acknowledge 64 bit ???
+5 VDC
+5 VDC
Reserved
Ground
Command, Byte Enable 6
Command, Byte Enable 4
49
B67
B68
B69
B70
B71
B72
B73
B74
B75
B76
B77
B78
B79
B80
B81
B82
B83
B84
B85
B86
B87
B88
B89
B90
B91
B92
B93
B94
GND
AD63
AD61
+5V
AD59
AD57
GND
AD55
AD53
GND
AD51
AD49
+5V
AD47
AD45
GND
AD43
AD41
GND
AD39
AD37
+5V
AD35
AD33
GND
RES
RES
GND
+3.3V
Signal Rail
+3.3V
Signal Rail
+3.3V
Signal Rail
Ground
Address/Data 63
Address/Data 61
+V I/O (+5 V or +3.3 V)
Address/Data 59
Address/Data 57
Ground
Address/Data 55
Address/Data 53
Ground
Address/Data 51
Address/Data 49
+V I/O (+5 V or +3.3 V)
Address/Data 47
Address/Data 45
Ground
Address/Data 43
Address/Data 41
Ground
Address/Data 39
Address/Data 37
+V I/O (+5 V or +3.3 V)
Address/Data 35
Address/Data 33
Ground
Reserved
Reserved
Ground
desempenho, capazes de operar com taxas de transferncia superiores a 10 MB/s, sendo que o
barramento ISA se tornou um gargalo para o desenvolvimento de dispositivos mais velozes. Para
resolver este problema, a VESA (Vdeo Electronics Standard Association) criou um novo
barramento veloz chamado VLB (VESA Local Bus). Este barramento foi muito utilizado nas placas
de CPU 486. e mesmo nas de 386, fabricadas entre 1993 e 1994. Comeando a cair em desuso no
ano de 1995, dando lugar ao barramento PCI, estudado anteriormente.
50
Caracterstica
Utilizado a 33 MHz;
Desempenho calculado = 32 (bits) x 33 (MHz) / 8 (bits) = 132 MB/s;
Figura placa de vdeo SVGA (Vdeo) e controlodara de HDs e portas Seriais IDEPLUS
tipos
de
placas:
Caracterstica
Utilizado a 33 MHz;
Desempenho calculado = 32 (bits) x 33 (MHz) / 8 (bits) = 132 MB/s;
Pode operar em com placas ISA de 8 ou 16 bits em 5 Mhz e 8 Mhz, respectivamente
51
Caracterstica
Utilizado a 10 MHz;
Desempenho calculado = 32 (bits) x 10 (MHz) / 8 (bits) = 40 MB/s;
52