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Objetivos
Formulas
Rtotal=R1+R2+.+Rn
Ley ohm
V=IR
Corriente
I=V/R
Potencia
P=V*I , =
, P= 2 *R
Valores Calculados
Rtotal=1k+2k+3k+.330ohms=6.330ohms
I= 5V/6.330Kohms=0.789 mA
V1=1k(0.789)=0.789V
V2=2k(.789)=1.57V
V3=3K(.789)=2.3V
V4=.330(.789)=.26V
Vtotal=v1+v2+v3+v4= 5volts
Potencia
P1=0.62mW
P2=1.24mW
P3=1.86mW
P4=0.20mW
Objetivos
Valores calculados
Resistencia
Rtotal=1.2Kohms+1Kohm
Voltaje
V1=IR=>(2.27mA)(1)=2.27V
V2=(2.27mA)(1.2)=2.72V
V3=2.72V
Intensidad de corriente
Itotal=V/R => 5V/2.2Kohms=2.27mA
I1=Itotal=2.27mA
I2=V2/R2=1.36mA
I3=Itotla-I2=0.91mA
Potencia
P1=V*I=(2.27V)(2.27mA)=5.15mWatts
P2=(2.72V)(1.36mA)=3.6mWatts
P3=(2.72V)(0.91mA)=2.47mWatts
2)F=B+BD+(CD+CD)(CD+CD)
D(CD+CD)(CD+CD)
=D
3 )F=ABD+AC+DC+BC
=B+AC
4)F=ABC+ABC+ABC+ABC+ABC+ABC+ABC
AC+A+ABC
= AB
5)F=AB(C+D)+AD+AB
=AB(C+D)+DB
6)F=AB+CD+ABC+AD+AC
AB+CD+ABC+DC
=B+C+D
El Medio sumador es un con dos entradas y dos salidas que vendran a ser el resultado de la suma
y el acarreo mientras que los dos bits de entrada representan el sumando y el aadido de la
operacin
tabla de verdad
A
Tabla De Verdad
A
0
0
0
0
1
1
1
1
B
0
0
1
1
0
0
1
1
Cin
0
1
0
1
0
1
0
1
Cout
0
0
0
1
0
1
1
1
SUMA
0
1
1
0
1
0
0
1
Practica 7-DECODIFICADOR
Un decodificador es el proceso inverso de un codificador, es decir, un traductor de lenguaje de las
maquina al lenguaje de la gente.
El decodificador tiene 4 entradas a la izquierda y tiene a la derecha diez lneas de salidas.
Los inversores que se encuentran a la salida se aaden por conveniencia para controlar las luces
de los indicadores decimales, es decir, que una salida activa se invierte a uno lgico en los
indicadores de salidas.
En la primera lnea de la tabla de verdad se muestran todas las entrada en el nivel bajo (0). Con
una entrada 0000 se activa la salida del cero decimal al estado bajo. El inversor inferior
complementa esta salida al nivel alto, lo que hace que luzca el indicador de la salida decimal cero,
no permitiendo que ninguno de los dems luzcan.
De igual forma, la quinta lnea muestra la entrada BCD 0100, lo que hace que se active la salida
cuatro en el nivel bajo. Esta salida es invertida haciendo que luzca el indicador de la salida decimal
4.
Restador
Para la resta de dos dgitos binarios , un circuito digital la hace con operaciones de suma en
complemento a Dos.
Restas por Convenio Complemento A 2
La resta o diferencia de dos dgitos binarios, un circuito digital la hace con operaciones de
suma en complemento a uno o dos.
Para ilustrar este tipo de restas se analizar un ejemplo:
1) Se toma el sustraendo Sn y se complementa.
2) Al nmero complementado le sumamos la unidad.
3) El resultado ser el sustraendo negativo (Sn), el cual se sumar al minuendo Mn.
4) Deben de considerarse los bits de signo desde que se inicia la operacin hasta que
finaliza.
5) En el resultado final existe un bit que no se considera
6) Para visualizar el resultado de la resta en cdigo BCD en los dos displays se utiliza la
misma lgica del sumador.
Para nmeros negativos se utiliza un 7485 que compara los 2 nmeros de entrada y si el
primero es menor que el segundo se activa la punta de prueba de los displays indicando que
la operacin no se puede realizar