Informe Previo 3

Informe Previo 3: Circuito Comparador, Generador de

Paridad y circuitos combinacionales con CI-MSI.
1) Presentar los diagramas esquemticos y las tablas de verdad de los C.I. M.S.I.
Concernientes a esta prctica (74LS85, 74LS86)

Para el comparador 74ls85:

Este circuito integrado contiene un comparador de dos datos de 4 bits cada uno.

La relacin de pines de este integrado es la siguiente:

A>B, A<B, y A=B: entradas de comparacin en cascada activas a nivel alto (1)

A>B, A<B, y A=B: salidas de comparacin activas a nivel alto (1).

A0, A1, A2, A3: entradas del dato A.

B0, B1, B2, B3: entradas del dato B.

La tabla de verdad y el montaje del comparador es la siguiente:

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Y la tabla de verdad ser:

Si hacemos la simulacin en Multisim, obtenemos:

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Para la compuerta lgica 74ls86:

XOR (7486):

Expresin Algebraica:

AB = F
Tabla de verdad

A B F
0 0 0
0 1 1
1 0 1
1 1 0

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2. Explique el funcionamiento de un comparador de magnitud de 2 bits y de 4 bits

Comparador de 2 bits:

Un comparador de dos bits es aquel circuito al cual tu introduces dos nmeros de dos bits
cada uno y en respuesta ello tienes tres posibles salidas, que A sea mayor B, que A sea
igual a B y que A sea menor a B, para verificar ello usualmente se coloca un led en la cada
salida.

El siguiente comparador de dos bits, est hecho a base de compuertas nand.

Comparador de 4 bits:

Un comparador de dos bits es aquel circuito al cual tu introduces dos nmeros de cuatro
bits cada uno y en respuesta ello tienes tres posibles salidas, que A sea mayor B, que A
sea igul a B y que A sea menor a B, para verificar ello usualmente se coloca un led en la
cada salida.

En el siguiente circuito se aprecia un comparador de dos nmeros de cuatro bits cada uno
realizado a base de compuertas not, and, nor y or.

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3. Explique el funcionamiento de un circuito generador de paridad. Explique el caso de

Paridad par o impar.

La finalidad de ponerle un bit de paridad par o impar es la de darle mayor seguridad al

cdigo y evitar posibles errores en la transferencia de datos.

El circuito de que me genera un bit de paridad par es el siguiente:

Como podemos ver se operan por medio de una compuerta Xor los 4 bits de entrada de
mi cdigo, resultado de dicha operacin se obtiene un bit que puede ser 0 o 1 el cual
depender de la cantidad de 1 que haya en mis 4 bits.

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Por ejemplo:

1011 en paridad par ser 11011

1001 en paridad par ser 01001

En nuestro el circuito se hizo a base de compuertas Xor ya que su salida ser un 1

siempre y cuando la suma de sus entradas sea un nmero impar, de esa manera se
garantiza que la salida final ser un 1 si y solo si hay una cantidad impar de 1 en
nuestro nmero de cuatro bits.

4. Explique el funcionamiento de un circuito detector de paridad.

La funcin de un circuito detector de paridad es la de verificar si el cdigo que est

recibiendo esta con un cantidad de 1 par o impar (depende al tipo de paridad al que fue
sometido inicialmente).

Un circuito detector de paridad es el siguiente:

Como podemos ver en el circuito el detector de paridad par se hizo a base de puras
compuertas Xor, la salida Error permanecer en 0 lgico siempre y cuando la cantidad
de 1 del cdigo (incluyendo al bit de paridad par) sea una cantidad par, pero si se
detecta un numero de 1 impar, inmediatamente cambiara a estado alto la salida y
depende a lo que valla conectado el circuito nos avisara que ha ocurrido un error en
cuanto a la transmisin del cdigo.

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5. Disee un circuito lgico para controlar las luces instaladas en un pasadizo largo que
tiene 3 puertas, una en cada extremo y una a la mitad. Cada puerta tiene un interruptor
para operar las luces a lo largo del pasillo. Etiquete los interruptores como A, B y C.

Cuya tabla de verdad es la siguiente:

A B
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
C D
0 0
1 1
0 1
1 0
0 1
1 0
0 0
1 1

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6. Obtener la tabla de verdad de cada una de las salidas S y C del circuito mostrado:

Cuya tabla de verdad es la siguiente:

X Y Z S C
0 0 0 0 0
0 0 1 1 1
0 1 0 1 0
0 1 1 0 0
1 0 0 1 0
1 0 1 0 0
1 1 0 0 1
1 1 1 1 1

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