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47KΩ
U1 VCC
5.0V
OPAMP_3T_VIRTUAL
U3
7
1
8
3 R9
6
1kΩ U2
D1 2
BPV10NF
AD620AN R3 R2 R1
4
5
VSS
1kΩ 1kΩ 1kΩ OPAMP_3T_VIRTUAL
U2 -5V R10
R4 R8 R7 R5 R6
2kΩ
2kΩ 2kΩ 2kΩ 2kΩ 2kΩ
OPAMP_3T_VIRTUAL
R2
47KΩ
Figura 1 Figura 2
3. Un transductor entrega un voltaje entre 1.1 y 1.9 voltios cuando la variable que transduce
varía de 0 a 100% de su rango, diseñe e implemente un circuito de acondicionamiento que
entregue un voltaje entre 0 y 4.096 voltios ante esta variación.
4. Un convertidor digital/analógico de 4 bits, conocido como de red R-2R tiene el circuito
esquemático de la Figura 2. Las resistencias R4, R8, R7 y R5 reciben las entradas digitales
(0 o 5 voltios según el nivel lógico). Responda las siguientes preguntas:
a. Cuál de las resistencias (R4 o R5) debería recibir el bit más significativo? Puede
averiguarlo probando en cuál de las resistencias un nivel alto tiene mayor efecto
sobre el voltaje de salida del Op.Amp manteniendo las otras entradas en cero.
b. Halle el voltaje de salida para una entrada todos ceros (0000).
c. Halle el voltaje de salida para una entrada todos unos (1111).
5. Se desea filtrar una señal con un filtro pasa-alto de 2do orden con una frecuencia de corte
de 0.2 Hz. Diseñe el filtro Sallen-Key correspondiente y dibuje el circuito esquemático. Se
sugiere que las capacitancias tengan una relación de 1 a 5 y que ninguna de ellas sea
mayor de 300 nF.
6. Un circuito de muestreo y retención debe llegar a 0.1% en 10 us (ante un escalón de
1voltio); calcule la capacitancia de retención y la máxima corriente de bias que se puede
aceptar en el operacional para que en la fase de retención que dura 100us la tensión en el
circuito caiga menos de 0.1%. Asuma que la resistencia en estado encendido del
conmutador es de 100 Ohmios y es muy alta en estado apagado.
7.