TECHNOLOGIE

DES CIRCUITS INTEGRES

TTL - CMOS

1.1 Définition de circuit intégré :

▪ Un circuit intégré désigne un bloc constitué par un monocristal de silicium ( Puce )

de quelques millimètres carrés à l’intérieur duquel se trouve inscrit en nombre
variable des composants électroniques élémentaires ( Transistors, diodes,
résistances, condensateurs, ... ).

1.2 Définition de classes d’intégration :

Dans l’ordre chronologique, on distingue 4 classe d’intégration :

*0 Les microcircuits SSI ( Single Size Intégration ) : ≈ 100 transistors par cm2.
*1 Les circuits intégrés MSI ( Médium Size Intégration ) : ≈ 1000 transistors par
cm2.
*2 Les circuits LSI ( Large Size Intégration ) : ≈ 10000 à 100000 transistors par
cm2.
*3 Les circuits VLSI ( Very Large Size Intégration ) : ≈ 0.1 à 1 million transistors
par cm2.

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1.3 Notion de niveaux logiques :

Pour une famille donnée, les niveaux logiques « 0 » et « 1 » ne correspondent pas à une tension
précise, mais à une certaine « plage » de tension.

• On appellera pour les valeurs de tension en entrée ( Input ):

*4 VIHmin : Tension minimale en entrée qui assure le niveau logique haut.
*5 VILmax : Tension maximale en entrée qui assure le niveau logique bas.

Vcc
1
VIHmin
Caractéristique ∅
d’entrée
 VILmax
( Etat indéfini )

 On appellera pour les valeurs de tension en sortie ( Output ):

*6 VOHmin : Tension minimale de sortie à l’état logique haut.
*7 V0Lmax : Tension maximale de sortie à l’état logique bas.

Vcc
1
VOHmin
Caractéristique
∅
de sortie
 VOLmax
( Etat indéfini )

0
0

1.4 Compatibilité des niveaux logiques .

Vcc VOHmin - VIHmin Vcc

1 1
VOHmin
VIHmin
∅ ∅
( Etat indéfini ) VILmax - VOLmax ( Etat indéfini )

VOLmax VILmax
0
0
0 0
Niveaux de sortie circuit 1 Niveaux d’entrée circuit 2

*8 Compatibilité au niveau haut : Il faut que VOHmin > VIHmin

*9 Compatibilité au niveau bas : Il faut que VILmax > VOlmax

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1.5 Temps moyen de propagation.

Lorsqu’on applique à l’entrée d’un circuit un niveau logique, il y a un certain retard pour que la
sortie réagisse. Cette durée est le temps moyen de propagation t PD.

tPHL tPLH
S
Entrée Sortie

50%

t
*10 tPHL: Temps de propagation du niveau haut au niveau bas.
*11 tPLH: Temps de propagation du niveau bas au niveau haut.
tPD = (tPHL + tPLH ) / 2

Remarque : Ce temps détermine la fréquence maximale FMAX à laquelle les circuits intégrés sont
capables de réagir.

1.6 Facteur de charge : Sortance N.

Ce paramètre caractérise le nombre N maximal d’entrées de portes logiques pouvant être

commandées par la sortie d’un autre opérateur logique de la même famille.

IO II
X X
IOH : Courant de sortie maximal à l’état haut
II IOL : Courant de sortie maximal à l’état bas
X
IIH : Courant d’entrée maximal à l’état haut
II
X IIL : Courant d’entrée maximal à l’état bas

*12 Sortance N ( A l’état haut ) = IOH / IIH

*13 Sortance N ( A l’état bas ) = IOL / IIL

Remarque : La documentation constructeur fournie les données suivantes : IOH, IIH, IOL, IIL.

1.7 Notion de familles de circuits logiques :

Il existe plusieurs familles de circuits technologiques. Les 2 plus utilisées sont :

*14 TTL ( Transistors Transistors Logic )
*15 CMOS (transistors à effet de champ MOS - Complémentaire - Métal - Oxyde - Semiconducteur - )

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PORTES LOGIQUES TTL Transistor Transistor Logique Fiche de référence N°7

Plusieurs technologies : Niveaux Logiques d ’une porte logique TTL (LS)

SORTIE ENTREE
TTL standard (n ’est plus utilisée) 74 00
TTL Low Power 74 L 00 VO VI
TTL Schottky (Rapide) 74 S 00 VCC 5V VCC 5V
TTL Low Power Schottky 74 LS 00
TTL Advanced Schottky 74 AS 00 Niveau ‘ 1 ’ Niveau ‘ 1 ’
TTL Advanced Low Power Schottky 74 ALS00 VOH mini 2,7 V
VIH mini 2V
Niveau Niveau
Caractéristiques de fonctionnement : indéterminé indéterminé
VIL maxi 0,7 V
VOL maxi 0,5 V
Niveau ‘ 0 ’ Niveau ‘ 0 ’
Gamme d’alimentation : 5 V +/- 5%.
0V 0V
Gamme de température : de 0 °C à + 70 °C.
Sortie à collecteur ouvert (Open collector Symbole
Puissance dissipée : environ 2 mW par porte (série LS). output)
On sort directement sur le
Fréquence de fonctionnement : jusqu’à 3 MHz. collecteur du transistor de sortie.
 Obligation de connecter une
VO La sortie est VO
résistance R de tirage au +5 V. équivalente à un
Sortance : jusqu’à 20 (série LS). Pour un calcul rigoureux de R, se interrupteur.
To
(Nombre d’entrées que l’on peut relier à une sortie de porte) reporter à la page 43 du
Memotech

Faible immunité aux bruits.

Caractéristique d ’Entrée/Sortie d’un inverseur
Sortie 3 états (3-state Symbole
VO output)
VCC +5V Dans une porte classique, l ’un des 2 transistors T1 ou T2 du totem pôle est conducteur.
Dans une porte 3 états, il est possible de bloquer simultanément les 2 transistors T1 et
VOH 74 LS 00 T1 T2 par l ’entrée de validation EN (EN = 0).
VI VO VO On dispose alors de 3 états en sortie:

& T2
EN
1
1
T1
Passant
Bloqué
T2
Bloqué
Passant
Etat
Haut
Bas
VOL 0 Bloqué Bloqué Haute impédance (Sortie ‘ en l ’air ’).
VIL VIH VCC VI
0

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PORTES LOGIQUES CMOS Fiche de référence

Plusieurs technologies : Modélisation de l’entrée et de la sortie d’une porte logique CMOS

Série 4000 : SORTIE ENTREE

40 00 B (sorties bufférisées : amplifiées)
40 00 UB (sorties non-bufférisées)
Rs IIN
IOH
Série 74 :
CG
74 C 00 (identique à la série 4000) VDD
VOH RG
74 HC 00 (High-speed CMOS : CMOS rapides) VIH

Caractéristiques de fonctionnement :

Gamme d’alimentation : de 3 V à 15 V. Etat logique ‘ 1 ’ Etat logique ‘ 1 ’

Gamme de température : de – 40 °C à + 85 °C.

Puissance dissipée : environ 10 nW par porte. IOL IIN

Fréquence de fonctionnement : jusqu’à 12 MHz. CG

RS RG
VOL VIL
Sortance : jusqu’à 50 (série 4000B).
(Nombre d’entrées que l’on peut relier à une sortie de porte)

Excellente immunité aux bruits.

Caractéristique d ’Entrée/Sortie d’un inverseur
Etat logique ‘ 0 ’ Etat logique ‘ 0 ’
VO
GRANDEURS VOH : Tension de sortie à l ’état haut.
VI VO CARACTERISTIQUES :
VDD
1 RS = environ 300 Ω
VOL :
VIH :
Tension de sortie à l ’état bas.
Tension d ’entrée à l ’état haut.
RG = plusieurs MΩ VIL : Tension d ’entrée à l ’état bas.
IOH : Courant de sortie à l ’état haut.
CG = environ 50 pF
VDD VI IOL : Courant de sortie à l ’état bas.
0 VDD / 2
IIN : Courant d ’entrée.
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