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Abstract—El problema con los amplificadores que uti- • Tensión de polarización Vcc = 15 Volts.
lizan transistores es la estabilidad de la corriente de • Ganancia de tensión en la segunda etapa Av (2):
colector. En este informe se presenta el diseño de un −500 Volt/Volt.
amplificador de dos etapas en cascads en configuración • Frecuencia de corte inferior ωc : 2π ∗ 5 k rad/seg.
de Emisor Común con realimentación de Emisor. Los
• Resistencia de fuente Rs = 5 kOhms.
resultados indican la estabilidad de la corriente de colector
en cada etapa, y la concordancia entre los datos calculados
y medidos. A. Análisis de polarización
Index Terms—Fuente, Leyes de Kirchhoff, Malla, Este análisis permite determinar el punto Q de polar-
Multímetro, Nodo, Resistores, Simulador. ización de los amplificadores [1]. Para ello se tiene
que los capacitores separa cada una de las etapas de
amplificación, es decir, se considerarían como circuitos
I. I NTRODUCCIÓN abiertos. Por lo tanto, para la correspondiente etapa n,
El problema fundamental en el diseño de amplificadores se tienen las siguientes ecuaciones de malla a la salida
con transistores es establecer uno que provea un punto de cada amplificador para hallar IC (n):
estable de polarización. Además, si se requiere que el
vCE = VCC − iC (n)RC (n) − iE (n)RE (n)
amplificador funcione para una gama limitada de fre-
cuencias, el cálculo de los filtros es escencial. Para ello se Considerando iC (n) ≈ iE (n), se tiene que:
ilustra en la Figura 1(a) un amplificador de dos etapas en
vCE = VCC − (iC (n))(RC (n) + RE (n))
cascada, utilizando una configuración en Emisor Común
(EC) para cada etapa. Así, para cada etapa, la resistencia Luego la recta de carga en función de vCE es igual a:
de emisor se comporta como un parámetro de reali- VCC − vCE
mentación. Suponga que la corriente de colector IC varia iC (n) = (1)
RC (n) + RE (n)
más allá del valor diseñado (sea por una variación de β ,
o de temperatura). Luego VRE = RE IE . Como VBB y Luego, se puede considerar la curva de la pendiente de
RB no cambian, en la malla de entrada se muestra que carga como −1/(RC (n) + RE (n)). Para la malla de
IB debería disminuir, lo que reduce también el valor de entrada se tiene el equivalente Thévenin desde la base,
IC a su valor original. Esto se denomina Realimentación donde:
Negativa. R1 (n)R2 (n)
RB (n) = R1 (n)||R2 (n) = (2)
En este informe se presenta el procedimiento de R1 (n) + R2 (n)
diseño, montaje y recomendaciones para cumplir con las R2 (n)
características anteriormente comentadas. VBB (n) = VCC ∗ (3)
R1 (n) + R2 (n)
Luego, tomando la malla de entrada Base–Emisor:
II. M ARCO EXPERIMENTAL
VRE (n) = (β + 1)iB (n)RE (n)
El diseño debe cumplir con las siguientes caracterís-
ticas: = VBB (n) − iB (n)RB (n) − VBE
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Fig. 1. Circuito 1
VBB (n) − VBE ∆vBE = 0.1 Volts, con lo que VRE min ∆vBE ≈ 0.1.
iB (n) =
RB (n) + (β + 1)RE (n) Luego VRE min > 10 ∗ 0.1 = 1 Volt. Luego:
Considerando que β 1 y RB (n) βRE (n), se 1 1
RE (n) > ≈ (5)
tiene que: IE (n) IC (n)
VBB (n) − VBE La Tabla I ilustra los valores obtenidos de la hoja de
iB (n) ≈
βRE (n) datos para el Transistor .
Como iC (n) = βiB (n): De acuerdo con esto, se busca que el amplificador
obtenga la mayor Excursión Simétrica a la salida de
VBB − VBE cada etapa n, es decir, que la señal no genere corte o
iC (n) ≈ (4)
RE (n) saturación en alguno de sus ciclos sobre el amplificador.
Asumiendo que RB (n) ≈ 0.1βmin RE (n). Por último, Para ello se debe cumplir los siguiente:
para evitar el punto de saturación, cuando vCE → 0, 1
VCE (2) = VCC
se determina un valor tal que la tensión complementaria 2
vRE pueda sobrellevar las variaciones de vBE en casos de Se asume que, para el punto de polarización en cada
variación de temperatura. Normalmente la variación del etapa:
voltaje de polarización en la juntura Base–Emisor es de ICQ (n) = 0.01ICmax
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vi (n) = rπ iB (n)
vo (n) β β
Av (n) = = − (Roeq (n)||ro ) ≈ − Roeq (n)
vi (n) rπ rπ
Finalmente, se varía la frecuencia de la fuente vs , uti-
VT lizando análisis AC Sweep. Del análisis, la frecuencia
rπ (n) = β
IC (n) de corte resulta ser igual a Hertz.
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TABLE II
C ALCULOS
Vs VBB (1) VCE (1) IC (1) VBB (2) VCE (2) IC (2)
0.1Vsmax
0.2Vsmax
0.3Vsmax
0.4Vsmax
0.5Vsmax
0.6Vsmax
0.7Vsmax
0.8Vsmax
0.9Vsmax
Vsmax
TABLE III
R ESULTADOS SIMULADOS . L AS MEDIDAS DE TENSIÓN V ESTÁN ENVOLTS , LAS MEDIDAS DE CORRIENTE I ESTÁN EN M A MPERES .
vs vBB (1) vCE (1) iC (1) vBB (2) vCE (2) iC (2) vL iL
max min max min max min max min max min max min max min max min
0.1Vsmax sin(ωt)
0.2Vsmax sin(ωt)
0.3Vsmax sin(ωt)
0.4Vsmax sin(ωt)
0.5Vsmax sin(ωt)
0.6Vsmax sin(ωt)
0.7Vsmax sin(ωt)
0.8Vsmax sin(ωt)
0.9Vsmax sin(ωt)
Vsmax sin(ωt)
TABLE IV
R ESULTADOS SIMULADOS . L AS MEDIDAS DE TENSIÓN V ESTÁN EN VOLTS , LAS MEDIDAS DE CORRIENTE I ESTÁN EN M A MPERES .
ω = 10 ∗ ωc .
Vs VBB (1) VCE (1) IC (1) VBB (2) VCE (2) IC (2)
0.1Vsmax
0.2Vsmax
0.3Vsmax
0.4Vsmax
0.5Vsmax
0.6Vsmax
0.7Vsmax
0.8Vsmax
0.9Vsmax
Vsmax
TABLE V
R ESULTADOS MEDIDOS . L AS MEDIDAS DE TENSIÓN V VOLTS , LAS MEDIDAS DE CORRIENTE I
ESTÁN EN ESTÁN EN M A MPERES .
. IV. C ONCLUSIONES
Los valores medidos (SI/NO) correspondieron
La realimentación dada por el resistor RE determina
con los parámetros de diseño porque
estabilidad de corriente, porque
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vs vBB (1) vCE (1) iC (1) vBB (2) vCE (2) iC (2) vL iL
max min max min max min max min min max
0.1Vsmax sin(ωt)
0.2Vsmax sin(ωt)
0.3Vsmax sin(ωt)
0.4Vsmax sin(ωt)
0.5Vsmax sin(ωt)
0.6Vsmax sin(ωt)
0.7Vsmax sin(ωt)
0.8Vsmax sin(ωt)
0.9Vsmax sin(ωt)
Vsmax sin(ωt)
TABLE VI
R ESULTADOS MEDIDOS . L AS MEDIDAS DE TENSIÓN V ESTÁN EN VOLTS , LAS MEDIDAS DE CORRIENTE I ESTÁN EN M A MPERES RMS.
ω = 10 ∗ ωc .
.
RL 20 log(vo (2)/vs )
≈ 0.1RL0
≈ 0.5RL0
≈ 2RL0 R EFERENCES
≈ 5RL0 [1] Najmabadi, F. Transistor amplifiers: Biasing and Small Signal
≈ 10RL0 Model. ECE65 Lecture Notes, Universidad de San Diego. 2006
≈ 20RL0 http://aries.ucsd.edu/NAJMABADI/CLASS/ECE65/06-W/
NOTES/BJT3.pdf
TABLE VIII [2] Najmabadi, F. BJT Amplifier Circuits. ECE65 Lecture Notes,
R ESULTADOS MEDIDOS . L AS MEDIDAS DE TENSIÓN v ESTÁN EN Universidad de San Diego. 2006
VOLTS RMS. PARA ESTE CASO , vs = 0.5Vsmax sin(10ωc t), Y RL0 http://aries.ucsd.edu/NAJMABADI/CLASS/ECE65/06-W/
ES LA RESISTENCIA DE CARGA DISEÑADA . NOTES/BJT3.pdf
[3] Departamento de Ingeniería Eléctrica e Informática, Insti-
tuto Tecnológico De Massachusetts, Cambridge, Massachusetts
02139, 6.101 Práctica introductoria de electrónica analógica
Práctica 4
. [4] Avendaño, L. E. (2007). Sistemas Electrónicos Analógicos: Un
Si se varía el valor de la carga RL , sucede lo siguiente: enfoque matricial. En L. E. Avendaño, Sistemas Electrónicos
Analógicos: Un enfoque matricial (págs. 94-112). Pereira, Ris-
aralda, Colombia: Universidad Tecnológica de Pereira.
.
Si vs > Vsmax , sucede lo siguiente:
.
Con respecto al análisis del circuito de la Figura 1, se