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O2
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O0
clk O0

O1

O2

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q1
q0 q1 q0
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clk

O1 O2 On-1
O0
Tn-2
& &
qn-2
q0 q1 q2 qn-1
1 T0 T1 1 T2 Tn-1

clk

O1 O2 On-1
O0

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Clear
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Ti

Oi

clk

Clear

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Cl i
0 qi
qi-1 Ti
& 1
Ti-1
Clear

Oi
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- + * - + , " 9

clk

Clear

Salida j j+1 0 1 2 3 4 5

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qi
Ti

Oi

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Cl i
0 qi
qi-1 Ti
& 1
Ti-1
qi
Preset

Oi

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, - + ;

qi qi
Ti Ti

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clk

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Cl i
0 0 qi
Otra Ti
funciones 1

INH

Oi

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: - 8 8 + 8

.+ , .+ - . * -

clk

INH

Salida 1 2 3 4 5 6 7

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E L I

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Load

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Cl i Pri
qi
Ti

Oi
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- * " 8 * * 4+ " 8
- + . 8 * : * 5*

clk

Load

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0 qi
Ti
1

Load

Oi

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clk

Load

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4+ - + + *
5 * " - * +. * 1
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clk
7 6 5 4 3 2 1 0 7
O0

O1

O2

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8 # $ %& 1 >8 +

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&
Ti-1
0
qi-1 Ti
& 1
Ti-1
qi
UP/DOWN

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 clk

Salida 1 2 3 4 5 6 7 0 1

CY

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clk

Salida 5 4 3 2 1 0 7 6 5

BW

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*+ .+ , .+

clk
0 1 2 3 4 5 6 7 0
O0

O1

O2

q0 q1 q2
1 T0 1 T1 1 T2

clk

O0 O1 O2

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clk

O0

O1

O2
3204

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0302
0100 00 01 11 10
modulo-16 Cl
00 1 1 x 1
O3 O2 O1 O0 01 1 1 x 0
11 1 1 x x
clk C.C. 10 1 1 x x
Cl

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4+ . 4+ - . > .+ ;

clk

Salida 6 7 8 9 0 1 2 3 4

Cl

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0302
0100 00 01 11 10
modulo-16 Cl
00 1 1 x 1
O3 O2 O1 O0 01 1 1 x 1
11 1 1 x x
clk C.C. 10 1 1 x 0
Cl
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clk

Salida 6 7 8 9 10 0 1 2 3 4

Cl

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/+ 7/ 0 '
 Init 1 1 1 1

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q0 q1 q2 q3
D0 D1 D2 D3

clk
O0 O1 O2 O3

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Init

clk

O0
O1
O2
O3

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O

Init

Cl Pr Cl Pr Cl Pr Cl Pr
q0 q1 q2 q3
D0 D1 D2 D3
q3

clk
O0 O1 O2 O3

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1 8 "
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Init

clk

O0
O1
O2
O3

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/+ 7/ 0 A
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- . - : * ,+ * "* 7
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Salida
Entrada serie
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D3 D2 D1 D0

clk

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- - 8 + + , * - - - "

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4+ + - + * *
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(>8 4+ 8 + " :8 - / *- + +
- +

/+ 7/ 0 M
 B0 ? ? ? ? Inicio

B1 B0 ? ? ? Despues del flanco

activo del primer ciclo
de clk

B2 Despues del flanco

B1 B0 ? ? activo del segundo ciclo
de clk

Despues del flanco

B3 B2 B1 B0 ? activo del tercer ciclo de
clk

Despues del flanco

B3 B2 B1 B0 activo del cuarto ciclo de
clk

+ - * * ? 4+ + 4+ -
- * * 8 (>8 - .5 ;8 4+ 4
5 * 8 - (> 8 + .
.+ , .+ + - + ;

? B3 B2 B1 B0 Primer ciclo de reloj

B0 Lectura del bit B 0

? ? B3 B2 B1 Segundo ciclo de clk

B1 Lectura del bit B 1

Tercer ciclo de clk

? ? ? B3 B2 Lectura del bit B 2
B2

Cuarto ciclo de clk

? ? ? ? B3 Lectura del bit B 2
B3

" 8- * 4+ . -
- + . - : * . - : *
:4+ + + , * * *1 4+ +
/+ 7/ 0 >
 + + :4+ .
> 8 84

"-* ! $ " ! "!*" ( &* . ! &"&

.+ , .+ *+ + + 1 + .
- ! / .+ 4+ - 8 + . - : *

Entrada
serie q3 q2 q1 q0
D3 D2 D1 D0

clk

O3 O2 O1 O0
Salida
paralelo

- * + * * 4+ - +
+ 8 " 4+ . - 6 ;- * +
8 *- -

"-* ! $ " ! . ! &"& ( &* "!*"

.+ , .+ + + + 1 + .
Entrada
paralelo
A3 A2 A1 A0
Load
C.C. C.C. C.C. C.C.

Cl Pr Cl Pr Cl Pr Cl Pr
D3 q3 D2 q2 D1 q1 D0 q0 Salida
serie

clk

Load A3
&

&

Cl Pr

/+ 7/ 0
 - * + .+ - 8 - 4+
4+ 8 +
.+ ? *- + 4+ . - : * + " *
/4+ * , - + 8 4+ : + 1 "

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4 , .+ . + - * . 8+
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- * . + ? 6 + + * 8
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,+ 8 /8 6 + 5 *
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G 3 - + + 4+
+ . 8 * - + * *

! . - -

.+ , .+ + + + + . - !

Entrada
paralelo

q3 q2 q1 q0
D3 D2 D1 D0

clk

O0 O1 O2 O3
Salida
paralelo

* " 8 - - - " ; +. -
- , + + - . 8 * * C *
/D G8 + 4+ - 4+ -+ 6
- - ,

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Clear
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S0

4
ROUT
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