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Imane HALKHAMS
Introduction
• La mémoire de l’ordinateur stocke les données et les instructions du programme en cours
d’exécution. Pour réaliser cette mémoire, des circuits sont utilisés dits circuits de
mémorisation. Pour mémoriser un bit (0 ou 1), il faut utiliser un circuit capable de se souvenir
de la valeur qu’il a enregistrée. Ces circuits sont appelés circuits séquentiels.
• A l’inverse des circuits combinatoires, la valeur de sortie d’un circuit séquentiel ne dépend pas
que des variables logiques d’entrée, mais dépend aussi de la valeur de sortie antérieure.
• Dans ce chapitre, on va étudier les éléments de base d’un circuit séquentiel et leurs
fonctionnements.
Définition d’un circuit séquentiel
• Un circuit séquentiel est composé d’un circuit combinatoire et d’éléments
mémoire appelés BASCULES.
Entrées Sorties
Circuit
combinatoire
Schéma d’un circuit séquentiel
Mémoire
Horloge
Introduction
• On distingue deux types de circuits séquentiels :
• Par contre, un circuit séquentiel asynchrone n’est pas une horloge. L’état d’un tel
circuit dépend de l’ordre d’apparition des signaux en entrée.
Introduction
• Dans un circuit séquentiel synchrone, l’état de la variable de sortie dépend
des signaux appliqués en entrée à des périodes de temps régulières. Ces
circuits utilisent généralement des horloges et sont, donc, appelés séquentiels
à horloge.
• Par contre, un circuit séquentiel asynchrone n’est pas une horloge. L’état d’un
tel circuit dépend de l’ordre d’apparition des signaux en entrée.
Les bascules
Les bascules
• Définition d’une bascule
• Exemple :
• Q : est la variable de sortie de la bascule. Elle fournit l’état de la bascule. Si Q=1, on dit que
l’état de la bascule est à 1. Sinon, l’état de la bascule est 0.
• Nom de la bascule : un nom est associé à chaque bascule. Il indique les entrées de la
bascule en question. On l’appelle ainsi « bascule bistable » car elle possède deux états
stables. C’est à dire deux états de sortie dans lesquels la bascule peut se maintenir
indéfiniment sans action extérieure.
Les bascules
✓ La bascule R-S
✓ La bascule J-K
✓ La bascule D
✓ La bascule T
La bascule R-S
• La bascule R-S est un circuit formé de deux portes logiques NOR(non ou)
ou NAND (non et).
• Ce circuit possède deux entrées et deux sorties :
• Les entrées :
✓S pour la mise à 1 de la bascule (marche)
✓R pour la mise à 0 de la bascule (arrêt)
• Les sorties :
✓𝑸
ഥ.
✓𝑸
La bascule R-S
• Le schéma de la bascule R-S est le suivant :
Technologie NON-OU
La bascule R-S
• Principe : la valeur de Q à t+1 dépend de R, S et de la valeur de Q à t:
La bascule RST (RSH)
• Bascule RS dans laquelle les entrées R et S ne sont prises en compte que
si elles sont en coïncidence avec un signal de commande
✔ bascule bloquée quand le signal de commande est à 0
• Si le signal de commande est fourni par une horloge :
➢bascule synchrone:
La bascule J-K
• La bascule J-K diffère de la bascule R-S du fait que quand les deux
variables d’entrée passent simultanément à 1 l’état de la bascule n’est
pas indéterminé.
• En effet, quand J=K=1, on obtient la fonction de complémentation
ത
Qt+1=𝑄𝑡.
La bascule J-K
• La bascule J-K est une bascule synchrone possédant deux entrées de commande :
✓L’entrée de l’enclenchement J qui joue le rôle de l’entrée S de la bascule RSH.
✓L’entrée de déclenchement K qui joue le rôle de l’entrée R de la bascule RSH.
• En absence du signal d’horloge, la bascule conserve l’état précédant de la sortie Q
(mémorisation).
• Pour la combinaison J=K=0, la bascule mémorise l’état de la sortie Q à chaque front
actif d’horloge.
• Lorsque J=K, la sortie Q recopie l’état de l’entrée J à chaque front actif d’horloge :
✓Pour la combinaison JK=10, La sortie Q est mise à 1 à chaque front actif d’horloge.
✓Pour la combinaison JK=01, La sortie Q est mise à 0 à chaque front actif d’horloge.
• A l'action simultanée sur J et K (J=K=1), la bascule change d'état à chaque front actif
d’horloge.
• La bascule JK permet donc de lever l’ambiguïté qui existe pour la combinaison S=R=1
de la bascule RSH.
Définition de bascule maître esclave:
• Le maître-esclave est une combinaison de deux bascules connectées en série, l'une agissant
en tant que maître et l'autre en tant qu'esclave. Chaque bascule est connectée à une
impulsion d'horloge complémentaire l'une de l'autre, c'est-à-dire que si l'impulsion d'horloge
est à l'état haut, la bascule maître est à l'état activé et la bascule esclave est à l'état
désactivé, et si l'impulsion d'horloge est à l'état bas, la bascule maître est à l'état désactivé et
la bascule esclave est à l'état activé.
• La bascule maître esclave est également appelée: Bascule déclenchée par impulsion car la
bascule peut être activée ou désactivée par une impulsion CLK pendant ce mode de
fonctionnement.
Définition de bascule maître esclave:
• Schéma de bascule maître-esclave:
• Supposons qu'à l'état initial Y=0 et Q=0,
l'entrée suivante soit Set=1 et Reset=0 ;
pendant cette transition, la bascule maître est
définie et Y=1, il n'y a pas de changement
dans la bascule esclave car la bascule esclave
est désactivée par l'impulsion d'horloge (CLK)
inversée, lorsque l'impulsion d'horloge du
maître passe à « 0 », puis l'information de Y
passe par esclave et Q=1, dans cette
impulsion d'horloge la bascule esclave est
active et les portes de la bascule maître
désactivées.
Définition de bascule maître esclave:
• Schéma de bascule maître-esclave:
• Supposons qu'à l'état initial Y=0 et Q=0,
l'entrée suivante soit Set=1 et Reset=0 ;
pendant cette transition, la bascule maître est
définie et Y=1, il n'y a pas de changement
dans la bascule esclave car la bascule esclave
est désactivée par l'impulsion d'horloge (CLK)
inversée, lorsque l'impulsion d'horloge du
maître passe à « 0 », puis l'information de Y
passe par esclave et Q=1, dans cette
impulsion d'horloge la bascule esclave est
active et les portes de la bascule maître
désactivées.
La bascule D
• Permet de générer un "retard" (delay) ou de stocker de l'information
(latch)
➢ en envoyant une donnée D sur l'entrée J et son inverse sur l'entrée K
➢ Un relâchement de D ➔ Mise à 0 de
Q
La bascule D
• Permet de générer un "retard" (delay) ou de stocker de l'information
(latch)
➢ en envoyant une donnée D sur l'entrée J et son inverse sur l'entrée K
➢ Un relâchement de D ➔ Mise à 0 de Q
La bascule D
• Permet de générer un "retard" (delay) ou de stocker de l'information
(latch)
➢ En envoyant une donnée D sur l'entrée J et son inverse sur l'entrée K
➢ On obtient une bascule D en rajoutant un inverseur entre S et R
➢ Un relâchement de D ➔ Mise à 0 de
Q
La bascule D sur front d’horloge
• La sortie recopie l’entrée à chaque front montant de l’horloge CLK.
La ligne de commande X
permet de sélectionner le
mode :
X=1 ⇒ compteur
Compteurs asynchrones
Compteur-décompteur asynchrone
• Compteur : déclenche chaque bascule quand celle de rang inférieur passe de 1 à 0
• Décompteur : il faut déclencher quand la bascule de rang inférieur passe de 0 à 1 en
utilisant la sortie Q.
ത
• Décompteur : en utilisant la sortie 𝑄.
La ligne de commande X
permet de sélectionner le
mode :
X=0 ⇒ compteur
Compteurs synchrones
• Toutes les bascules reçoivent en parallèle le même signal d'horloge.
• Les bascules sont associées entre elles, de telle manière pour la bascule du
rang i on applique toutes les sorties des bascules qui la précède aux entrées J
et K.
Les registres
Les registres
Définition:
Un registre est un dispositif qui permet de mémoriser une information et de la restituer
autant de fois que désiré.
En réunissant plusieurs bascules sur un même signal d'horloge, on peut fabriquer un
circuit qui constitue un registre, d'où la possibilité de construire des mémoires
Les registres
Définition:
Les registres sont les éléments de base des mémoires réalisées avec des
semiconducteurs. On peut se représenter un registre comme un ensemble de
mémoires élémentaires susceptibles de stocker chacune un bit.
L’entrée des informations dans un registre peut se faire soit en série (les unes après les
autres) soit en parallèle (toutes au même moment).
➢A chaque coup d'horloge, un nouveau bit est présenté et ceux déjà chargés sont
décalés d'un rang
Les registres
Définition:
La classification des modes de fonctionnement est la suivante :
• Des registres à entrées parallèles et sorties parallèles : PIPO (Parallel INParallel OUT).
• Des registres à entrées parallèles et sorties séries : PISO (Parallel IN-Serial OUT).
• Des registres à entrées séries et sorties parallèles : SIPO (Serial IN- Parallel OUT).
• Des registres à entrées séries et sorties séries : SISO (Serial IN- Serial OUT)
Les registres tampon (Registres parallèles)
Les registres tampon sont des registres de type parallèle-parallèle constitués de n
bascules de type D commandées par une même horloge (Voir figure).
Au signal d’horloge (impulsion sur CLK) les entrées Di sont recopiées sur les sorties
Qi . Une entrée asynchrone CLR permet, de façon prioritaire, d’effacer le contenu du
registre et d’écrire Qi = 0. Entre deux impulsions les sorties sont parfaitement isolées
des entrées.
Les registres à décalage à droite
Les registres à décalage sont des registres de type série-série ou série parallèle, dans
lesquels les informations sont décalées d’une bascule vers la suivante au rythme des
impulsions d’une horloge. Ils sont généralement réalisés avec des bascules RS de type
maître-esclave, ou des bascules D. Le schéma de principe d’un registre à décalage (vers
la droite) avec entrée série est présenté sur les figures suivantes (D et RS).