Regional Meta

Centro de Industria y servicios del META

MANTENIMIENTO ELECTRNICO E INSTRUMENTAL INDUSTRIAL

Teleinformtica 2011

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Fecha:

Sistema de Gestin de la Calidad

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Control del Documento

Nombre Autores Edinson Saenz Fidel Baquero Cargo Aprendiz Tema Dependencia Centro de Industria y servicios del META Firma FIRMA Fecha

SUMADOR RESTADOR BINARIO CON VISUALIZACIN DINMICA

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Introduccin

SUMADOR RESTADOR BINARIO A continuacin desarrollaremos el diseo de un circuito sumador restador binario con visualizacin dinmica en displays de 7 segmentos aplicando lgica binaria. Esperamos sea de su agrado y cumpla sus expectativas

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OBJETIVOS GENERAL. Disear un sumador restador binario con visualizacin dinmica en display de 7 segmentos ESPECIFICOS.

1. realizar la simulacin en el programa circuit Maker 2. Poner en prctica los conocimientos adquiridos en los diseos anteriores 3: Realizar el montaje del diseo en la protoboart

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Justificacin El sumador restador binario con visualizacin dinmica se presenta como un proyecto para poner en prctica los conocimientos adquiridos en cuanto a la conexin de diferentes componentes entre compuertas y como una oportunidad de conocer ms de la lgica binaria y la familia TTL

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MATERIALES 1. un dipswisch de 8 entradas y uno de 2 2. resistencias 8 1k una 220 Ohms 2- 330 Ohms 1- 70.1 k 1- 2.8 k 3. dos condensadores 4. dos transistores NPN 2222 5. 6 leds 6. dos display de nodo comn 7. cable UTP 8. compuertas 7447, 7408, 7486, 7404, 7432, 7408, 74244 9. una seal de reloj (555) 10. fuente de 5v 11. 4 protoboart 12. pinzas cortafros

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DIAGRAMA DE FLUJO
INICIO

INGRESAR

Resta
SUMA O RESTA

Resta

Suma A+B

Visualizacin Z

Complemento a 1 Z

HAY DESVOR DE

Z+1

Visualizacion

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COMPUERTAS

TRANSISTORES (NPN) 2222

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CONDENSADORES

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SIMULACIN EN CIRCUIT MAKER

L1

V+

V+

DISP3
A4 A3 A2 A1 B4 B3 B2 B1

DISP4
abcdefg.

74LS83
s4 s3 s2 s1

abcdefg.

Cin Cout

U30C 74LS83
s4 s3 s2 s1

A3 IA<B A2 IA=B A1 IA>B A0 B3 B2 A<B B1 A=B B0 A>B A4 A3 A2 A1 B4 B3 B2 B1

U1 74LS85 74LS85

V6 0V U25A U22D U7 74LS83

s4 s3 s2 s1

U17A

U22C

U12A U20C

Cin Cout

A3 IA<B A2 IA=B A1 IA>B A0 B3 B2 A<B B1 A=B B0 A>B

U3 74LS85 74LS85

A4 A3 A2 A1 B4 B3 B2 B1

U24B

Cin Cout

OEa Ia3 Ia2 Ia1 Ia0 OEb Ib3 Ib2 Ib1 Ib0

U16 74LS244
Ya3 Ya2 Ya1 Ya0 Yb3 Yb2 Yb1 Yb0

A3 A2 A1 A0

U27 74LS47

g f e d c b a

test RBI RBO

U22F

U30D

U13A V17 5V +V U11A U10A

U20D

A3 IA<B A2 IA=B A1 IA>B A0 B3 B2 A<B B1 A=B B0 A>B

U4 74LS85 74LS85

U30A U28 74LS83

s4 s3 s2 s1

U29A U20B

A4 A3 A2 A1 B4 B3 B2 B1

U24C U5A U24D U22E U30B

Cin Cout

U14A

U15A

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EVIDENCIAS

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Conclusiones

Despus de ver el resultado del montaje y el correcto funcionamiento del sumador restador podemos concluir que: a. Los clculos realizados fueron los correctos b. La simulacin el circuit Maker nos arrojo los posibles resultados exitosos c. Las conexiones realizadas se hicieron correctamente y sin errores de sobrecarga e impedancias d. Los componentes utilizados eran los correctos Tuvimos inconvenientes en cuanto a la realizacin pero pudimos superarlos con trabajo en equipo y sobre todo con mucha paciencia. Nos ayudo mucho realizar los montajes seccin por seccin y comprobando siempre el correcto funcionamiento

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