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ltimo valor est determinado por el parmetro RAS to CAS delay, y suele oscilar entre 2, 3 o 4 ciclos. Una vez que la columna est preparada se produce otro retardo hasta que los datos pueden ser ledos. Ahora la variable que nos interesa es CAS Latency Time (tambin conocida como CL), que en mdulos de tipo DDR asciende a 2, 2,5 o 3 ciclos. Una vez que los datos han sido ledos, la fila debe ser desactivada, tiempo definido en el parmetro RAS Precharge, que suele ascender a 2, 3 o 4 ciclos adicionales. Por ltimo debemos considerar el tiempo mnimo que debe permanecer activa una fila, indicado en la variable Active to Precharge Delay. Este suele oscilar entre 5 y 8 ciclos.