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Reparacin Xbox

Entrenamiento tcnico PCBA


V1.2.2
Seguridad elctrica

Los voltajes de alimentacin de la fuente son peligrosos si se expone a ellos.


Sea cuidadoso durante la reparacin porque los disipadores contienen 75Vdc
y pudieran estar calientes.
Quitarse la pulsera de ESD de la mueca durante l diagnostico siempre que
se aplique corriente a la consola.

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XBOX Desensamble/Ensamble de la
consola
Demostracin
Remueve el Cover 6 tornillos
Remueve el HDD 1 tornillo
Sea cuidadoso con el ruteo de la fuente
4 Tornillos adicionales sujetan al HDD
Remueve el DVD 2 tornillos
Ponga atencin al conductor de la fuente hacia la MB
Ten cuidado de no pellizcar los cables del ventilador
Remueve el panel de control frontal - Clips
Remueve el ventilador - Clips
Remueve la MB 11 tornillos
Remueve el PSU 2 tornillos
Remueve el puerto controlador 4 tornillos
Total # tornillos = 30

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XBOX Diagrama de conexiones de la consola

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Cdigos de diagnostico segn los LED
La Xbox tiene una capacidad de diagnstico que utiliza la secuencia
de colores que destellan los LED para indicar diferentes fallas.
En algunos casos, el ciclo diferir para indicar los problemas
diferentes.
Secuencia de los LED Descripcin de la falla
Destellando los LED en rojo OS defectuoso en la EEPROM
Destellando los LED en naranja Temperatura sobre el limite
superior
75% Verde, 25% Rojo Error en DVD
75% Rojo, 25% Verde Error en HDD
50% Verde, 50% Naranja No se detecta A/V Pack
50% Verde, 50% Rojo Error en Core Digital
50% Rojo, 50% Naranja Error en RAM

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Arquitectura del sistema
PowerSupply
Power Supply
System Management Controller

System Management Controller

Local
System
Voltage PSU
Regulators
System
System Memory
Management System Memory
Controller

RAM
System
System Temperature
Temperature
Fan
Fan Sensor
Sensor RAM
Audio Video
Interface
Audio/Visual
Interface Port
Port
Free
Front
Panel
Panel
IO
IO TV
TV
CPU North
NorthBridge
Bridge Encoder
Encoder
CPU And GPU
And GPU
(NV2A)
(NV2A)
System Clocking
AMP
GraphicsGraphics
Subsystem
Subsystem AMP
Clock
Generator
Audio
Digital DAC
Controller Audio
Audio
Interface
Controller Power DigitalUF DAC
Management
PortInterface Power Audio
Port Management

APU
APU
Controller
Audio Network Interface
Port
Controller Network Interface
Suite system
Audio
Port
Subscription Network
Ethernet
PHY
Ethernet Network Port
PHY Port
Core Logic
Controller
Core(MCPX)
Logic
PortController
(MCPX)
Port LPC
LPCHeader
External Debug Header
ROM
External LPC
Controller Debug
ROM
LPC
Port Controller
Port

Controller DVD Hard


Port Controller Drive HardDisk
Port DVD Disk Drive
Drive Drive

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CPU
El CPU de la Xbox es una variante del Intel PIII basado en el
Coppermine CPU

Caractersticas de CPU:
MMX y SSE instruction set enhancements
Reloj interno de 733MHz
133MHz del bus frontal
32k L1 Cache
128k Full-speed L2 Cache integrated on-die
BGA-2 package

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Introduccin al subsistema de grficos
Consiste de un alto - direccionador y controlador de memoria con
un avanzado procesador de grficos y una interfase de video digital
al encoder de la televisin.
El encoder de la televisin incluye escala digital y un encoder lgico
as como convertidores digitales a analgicos para producir seales
de televisin NTSC/PAL/SECAM y seales compuestas YPrPb
HDTV
La funcionalidad del north bridge (NV2X) esta integrada con el
procesador de grficos para implementar la Arquitectura de
Memoria Unificada (UMA)
El North Bridge consiste de un controlador de memoria, una
interfase P6 del bus frontal, una interfase LDT, y una unidad
arbitraria para dirigir transacciones para el CPU, GPU, LDT y buses
de memoria.
La interfase LDT es usada como puente entre el chip core logic
conteniendo la el ancho de banda bajo de las funciones lgicas del
bus ATA, USB, XROM y el APU.

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NV2A North Bridge y GPU
El NV2A es un integrado controlador de memoria y una unidad controladora de grficos
Contiene
Cuatro controladores de memoria independientes para el sistema de memoria unificada
6 interfases frontales hacia el CPU.
Bus de interfase LDT para el core logic
Unidad procesadora de grficos
Unidad de manejo de memoria y transferencia de datos en el bus interno.

Memory Memory Memory Memory


Controller Controller Controller Controller

Arbitration Unit

Clock
Gen

Scalar Color Space


Converter
Interface
Graphics

Digital
P6 LDT
Processing
Interface Interface
Unit

Control and
Configuration Logic

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Media Communications Processor - MCPX

Contiene todas las funciones del core logic :


Procesador de audio y controlador de interfase
Controlador de disco duro
Controlador de DVD
Controlador USB
Funciones de apoyo al sistema Gen de reloj, RTC, Bus SM
Conecta a el GPU a travs del bus LDT que provee
800MB/s de transferencia
El bus LDT consiste de dos links, uno sirviendo de
transferencia del NV2A al MCPX, y el otro sirviendo de
transferencia del MCPX al NV2A.

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Memoria

Xbox utiliza una arquitectura de memoria (UMA Unified


Memory Architecture) para consolidar la RAM y la RAM
de video en un solo cubo de memoria.
Un avanzado controlador de memoria y el bus de
transferencia hace el puente entre el bus del CPU, el
bus del GPU y el bus LDT Previendo un acceso de alta
velocidad hacia la memoria unificada.
El sistema usa DDR SDRAM (Double Data Rate
Synchronous Dynamic Random Access Memory). La
DDR SDRAM transfiere palabras de datos sosteniendo
400MHz, usando los 200MHz del reloj de la memoria.

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Ciclo de buteo Power-on

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Diagrama de bloques del sistema

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Diagrama del System Reset

POWERON (from SMC)

5V (from Power Supply)

3.3V (from Power Supply)

12V (from Power Supply)

POWOK (from Power Supply)

SYSRESET# (from SMC)

PCI_RESET# (from MCPX)

CPU_RST# (from NV2A)


Clock Gen outputs (and
CPU_CLKOUT from NV2A)
1msec delay in
1msec 1msec NV2A During 1msec
min spec delay in This time, the delay in
for MCPX MCPX NV2A will fetch NV2A
(PIC code The first data
must from the
guarantee External ROM
this) (PLL settings,
slew rates,
Skew timings,
Microsoft Confidential Drive strengths,
etc.)
Convenciones del esquemtico
El esquemtico de la tarjeta principal de la Xbox usa el
standard de Intel para componentes integrados
referencia/localizacin designados:
Este mtodo integrado se compone de referencias (i.e. R1, U1,
etc.) con la localizacin de los cuadrantes de cada componente
en la MB.
El formato de designacin es como el siguiente:
Referencia

R3B1

MB Localizacin del cuadrante

R3B1 es Res 1 de n
Resistencias en el cuadrante 3B
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Layout de los cuadrantes de la PCB

Designacin de los cuadrantes cerca del permetro de la MB

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Convenciones del esquemtico
(continuacin)

Los conectores de paginas


identifican la asociacion de
paginas para cada lnea de
seal
Los puntos de prueba estn
anotados como
PROBE_POINT
Los componentes que no
estn en la versin de la MB
estn anotados como EMPTY
Designaciones de la fuente de
alimentacin:
V_2P5 = 2.5V supply

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Lado de Top de la MB Memoria y Conectores
LAN AVIP
Case Fan

NV2A Fan

Memoria 4 Localidades
IDE de cada lado
2 Localidades
faltantes en
cada lado

LPC Empty

MB S/N Label

Power
Supply

Front Panel

Game 3&4 Game 1&2

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Componentes crticos de la MB Lado de Top
Audio Amp Audio Pop TV Encoder
Audio CODEC Fan Dif Amp
U3B1

LAN Audio 9v Reg


1.5V Lin Reg
U3B2
SMC

27 MHz
Crystal
EEPROM

CPU
Kernel

Clock Gen
NV2A
CPU Clock
Buffer

32.768 KHz
Crystal
MCPX
FET V_CPUCORE
1.5V Sw Reg Sw Reg
U8E1 FET (2) 1.25V Q1F1
Sw Reg
FET 1.5V Sw Thermal Sensor Q4G1
Reg U6F1
Q7F1

Backup-Cap Controller
C7G10 1.25V Sw Reg OC Protect
2.5V Lin Reg U4G1
Microsoft Confidential U5G1
Componentes crticos de la MB Lado de Bottom
Audio Vreg
Fan Driver & Bias AVIP OC
Q3N1 Protect

Memoria

Not stuffed

CPU VReg
DC-DC Cvrtr

FET Q2U1
V_CPUCORE
Controller
Dual Rect
OC Protect
U8U1

LED Drive
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System Management Controller
El System Management Controller
(SMC) es un microcontrolador de POWSW SYS RESET

severa importancia en el sistema FRONT PANEL


EJTSW SMI

El SMC esta siempre alimentado por IO SUBASSY LED 1


CPU

un voltaje de salida de la fuente de INTERFACE

alimentacin (3VSB) LED 2 SCL

El SMC se comunica con el CPU SDA

mediante el System Management Bus


(SMBus)
FAN FANPWM
CONTROL
DVD EJECT

Las obligaciones del SMC incluyen las


siguientes actividades: TRAY STATE O

DVD
Controlas la fuente de alimentacin POWOK TRAY STATE 1 CONTROL
INTERFACE

RESET POWER
POWON TRAY STATE 2

Monitorear la temperatura y el SUPPLY


3VSB ACTIVITY

ventilador VSS
Monitorear las IO del panel frontal
Monitorear el AVIP Mode V MODE O

Controlar el DVD SMCRESET V MODE 1 AVIP

XTAL OUT V MODE 2


RESET &
CLOCK OSC
XTAL IN

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Pines del SMC

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Monitoreo de temperatura SMC
El SMC monitorea la temperatura del CPU y la temperatura del aire
interno en una ubicacin del chasis
La temperatura sensada es implementada para el uso de un IC
dedicado a sensar la temperatura, la referencia en la MB es U6F1
Este IC mide la temperatura del dado del CPU conectando al diodo
sensor de temperatura y tambin puede medir su propia
temperatura utilizando un diodo sensor de temperatura interna

SCK
SM Bus
Interface ADC
SDA
CPU Temperature
Sense Junction

Internal
Temperature
Sensor
MUX

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Controlador del ventilador SMC
El SMC monitorea la temperatura y controla
la velocidad del ventilador en acuerdo con
las mediciones de temperatura.
El SMC compara las lecturas de
temperatura (promedio) por tres setpoints
Dos setpoints son usados para histresis y
le dir al SMC que incremente o
decremento la velocidad del ventilador
El tercer setpoint es para la sobre
temperatura
En una condicin de sobre temperatura, el
SMC inmediatamente pone a restablecer
todo el sistema, prende el ventilador a su
mxima velocidad, destellan los LEDs en
naranja para indicar sobretemperatura,
espera hasta que el sitema regresa a un
rango de operacion seguro, y entonces se
apaga
La velocidad del ventilador es realizada por
la modulacin de un pulso

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SMC Fan PWM Waveforms

Fan PWM Hot Temp U7B2.13 Fan PWM Normal Temp U7B2.13

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Control del panel frontal I/O SMC
El SMC es responsable de
manejar los LED indicadores
del panel frontal
El indicador esta
implementado como un LED
bicolor rojo/verde, el cual es
capaz de estar iluminando en
ROJO, VERDE, o NARANJA
(rojo/verde)

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Puerto de interface Audio/Video SMC
El SMC monitorea las entradas AVIP MODE y notificara al CPU
(mediante SMI) siempre que un nuevo AV Pack es detectado
El SMC no reconocer como un cambio la transicin hacia el
estado NO PACK, solo reconocer cambios entre diferentes
configuraciones

Control de bandeja del DVD SMC


El SMC es responsable de monitorear el estado de la bandeja del DVD
El SMC debe ser capas de sacar la bandeja del DVD (independiente
del CPU)
El SMC debe monitorear en cualquier momento un nuevo CD o DVD
localizado en el drive
En cualquier tiempo el SMC detecta que la bandeja del DVD ha sido
abierta o cerrada, esto ser notificado al CPU (mediante SMI)

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Arquitectura del sistema de relojes
27 Mhz Crystal
1 2

U2D1
U7C1
Buffered by
U3R1
17
13
24.5MHz 56 63
U4B1
14
U3C1
U6N1
U6B2 12
U6D1
U6R1
8
7 4
U6B1

U6E1
34 10
25MHz
47 Note: FOUT4 runs
U7B1
37 Even when Clock
Synth Is disabled

11
9
U7B2

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DVD-ROM
El DVD drive no esta diseado para ser capaz de leer CD-Regrabables (CD-R)
La lnea de control de la bandeja abierta o cerrada es manejada por el SMC en
acuerdo con el usuario mediante el switch EJECT, y el estado maquina del SMC
El DVD Drive interconecta al CPU atraves de una interfase AT-Attachment (ATA)
compartida con el HDD.
El DVD esta configurado como un dispositivo esclavo, el HDD esta configurado como
el maestro
La interfase ATA opera en el modo UDMA-33
El drive opera en Velocidad Angular Constante (CAV) en ambos formatos CD y DVD
La operacin de CAV produce velocidades en el rango de 2-4.8x para 12cm DVD, y
6.4 to 16x para 12cm CD
El software controla velocidades de 1000, 2000 y 3000 RPMs
El drive contiene un actuador manual de la bandeja, accesible mediante un orificio en
el panel frontal, para reactivar el mecanismo de la bandeja en caso que el drive falle
La bandeja automticamente se cierra cuando la empujas manualmente

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DVD-ROM (continuacin)
La alimentacin de 12VDC y la interfase de control/status estn
implementadas en un conector secundario multi-pin
La interfase incluye las siguientes seales (Nota: la direccin de las
seales estn con respecto a el drive)

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Diagrama de los estados de la bandeja
del DVD

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Hard Disk Drive

2 Tipos usados durante la manufactura


Seagate
Western Digital
Capacidad de 8GB
Configurado como CS (Cable Select) en el puerto IDE
Los pines de alimentacin del conector son los
siguientes:

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Network Interface
10Mbps (IEEE 802.3) y 100Mbps (IEEE 802.3u) con Auto
Negociacin
Voltaje de alimentacin de 3.3V e interfase
Deteccin automtica de polaridad y correccin del canal RX
Operacin Full-Duplex
Media Independent Interface (MII) para el fcil acceso a 10/100
Media Access Controllers (MACs)
Conector:
Dos LEDs, uno en cada lado, estan integrados en el cuerpo del conector
El LED verde, visible a la izquierda del conector, es iluminado cuando es
establecida una conexin de red, y parpadeara cuando hay actividad en
la lnea
El LED amarillo, visible a la derecha del conector, es iluminado si la
comunicacin es establecida a 100Mbps y no se iluminara si se conecta
a 10Mbps

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Audio/Video Interface Port - AVIP
Todas las seales de audio y video estan en un solo conector AV de 24
pines referido en la parte inferior como conector AVIP
El AVIP da las cuatro salidas de video, la seal de estado para el SCART,
salidas de audio stereo, salidas de audio digital SP-DIF, y las entradas del
VMODE
Un AV pack es conectado a el AVIP para frenar las seales de salida para la
interconexin a la TV y/o al sistema de audio
Para afirmar los estados de las entradas de control, un AV pack identifica
que tipo de seal de televisin podria ser generada, y si la salida de audio
es stereo o mono
Los 24 pines estan organizados en 2 hileras de 12 conductores como se
muestra en la figura de la parte inferior

AVIP Connector

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AVIP (continuacin)

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AVIP Modo de seleccin de entradas
El AVIP apoya varias configuraciones de rendimiento
La entrada MODE a el AVIP provee la identificacin del tipo de seal
esperada por el AV Pack
El modo de salida es identificado por cables entre el modo de seleccin de
pines (MODE1, MODE2, y MODE3) y pines GND en el conector AVIP como
se muestra en la tabla siguiente
El estado de estas entradas son continuamente monitoreadas por el SMC y
comunicadas al OS de la Xbox

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AVIP - Video Outputs
Las salidas de video anlogo estn manejadas por un encoder de
televisin, el cual es manejado por la interfase de video digital del
GPU
El encoder de televisin convierte el video digital al compuesto
NTSC/PAL, s-Video, RGB, HDTV
El encoder de TV tiene salidas DAC. Estas cuatro salidas estn
multiplexadas entre los tres principales modos de operacin
SDTV Standard Definition TV
SCART European Standard TV
HDTV High Definition TV
En el modo SDTV, los DACs tienen salidas CVBS, Y, y C para
soportar salidas compuestas y s-Video
En el modo SCART, los DACs tienen salidas CVBS, y RGB seales
compuestas
En el modo HDTV, los DACs tienen salidas Y, Pr, y seales Pb

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Salida de video AVIP SDTV
El modo SDTV incluye dos salidas de video: compuesto (CVBS) y s-Video (Y/C). Las CVBS, Y, y
C son seales de salidas simultaneas o pines individuales del conector AVIP, cada una es capaz
de manejar una lnea de transmisin
El DAC D del encoder de la TV es dedicado para la salida CVBS, y entonces es acompaado
por un filtro que esta implementado directamente en la MB
El NTSC, PAL, o SCART AV Packs solamente soportan salidas de video compuestas, estas
pueden ser implementadas por un simple cable
El AV Packs refuerza el s-Video, y entonces requiere salidas Y y C en conjunto a la salida CVBS
Las salidas Y y C para s-Video utilizan las mismas salidas del DAC como tambin dos de las
seales de HDTV, y entonces, los filtros de estas salidas estn implementados en el AV Pack de
la PCBA, y estn en cascada con los filtros de HDTV implementados en la MB

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Puertos de los controles
Los puertos de los controles proveen alimentacin de DC, un bus de
comunicacin digital bi-direccional, y una seal de video sincronizada para
apoyar a los perifericos que utilizan CRT
El conector mecanico que es usado para el control es un diseo para la
Xbox, pero es basado en la especificaciones electricas del conector USB
del tipo A especificado en el Universal Serial Bus Specification, Version 1.1.
Un quinto conductor es aderido a la salida de la seal de video sync
La proteccin de sobrecorriente es proveen los termistores RT2V1, RT3V1,
RT3G1, RT3V2

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Controller Port MB Connector
Este conector radica en la MB y apoya la conexin fsica para los
puertos controladores en el panel frontal
Hay dos conectores fsicos:
J1G1 para los puertos 1 y 2
J4G1 para los puertos 3 y 4
Ambos conectores tienen los mismos pines de salida como se
muestran a continuacin

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Conector del panel frontal de la MB
Este conector soporta el panel frontal que contiene el switch de
encendido, switch eject del DVD y los LEDs
La referencia del conector en la MB es J2G2

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Power Supply Unit (PSU)
La fuente de alimentacin esta formada por tres bloques funcionales:
Una Power Supply Unit (PSU) provee las conversiones de la linea de
entrada de AC para regularla a voltajes de DC
La regulacin local en la MB convierte las salidas de la PSU para los
voltajes crticos de alimentacin requeridos por el CPU, GPU, y las
memorias DDR. Otros reguladores proveen alimentacin anloga para
las secciones de audio y video
Un sper-cap provee alimentacin para mantener el tiempo real del reloj
y el contenido de la NVRAM cuando la linea de alimentacin es
desconectada
El apagado de la PSU es controlada por el System Management
Controller
La PSU debe mandar un voltaje pequeo a el SMC todo el tiempo,
esta salida es referida como 3VSB en el diagrama a bloques
La PSU esta activada todo el tiempo, siempre y cuando la fuente
este conectada a AC, la fuente provee alimentacin al SMC y al
RTC/NVRAM

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Conector de la fuente de alimentacin

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Diagrama de bloques de la fuente de alimentacin
Linear Regulator To Analog Audio
Vout = 9v Notes:
U5B1.2
1. 3VSB Standby voltage is always present,
even when system is off.
2. 3VSB powers the SMC and the RTC backup
Linear Regulator To DDR Memory cap.
Vout =2.5v DB6F1 3. System PSU provides standard supply
voltages and on-board regulators supply
others needed.
Linear Regulator 4. SMC sends the POWON signal to the PSU
To AGTL Termination and receives acknowledgement back from
Vout = 1.5v
DB3B1 PSU (POWOK) when all PSU supplys are
settled.

Local Switch
Mode Reg To DDR Vtt
Vout = 1.25v DB3F1

Local Switch
Mode Reg To CPU Vcore
Vout = 1.75v DB3E1

System Local Switch


PSU Mode Reg To NV2A/MCPX Vcore
Vout = 1. 5v DB8E1
1
2 To System
5
7
6 System
12 Management
Controller
11

Measure at Power
Connector on MB Super Cap
RTC/NVRAM To RTC
And charge
Backup DB6F2
circuit
Super Cap
C7G9

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Control del ventilador
El ventilador esta conectado mediante un conector de tres pines
dando el pulso modulado de 12VDC
El control de velocidad del ventilador es por medio del bucle que
controla el voltaje aplicado mediante el pulso modulado
El conector es un conector de tres pines, pero el pin 1 y 3 son
idnticos, permitiendo conectarlo de cualquier forma sin que tenga
impacto en el funcionamiento del ventilador

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