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a b c
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Circuits combinatoires Circuits arithmétiques Circuits combinatoires Circuits arithmétiques
& S2 S0 a b c S
S1
S2 0 0 0 0
& S3 S3
E E DMUX S4
0 0 1 0
& S4 S5 0 1 0 0
S6
S7 0 1 1 1 1 DMUX
& S5
1 0 0 0
>1 S
& S6
a b c 1 0 1 1
1 1 0 1
& S7 1 1 1 1
a b c
a b c
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Circuits combinatoires Circuits arithmétiques Circuits combinatoires Circuits arithmétiques
& S3 S3
a b c S0 S1 S2 S3 S4 S5 S6 S7 DEC S4
S5
0 0 0 1 0 0 0 0 0 0 0 & S4
S6
S7
0 0 1 0 1 0 0 0 0 0 0 S5
&
0 1 0 0 0 1 0 0 0 0 0
a b c
0 1 1 0 0 0 1 0 0 0 0 & S6
1 0 0 0 0 0 0 1 0 0 0
& S7
1 0 1 0 0 0 0 0 1 0 0
1 1 0 0 0 0 0 0 0 1 0
1 1 1 0 0 0 0 0 0 0 1 Démultiplexeur avec E=1.
a b c
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Circuits combinatoires Circuits arithmétiques Circuits combinatoires Circuits arithmétiques
a b S
0
0
0
1
E0 ET E1
E0 OU E1
E0 E1
&
Circuits arithmétiques
&
1 0 E0 XOR E1
1 1 NON E0 >1
&
>1 S
=1 &
&
DEC
a b
1 0 1 0 1 0 0 1 0 >1
&
1 1 0 1 1 0 1 0 1 &
1 1 0 0 1
1 1 1 1 1 Cout : 1 s’il y a une retenue.
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Circuits combinatoires Circuits arithmétiques Circuits combinatoires Circuits arithmétiques
Pour 2 bits d’entrée, l’UAL est un circuit qui a peut d’intérêt... INV A
S
Mais, en connectant judicieusement les retenues de n UAL, on A
Entrées : EN A UAL
obtient une une UAL n bits, telle que :
A et B : les variables (données) B
EN B
Cout
les opérations logiques sont des opérations bit à bit F0 et F1 : bits de choix du signal d’activation
F F
les opérations arithmétiques sont effectuées sur des entiers Cin : retenue entrante 0 1
Cin
Sortie :
Cin Cin Cin Cin
S : résultat de l’opération
A S A S A S A S Cout : retenue de sortie
B UAL B UAL B UAL B UAL
F F
Cout
F F
Cout
F F
Cout
F F
Cout Cout Rôle : Faire l’une des 4 opérations (ou des variantes) :
0 1 0 1 0 1 0 1
A ET B, A OU B, B, A + B + Cin ,
en fonction des bits d’activation choisis.
S S S S3
0 1 2
&
A et B 0 0 1 1 0 0 A ET B
INV A &
A
>1 S 0 1 1 1 0 0 A OU B
=1 & A ou B
EN A
& >1
& 0 1 0 0 0 0 0
B B >1 0 1 0 1 0 0 B
&
& 0 1 1 0 0 0 A
Somme
EN B
&
0 1 1 0 1 0 A
=1
=1
& 1 0 1 1 0 0 B
Decodeur 1 1 1 1 0 0 A+B
& 1 1 0 0 0 1 1
& 1 1 0 0 1 0 -1
Lignes d’activation
>1
& C out
1 1 0 1 0 1 B+1
&
1 1 0 1 1 0 B−1
& Additionneur complet
1 1 1 0 0 1 A+1
&
1 1 1 0 1 1 −A
1 1 1 1 0 1 A+B+1
F0F1 1 1 1 1 1 1 B−A
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