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Valentin Gies
Plan du cours
Introduction Processeurs et mcatronique Architecture des processeurs Von Neumann Harvard Applications
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Valentin Gies
Un march gigantesque : 1 % des processeurs sont destins des ordinateurs, les autres sont destins au contrle numrique dapplications spciques.
Valentin Gies ES 206 : Systmes mcatroniques asservis
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x [n i ]
Commande des actionneurs : Gnration de consignes de type PWM (rapport cyclique variable) Pilotage Instructions de haut niveau smantique + analyse des capteurs extroceptifs (camra)
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Systme embarqu
Low power. Nombre de circuits distincts limit (viter les cables).
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DSP : Digital Signal Processor ASIP : Application Specic Instruction Set Processor ASIC : Application Specic Integrated Circuit
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DSP :
Inconvnients : perf limites pour le moyen-haut niveau. Atouts : trs performant pour le calcul scalaire (bas niveau), low power, grand nombre dentre sortie fort dbit.
Micro-contrleurs
Inconvnients : perf limites pour le bas et haut niveau. Atouts : efcace pour le moyen niveau (rglage dynamique des paramtres dun asservissement par exemple).
Processeur classiques
Inconvnients : trop cher, difcile intgrer, forte consommation et forte dissipation dnergie. Atouts : versatile (mais quel prix !)
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Micro-contrleurs
Asservissement : Contrle de variables faible dbit de donnes. Pilotage : Gestion dun automate de pilotage... Commande des actionneurs : gnration des signaux de sortie temps rel (PWM laide de fonctionnalits ddies).
Processeur classiques
Algorithmique de haut-niveau : traitement dimage, intelligence articielle...
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1 mmoire : programme et donnes Accs squentiel aux donnes et au programme. Trs facile programmer : pas de prcaution ncessaires.
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Possibilit dutiliser la mmoire programme comme 2e mmoire de donnes (utile pour les oprations type produit scalaire). university-logo
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1 bus de donnes codage des donnes prcis (souvent en virgule ottante). ALU (Arithmetical and Logic Unit) classique : oprateurs addition, opration boolennes. university-logo Accs squentiel aux port E/S Dbit limit !
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Le DSP (Harvard)
2 (ou plus) bus de donnes codage des donnes moins prcis (souvent en virgule xe). ALU tendue : MAC (Multiplicator and ACcumulator) et Barrel Shifter (dcaleur barillet). university-logo Entres-sortie haut dbit : DMA (Direct Memory Access)
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DSP : calculs scalaires trs performants MAC + Dcaleur barrillet + 2 accs mmoire simultans y = y + x1 z1 est ralis en 1 cycle au lieu de 10 sur university-logo un micro-contrleur.
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