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Florence.vadee@wanadoo.fr : 01 45 14 28 28 : 01 48 73 63 15
Electronique numrique
tude, adaptation et conception De circuits de commande en technologie numrique cble
Objectif
Raliser un circuit de commande en technologie numrique partie dun cahier de charges
Pr-requis
Bases dautomatisme du rfrentiel F3
Savoirs associs
Bascules, compteurs, multiplexeurs, convertisseurs et mmoires Technologies TTL et C MOS
Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne
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Sommaire
I. Introduction
1. Reprsentation analogique dune grandeur 2. Reprsentation numrique dune grandeur
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I.
Introduction
Dans les sciences, dans les techniques, dans les affaires, et dans la plupart des domaines nous sommes amens utiliser des grandeurs. Ces grandeurs sont mesures, surveilles, enregistres, transformes mathmatiquement, observes et exploites de diverses faons dans des systmes rels diffrents. Il est important lorsqu'on travaille avec diverses grandeurs d'tre en mesure de reprsenter correctement et prcisment leurs valeurs. Il y a fondamentalement deux manires de reprsenter la valeur dune grandeur : la manire analogique et la manire numrique.
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II.
Le Produit logique
a b 0 1 0 0 0 1 0 1
La complmentarit
a 1 0 a 0 1
a + b = a. b a. b = a + b
0 1
0 1
a. b
OU Norme US Norme CEE
a +b
ET
a b NON
1
NOR
&
NAND
1
XOR
Norme US
Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Norme CEE
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&
=1
Dans un tableau trois entres (a, b et c) et une sortie (f) on place les tats dpendant du cahier des charges : la sortie f est 1 si ce qui donne le tableau ci-dessous. Les entres a b c sont l'tat logique 0 simultanment
a 0 0 0 0 1 1 1 1
b 0 0 1 1 0 0 1 1
c 0 1 0 1 0 1 0 1
f 1 1 1 0 0 1 0 0
a 0 0 0 0 1 1 1 1
b 0 0 1 1 0 0 1 1
c 0 1 0 1 0 1 0 1
f 1 1 1 0 0 1 0 0
5
f = a .b.c f = a .b .c
f = a .b.c
f =ab c
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On cherche dans le tableau les tats o f est 1 puis on regarde la combinaison des entres permettant cet tat. Sil y a un 1 sous la variable on prend cette variable, par contre sil y a un 0 on prend le complment de cette variable. Les diffrentes variables doivent tre positionnes ensembles ce qui se traduit par un ET entre les diffrentes variables. Par contre la sortie f est 1 pour quatre combinaisons des variables dentres. On reliera donc les quatre quations par un OU entre les diffrents groupements. Ceci donne lquation suivante :
f = a . b. c + a . b. c + a . b. c + a. b. c
C. Ralisation l'aide de portes logiques : Il est alors possible de raliser cette fonction l'aide de portes :
A 1 7404 2 1 2 13 7411 4 7404 3 4 5 7411 9 10 11 6 7404 1 2 13 7411 7411 12 8 9 10 7432 6 12 1 2 7432
3 9 10 8 7432 8 F
D. Simplification mathmatique de l'quation Le type de ralisation prcdant ncessite un nombre important de portes logiques, alors que la fonction f peut tre simplifie mathmatiquement en utilisant les proprits de lalgbre binaire :
f = a . b. c + a . b. c + a . b. c + a. b. c f = a . c.( b + b) + b. c.( a + a )
Ce qui nous conduit une ralisation plus simple :
A 1 7404 2 1 2 4 7404 4 5 C 5 7404 6 7408 7408
f = a . c + b. c
3 1 2 6 7432 3 F
E. Simplification de lquation par tableau de KARNAUGH La mthode de KARNAUGH permet la simplification des quations bc 00 01 11 10 logiques pour des systmes comportants jusqu' 5 entres. On trace un a tableau o chaque case correspond une combinaison logique des 0 1 1 0 1 entrs, et o l'on passe d'une colonne ou d'une ligne l'autre en ne 1 0 1 0 0 modifiant qu'une variable d'entre. On remplit alors le tableau l'aide de la table de vrit, puis on regroupe les cases contigus par multiple de 2n (1, 2, 4, 8) contenant la valeur de sortie "1". On ne retient alors f = a . c + b. c que la somme des produits de variables correspondant aux variables
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d'entrs ne changeant pas dtat. Lquation obtenue est la mme que celle dj obtenue audessus.
Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Autres exemples :
ab cd 00 0 0 0 1 01 0 0 1 0 11 1 1 1 0 10 1 1 0 0 ab cd 00 1 0 1 1 01 0 0 1 1
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11 0 0 1 1
10 1 0 1 1
00 01 11 10
00 01 11 10
f = a. b. c. d + a. b. d + a . c
f = a + b. d
F. Alas de propagation Il arrive malheureusement qu'une simplification trop pousse entrane des erreurs de fonctionnement nommes ALEA DE PROPAGATION.
b 1 2 7408 4 5
a
3 1 2 6 7432 3 F
3 7404
a*
a*
tp
Un tel ALEA se produit lorsque, dans un tableau de KARNAUGH, deux regroupements ont des cases adjacentes. Il peut alors tre ncessaire de raliser des regroupements redondants.
a bc 0 1 00 0 0 01 0 1 11 1 1 10 1 0
G. Ecriture dune quation en vue de sa ralisation avec un seul type de fonction logique Pratiquement on cherche souvent raliser la synthse dun systme NAND (ET NON) logique avec un seul type de fonction logique (dans lexemple qui suit des portes NAND 2 entres). Il faut donc faire apparatre a lquation sous une forme directement transposable en schma. & s b Cest lquation de dpart. f = a .c + b .c
f = a .c + b .c f = a .c + b .c
Deux complmentations ne changent pas lquation mais font apparatre une forme directement exploitable.
s= a . b = a
+ b
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f = a .c + b .c f = a + c + b .c f =a+c+b+c f =a+c+b+c
Cette forme quivalente lquation de dpart (deux complmentations sannulant) fait apparatre le schma de ralisation ci-dessous.
f= a.c . b.c
f= a+c + b+c c
& &
a.c
Cest lquation de dpart. Une modification dcriture en utilisant le a thorme de De Morgan. b La mme chose en ayant pris soin de complmenter c deux fois auparavant. s= a Pour terminer une double complmentation de lensemble pour faire apparatre la forme standard.
a b c
a bc >1
a b c
a+c b+c
& &
a.c . b.c
& b.c
&
>1 s
+ b
= a .b
a+c + b+c
>1 >1
>1
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III.
1. Paramtres technologiques
Tension Vcc GND Vdd Vss Vi Vil Vih Vo Vol Voh Vth Vth+ VthVh Courant Icc Ii Iil Iih Io Iol Ioh Ios Iozl Iozh Divers Ta Ron Cx Rx Z Ptot Temprature ambiante Rsistance d'une porte analogique Capacit extrieure Rsistance extrieure Etat haute impdance Puissance dissipe Tension d'alimentation positive (5V TTL) Masse Tension d'alimentation positive (C MOS) Masse (C MOS) Tension d'entre Tension d'entre l'tat bas Tension d'entre l'tat haut Tension de sortie Tension de sortie tat bas Tension de sortie tat haut Tension de seuil Tension de seuil sur front positif Tension de seuil sur front ngatif Tension d'hystrsis Courant d'alimentation positive Courant d'entre Courant d'entre l'tat bas Courant d'entre l'tat haut Courant de sortie Courant de sortie tat bas Courant de sortie tat haut Courant de sortie en court circuit Courant de sortie rsiduel tat bas en haute impdance Courant de sortie rsiduel tat haut en haute impdance
Vcc=4.5V
Iih Vih
&
Iol
Vol GND
Vcc=4.5V
Iil Vil
&
Ioh
Voh GND
Abrviations C.O. Collecteur ouvert NC Non Connect Sortance Lors des associations de circuits, la somme des courants d'entres ne doit pas tre suprieure au courant de sortie qui les commandes. La sortance est le nombre maximal d'entres que l'on peut connecter une sortie. Elle s'exprime en unit de charge (U.L.). A l'tat bas S L =
IOL min IOH min et l'tat haut S H = IIL max IIH max
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Marge de bruit
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Sortie Vohmin
Volmax
Ml
Les marges de protection contre les perturbations, ou marge de bruit Ml et Mh sont dfinies par les carts entre les frontires des plages de tensions garanties cot sortie et les frontires des plages de tension permises cot entre. Ou en clair... voir ci-contre!!! Mh = Vohmin - Vihmin Ml = Volmax - Vilmax
Paramtres dynamiques f max Frquence horloge max. tr, tf temps de monte et temps de descente de l'horloge ttlh temps de transition entre le niveau haut et le niveau bas tthl temps de transition entre le niveau bas et le niveau haut tplh temps de validation entre le niveau haut et le niveau bas aprs coup d'horloge tphl temps de validation entre le niveau bas et le niveau haut aprs coup d'horloge th temps de maintien d'une entre aprs un coup d'horloge pour tre valid tsu temps de prpositionnement <>th tphz temps d'invalidation tat haut / haute impdance tplz temps d'invalidation tat bas / haute impdance tpzh temps de validation haute impdance / tat haut tpzl temps de validation haute impdance / tat bas tr Temps de recouvrement
horloge tr tf
entre tsu
th tsu
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En gnral, c'est la vitesse et la puissance dissipe qui dtermine le choix d'une technologie. Les circuits HC et HCT combinent la faible consommation, la grande immunit au bruit et la large gamme de temprature de fonctionnement des circuits MOS. La consommation statique des circuits CMOS est 100000 fois infrieure celle d'un circuit LS. L'immunit au bruit des circuits HCT l'tat haut est de 18% et l'tat bas de 28% de Vcc alors qu'elle n'est que de 8 et 14% pour des circuits LS. Caractristiques dentes sorties compares 74 Iolmin Iohmax Iilmax Iihmax Volmax Vohmax Vilmax Vihmax 00 16 -400 -1.6 40 0.4 2.4 0.8 2 L00 3.6 -200 -0.18 10 0.4 2.4 0.7 2 S00 LS00 AS00 ALS00 20 8 20 8 -1000 -400 -2000 -400 -2 -0.36 -0.5 -0.2 50 20 20 20 0.5 0.5 0.5 0.5 2.7 2.7 Vcc-2 Vcc-2 0.8 0.7 0.8 0.8 2 2 2 2 F00 20 -1000 -0.6 20 0.5 2.5 0.8 2 HCT00 4 mA A 0.001 0.001 mA A 0.1 0.1 V 4.9 4.9 V 1 0.8 V 3.5 2 V HC00 4
Il existe des sries de porte dite collecteur ouvert pour lesquelles la sortie est constitue par un transistor dont le collecteur est reli la broche de sortie.
Vcc
Gnd
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Tableau comparatif Circuit TTL Circuit CMOS 4000 TTL Temps de propagation (ns, Cl=15Pif) Frquence d'horloge (Bascule)(Mhz) Consommation au repos immunit au bruit sortance 10 35 10 mW 1V 10 TTL LS 7 45 2mW 0.8V 10
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On prfrera une technologie TTL pour les applications haute vitesse (informatique, calculateur embarqu) et une technologie C MOS pour les applications faible consommation (quipements lectroniques fonctionnement autonome sur batteries). Association TTL vers CMOS Dans le cas o les potentiels Vcc (5V) et Vdd (12V ou 15V) sont diffrents, il nest pas possible de raccorder directement un circuit TTL un circuit C MOS. Un circuit dadaptation de niveau est alors ncessaire. Il peut tre ralis de manire externe (figure de gauche) ou de manire interne en utilisant un circuit avec tage de sortie collecteur ouvert (figure de droite).
Vdd Vcc Vcc Vdd
TTL
CMOS
TTL CO
CMOS
Gnd
Gnd
Association CMOS vers TTL Les tages dentre des circuits TTL tant pourvus de circuit dcrtage de la tension, la connexion entre les deux technologies se fait directement. Il est possible pour des problmes dchauffement du circuit TTL, de placer un circuit dcrtage de la tension lextrieur du botier. Ce circuit est constitu dune diode zener de 5,1 V et dune rsistance.
Vdd Vcc CMOS 4050/ 4049
TTL
Gnd
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IV.
Dans les automatismes squentiels la variable de sortie dpend de ltat des variables dentres et de leur instant dvolution.
1. Les bascules
Les bascules sont utilises pour synthtiser les systmes squentiels plus ou moins complexe. Les mthodes de synthse ne seront pas tudies ici, nous allons nanmoins tudier les diffrents types de bascules couramment utilises. RS asynchrone La bascule RS est la base de toutes les autres bascules. La sortie de la bascule est mise 1 lorsque l'entre SET est active et est mise 0 lorsque l'entre RESET est active. La combinaison SET=1 et RESET=1 est a priori interdite, mais on a tout de mme dfini deux type de bascule : Priorit au 0 S 0 0 1 1
S 2 3 7402 5 6 7402
R 0 1 0 1
Q* Q* p
1 0 0
Q*
Qp
0 1 0
1
Priorit au 1 S 0 0 1 1
S 1 7404 2
R 0 1 0 1
1 2
Q* Q* p
1 0 1
3 Q
Qp
0 1 1
7400
3 7404
4 5 7400
Q*
Bascules RS synchrones Nous utiliserons une entre supplmentaire H autorisant les changements sur la sortie de la bascule. Deux modes de fonctionnement sont alors possibles : - Sur niveau : Le changement dtat ne peut se faire que lorsque H est un niveau validant. - Sur front : Le changement dtat ne peut se faire que lorsque H voit un front validant.
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Dclenchement sur niveau
S 1 2 7400 H 4 5 7400 3 1 2 7400 3
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1 2 7400
Q*
Dclenchement sur front Le principe est identique celui du dclenchement sur niveau, on transforme simplement le signal d'horloge en une impulsion 7404 7408 sur le front montant (passage du 0 logique au 1 logique) de ce signal d'horloge en utilisant un temps de propagation de porte logique (voir schma ci-contre).
1 2 1 2 3
Bascule D
S 1 2 1 7400 H 4 5 7400 3 1 2 7400 3 Q
7404 2
1 2 7400
Q*
La sortie Q est gale S si l'horloge H=1, la sortie Q est mmorise si H=0. Ce type de bascule existe en dclenchement sur front, elle sert alors mmoriser l'tat de l'entre lors d'un front d'horloge.
Bascule JK Il existe de nombreux type de bascule JK, bien que les plus couramment utilises sont de type synchrone sur front. Leur fonctionnement est toujours dcrit par la table de vrit suivante: J 0 0 1 1 K 0 1 0 1 Q
Qp
0 1
Qp
Bascule T La bascule T est une bascule qui n'existe pas en tant que tel, mais qui est utilis l'intrieur de nombreux circuits intgrs. On la construit partir d'une bascule JK ou J=K. T 0 1 Q
Qp Qp
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2. Multiplexeur / Dmultiplexeur
I0 I1 Q I2 I3
S1 S0
Un multiplexeur est un commutateur lectronique reliant sa sortie Q une des 2n entres, n tant le nombre de bits de slection. Sur notre exemple Q est relie I0 si S1=0 et S0=0, Q est relie I1 si S1=0 et S0=1, Q est relie I2 si S1=1 et S0=0 et Q est relie I3 si S1=1 et S0=1. Il existe des multiplexeurs logiques (le signal sur les entres I0 I3 doit tre de nature logique) et des multiplexeurs analogiques (le signal sur les entres I0 I3 doit tre de nature analogique). Un dmultiplexeur est un commutateur ralisant la fonction inverse, savoir relier une des 2n sorties son entre.
3. Les Compteurs
Les compteurs / dcompteurs sont des systmes squentiels n bascules. La dynamique (profondeur de comptage) de ces systmes est fixe par le nombre de bascules. Compteurs asynchrones Un compteur asynchrone est un compteur ou le basculement de la bascule numro i est dclench par la sortie de la bascule i-1. Il existe un temps de propagation entre le basculement de chacune des bascules constituant le compteur. Il peut donc apparatre des alas de fonctionnement indsirables. Cette solution est rserve aux comptages lents.
1 H Q Q 1 Q Q 1 Q Q
H Q1 Q2 Q3
Compteurs synchrones Afin d'liminer les alas rsultants des temps de propagation entre les bascules, il est possible de synchroniser le fonctionnement des bascules sur l'horloge:
1 H
Q Q
Q Q
Q Q
Q Q
Compteurs intgrs Il existe en circuit intgr peu prs tous les types de compteurs que l'on peut imaginer : Technologie TTL ou C MOS Synchrone ou asynchrone Compteur simple ou rversible (compteur/dcompteur) Compteur prpositionnable (on peut choisir la valeur de dpart) Diviseur de frquence Binaire ou BCD (on peut choisir le type de codage)
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Codage BCD (Binaire cod dcimal) et Binaire pur Hexa 0 1 2 3 4 5 6 7 8 9 A B C D E F 10 11 12 Dcimale 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 D0 0 0 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 BCD U3 U2 U1 0 0 0 0 0 0 0 0 1 0 0 1 0 1 0 0 1 0 0 1 1 0 1 1 1 0 0 1 0 0 0 0 0 0 0 0 0 0 1 0 0 1 0 1 0 0 1 0 0 1 1 0 1 1 1 0 0 U0 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0
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B4 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 1 1
Binaire naturel B3 B2 B1 0 0 0 0 0 0 0 0 1 0 0 1 0 1 0 0 1 0 0 1 1 0 1 1 1 0 0 1 0 0 1 0 1 1 0 1 1 1 0 1 1 0 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1
B0 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0 1 0
Prsentation 74XX191 Le 74XX191 est un compteur/dcompteur 4 bits binaire naturel, synchrone prpositionnement parallle asynchrone. A, B, C et D : Pattes d'entres pour prpositionnement parallle. QA, QB, QC et QD : Sortie du compteur. RCO : Patte d'indication de dbordement (Report Carry Out) Cette 15 3 patte est mise l'tat bas si la valeur du compteur vaut 15 en mode A QA 2 1 B QB 10 6 comptage, 0 en mode dcomptage. Cest la retenue ! C QC 9 7 D QD 13 CLK : Horloge active sur front montant. RCO 14 CLK G : (ou CTEN): Autorisation de comptage dcomptage. 4 G 5 D/U D / U : dcomptage (1), comptage (0). 11 LOAD LOAD : Patte de prpositionnement asynchrone, ds que cette patte MX/MN 12 passe l'tat bas, les sorties sont gales aux entres, et cela jusqu'au passage 1 de LOAD. Le cycle de comptage/dcomptage ne commence que si LOAD = 1. MX/MN : Identique RCO mais utilis pour les comptages haute vitesse (dure plus importante). Mise en cascade Le compteur 74XX191 est capable de compter sur 4 bits soit de 0 15 cependant il peut tre utile daller au-del de cette capacit. Il sera donc ncessaire dassocier plusieurs compteurs 4 bits afin de raliser un compteur 8 (0 255) 12 (0 4095) 16 bits (0 65535) ou plus.
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne Association asynchrone : Lors d'une mise en cascade asynchrone, c'est le front montant de RCO qui dclenche un cycle de comptage dcomptage sur le compteur suivant.
15 1 10 9 Horloge Mode 14 4 5 11 U? A B C D QA QB QC QD RCO 3 2 6 7 13
Florence.vadee@wanadoo.fr : 01 45 14 28 28 : 01 48 73 63 15 Association synchrone : Lors d'une mise en cascade synchrone, lhorloge est commune aux deux compteurs cest le RCO du compteur de poids faible (units) qui autorise le comptage de celui de poids fort (seizaine). Ceci permet un fonctionnement parfaitement synchrone des sorties avec lhorloge.
15 1 10 9 Horloge Mode 14 4 5 11 U? A B C D QA QB QC QD RCO 3 2 6 7 13
12
15 1 10 9 14 4 5 11
U? A B C D
QA QB QC QD RCO
3 2 6 7 13 15 1 10 9 14 4 5 11
12
12
U? A B C D
VCC
Il existe donc un dcalage entre l'instant o commutent les sorties du premier compteur et l'instant o commutent les sorties du second compteur gale au temps de propagation du carry out.
QA QB QC QD RCO
3 2 6 7 13
12
VCC
4. Les Convertisseurs
Convertisseurs Numrique Analogique Ils convertissent un mot, form de plusieurs bits, en une tension qui lui est proportionnelle. Cette tension Us est comprise entre 0V et la tension de pleine chelle Upe (tension de sortie lorsque le mot prend la valeur la plus leve). Us =
Le mot ne pouvant prendre que des valeurs entires la sortie volue donc par paliers. Le pas entre deux mots conscutifs reprsente le poids du bit le moins significatif (LSB), lquivalent des units en dcimal, il vaut : LSB =
1 Upe 2 1
n
Paramtres technologiques: Rsolution : elle caractrise la prcision du convertisseur elle est exprime en nombre de bits. Prcision : valeur relative maximale exprime en % de l'erreur entre la valeur relle et la valeur thorique du signal de sortie. Temps d'tablissement : c'est le temps ncessaire pour que le signal de sortie atteigne sa valeur finale lors du changement de la valeur (numrique) d'entre.
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Convertisseurs Analogique Numrique Ils convertissent une tension Ue en un mot, form de plusieurs bits, qui lui est proportionnelle. Cette tension Ue doit tre comprise entre 0V et la tension de pleine chelle (tension maximum dentre : elle correspond au mot le plus grand en sortie) :
Paramtres technologiques: Rsolution : elle caractrise la prcision du convertisseur elle est exprime en nombre de bits. Valeur du LSB : c'est le poids que reprsente le bit le moins significatif. Prcision : valeur relative maximale exprime en % de l'erreur entre la valeur relle et la valeur thorique du signal de sortie. Temps de conversion : c'est le temps ncessaire pour que convertisseur donne la valeur (numrique) correspondant au signal d'entre. Pendant la phase de conversion, la tension dentre Ue doit tre maintenue constante. La dure de conversion est lie la technologie utilise, le prix aussi. Voici les technologies classes par ordre croissant de rapidit (et de prix) : Convertisseur rampe (simple ou double) (produits de remplacement exclusivement) Approximation successive Semi-Flash Flash
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5. Les mmoires
Les systmes numriques se distinguent des systmes analogiques par leur capacit mmoriser des informations, les traiter et les restituer en temps utile. Cest donc tout naturellement que nous allons nous intresser aux diffrents types de mmoire disponible sur le march. Il en existe deux grandes familles ; les mmoires vives qui peuvent contenir des informations tant quelles sont alimentes et qui peuvent tre lues ou crites selon les besoins et les mmoires mortes dans lesquelles sont dfinitivement inscrites les informations utiles. Lorganisation dune mmoire consiste en une association de plusieurs registres dont lun dentre eux peut tre mis en relation avec lextrieur, soit pour sa lecture (mmoire morte), soit pour sa lecture/criture (mmoire vive). On ne peut donc accder qu une case (registre) la fois dont le format va de 1 bit 64 bits et plus (sur lexemple ci-dessous 4 bits sont accessibles simultanment dans chaque registre de donnes). La slection dun des registres se fait par n fils dadresse parmi les 2n registres disponibles dans la mmoire. On parle de mmoire X registre par Y donnes dans chaque registre ce qui nous donne la capacit totale X x Y bits (la capacit peut aussi tre exprime en octet : un octet = 8 bits). La lecture (ou lcriture) dans un registre suppose que lon slectionne ce registre (A0, A1, A2, A3, A4, A5) et que lon slectionne le botier (CS) afin davoir accs aux donnes contenues dans le registre. Dans le cas de mmoire vive, on prcisera aussi si lon souhaite lire ou crire dans ce registre (L/E).
Les mmoires mortes ne sont quant elles accessibles quen lecture. On devra donc effectuer leur programmation hors du systme dexploitation. En usine (chez le fabriquant de mmoire) pour des grandes sries : ce sont les ROM. Avec un programmateur et une fois pour toute : ce sont les PROM. Des composants mmoires mortes sont programmables et effaables par UV, toujours en les sortant de leur emplacement dutilisation : ce sont les EPROM. Enfin des composants mmoires mortes sont programmables et effaables lectriquement (la programmation et leffacement sont assez long la lecture est quant elle rapide) directement sur leur emplacement dutilisation : Ce sont les EEPROM, trs souvent utilises dans les automates programmables industriels pour la sauvegarde des programmes mme en cas de coupure dalimentation lectrique. Des structures programmables plus complexes sont galement disponibles, elles permettent de mettre en relations, combinatoires et squentielles, des entres et des sorties : ce sont les FPGA, PLD etc
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Travail personnel
I. Ralisation dune quation On se propose de raliser la fonction suivante:
1. Proposer un schma contact de cette quation 2. Donner une criture de cette quation faisant apparatre des NAND 3 entres 3. Proposer un schma logique de cette nouvelle criture II. Calcul de rsistances de tirage La rsistance de tirage au 0 volt (pull down) permet d'imposer un zro logique sur l'entre du circuit intgr logique de la famille TTL LS. 1. Quel est le niveau de tension maximal correspondant au 0 logique ? 2. Quel est le courant maximal correspondant au 0 logique ? 3. Indiquer le sens de circulation conventionnel de ce courant. CI 4. Dduire lorientation de la tension aux bornes de R. R 5. Calculer la valeur max. de cette rsistance permettant dassurer le 0 logique. Quelle valeur pratique de rsistance prendra-t-on ? La rsistance de tirage au 5 volt (pull up) permet d'imposer un 1 logique sur l'entre du circuit intgr logique de la famille TTL LS. 1. Quel est le niveau de tension minimal correspondant au 1 logique ? +5V 2. Tracer cette tension sur le schma ci-contre. 3. Quel est le courant maximal correspondant au 1 logique ? R 4. Indiquer le sens de circulation conventionnel de ce courant. 5. Dduire lorientation de la tension aux bornes de R. CI 6. Quelle est la valeur maximale de la tension aux bornes de cette rsistance R ? 7. Calculer la valeur max. de cette rsistance permettant dassurer le 1 logique.
+5V
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne III. Analyse dun systme logique
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&
G
H2
R
S2
MEM
H3
S
&
ENTREES
TRAITEMENT LOGIQUE
SORTIES
Description des capteurs et pr-actionneurs S1: information de dfaut H1: voyant vert de fonctionnement normal S2: Bp acquittement de dfaut H2: voyant rouge de signalisation de dfaut (G : clignoteur 0,5 Hz) H3: Alarme sonore de dfaut 1. Faire l'analyse du fonctionnement de ce systme 2. Donner un chronogramme reprsentatif du fonctionnement
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1
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S1
0 1
S2
0 1
H1
0 1
H2
0 1
H3
0
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Philippe LE BRUN Lyce Louis ARMAND 173 Bd de Strasbourg 94736 NOGENT sur Marne IV. Elimination des rebonds de contact sec
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La fermeture d'un contact mcanique se fait avec un certain nombre de rebonds dune dure totale de lordre de la milli-seconde, voir ci dessous.
Ve
+5V
CI R
Un certain nombre de solutions est envisageable pouur liminer ces rebonds dont celle propose ici.
5V
R a R b
& S1
C.I.
&
1. Quels problmes risque-t-on de rencontrer si l'on n'limine pas les rebonds de contact? 2. Donner un chronogramme de fonctionnement sachant qu'un rebond dure environ 1ms. 3. Quelle sortie devra tre raccorde sur l'entre du CI pour obtenir le mme fonctionnement que ci-dessus sans les rebonds (interrupteur reprsent en position repos dans les deux cas). V. Commande d'un pont redresseur thyristors Les ordres d'amorages des thyristors T1, T2 et T3 proviennent d'un systme logique que nous ntudierons pas. Ils sont conformes au chronogramme ci-dessous.
1
T1
0 1
5V
S2
T2
0 1
T3
0
Afin de garantir une bonne commutation du pont, nous souhaitons commander les gchettes des thyristors par des trains dimpulsions dune dure de 120 dbutants sur lordre damorage prcdent. 1. Proposer un schma permettant de raliser cette fonction.
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Autocorrection
I. Ralisation dune quation
1.