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Nada MOUCHFIQ
2023 - 2024
Plan du Cours
Chapitre 1 : Généralités
Sous-couches
Control d’erreurs
Introduction
paquet paquet
trame trame
bits
couche physique couche physique
Emetteur Récepteur
Les deux sous couche de la couche liaison de données
Trame =
– Paquet (données provenant de la couche 3) + infos de contrôle
– On dit que le paquet est encapsulé dans une trame
Délimitation des trames
• Problème:
Le récepteur doit savoir le début et la fin d’une trame.
- Afin de reconstituer à partir des suites binaires les trames envoyées.
• Solution :
Une trame doit commencer par un marqueur de début de trame et se
terminer par un marqueur de fin de trame.
Découpage en trames
Trames émises
Trames reçues
• Fanion : 01111110
Données :
01011001111110
Trame :
• Avantages
– permet toujours de retrouver la synchronisation
– permet l'envoi de trames de tailles quelconques
– technique la plus simple
• Cette technique est utilisée également en considérant des caractères de
délimitation et des caractères de transparence.
Transmission d’information
canal
bruit
émetteur récepteur
Causes d’erreurs sur un canal
La destination peut :
• détecter les erreurs, puis demander une retransmission
– code détecteurs d’erreurs
• détecter et corriger les erreurs
– codes correcteurs d’erreur
Deux stratégies possibles
La destination peut :
• détecter les erreurs, puis demander une retransmission
d bits de données
+
c bits de contrôle
=
n bits d’information (à transmettre)
– Le bit de parité est un mécanisme de détection d'erreurs peu coûteux (1 seul bit rajouté), qui est
très simple mais son efficacité n'est pas extraordinaire, du fait qu'il peut avoir des messages
contenant un nombre d'erreurs pair mais qui ne peut être détecté par la technique de contrôle de
parité
– Exemple :
– Ce petit exemple nous montre que bien que le message soit altéré, le contrôle de parité ne le
détecte pas, ce qui constitue la limite la plus reprochée de cette technique.
Contrôle de parité longitudinale (Longitudinal
Redundancy Check LRC)
Principe :
• contrôler l'intégrité des bits de parité d'un bloc de caractères.
• Rajouter à chaque colonne représentant une suite de bits de même rang un bit de parité.
• Effectuer cette opération même sur le rang des bits de parité.
.
Impossible de détecter l’erreur si deux bits sont changés en même temps sur la même colonne
Pour plus d’efficacité, on rajoute un contrôle sur les lignes
Détection des erreurs :
Contrôle de parité croisée VRC + LRC
Ce polynôme G (x ) va servir :
4. Calculer M J = M+ R .
Algorithme Récepteur:
Soit
1. MJ le message reçu Algorithme :
2. Calculer le polynôme correspondant à MJ .
t
Exemple
Plan du Cours
Chapitre 1 : Généralités
00-1E-33-1D-6A-79
00-1E-33-1D-6A-79
00:1E:33:1D:6A:79
001E:331D:6A79
001E.331D.6A79
Adresse physique : adresse MAC
LAN
En mode Multipoint: Ethernet
Structure d’une trame de couche 2
WAN
En mode Point à point: HDLC, PPP, SDLC…
Format général d’une trame HDLC
( High-Level Data Link Control )
Le champ adresse identifie la station secondaire dans le cas d’une liaison multipoint
Cette adresse peut inclure une adresse particulière, une adresse de groupe ou
une adresse de diffusion
Dans le cas de liaison point-à-point il n’est pas pris en compte
Format général d’une trame HDLC
N(S) N(R)
I(0,0)
Exemple
Trames I (Information) I(1,0)
I(2,5)
Trame HDLC (Trame S)
N(S) N(R)
I(0,0)
Exemple
Trames S (00: RR I(1,0)
(Received & Ready)
S(RR,2)
I(2,0)
I(3,0)
S(RR,4)
I(4,0)
I(5,0)
Trame HDLC (Trame S)
N(S) N(R)
I(0,0)
Exemple
I(1,0)
Trames S (10 : RNR
(Received & Not Ready) I(2,0)
S(RNR,2)
S(RR,2)
I(2,0)
I(3,0)
I(4,0)
Trame HDLC (Trame S)
01 : REJ (Reject)
N(S) N(R)
I(0,0)
Exemple
I(1,0)
Trames S (01 : REJ
(Reject) I(2,0)
I(3,0)
I(4,0)
S(REJ,1)
I(1,0)
I(2,0)
I(3,0)
I(4,0)
Trame HDLC (Trame S)
N(S) N(R)
I(0,0)
Exemple
I(1,0)
Trames S (11 : SREJ
(Selective Reject) I(2,0)
I(3,0)
I(4,0)
S(SREJ,2)
I(2,0)
I(5,0)
Trame HDLC (Trame U)
Exemple SABM
Trames U (Unnumbered) UA
Données
DISC
UA