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PROGRAMMABLES
FPGA
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Les FPGA
FPGA= Field Programmable Gate Array.
Le concept du FPGA est basé sur l'utilisation d'une LUT (Look Up Table)
comme élément combinatoire de la cellule de base.
flexibilité
reconfiguration
prototypage rapide
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Architecture des FPGA
Blocs d ’entrées/sorties « IOB » configurables
Entrée, sortie ou les deux, mémorisation dans une bascule D
niveaux logiques LVTTL, LVCMOS, … 3.3V, 2.5V,…
Blocs logiques « CLB » configurables
Blocs combinatoires 4 entrées une sortie (en général)
Bascules D pour la mémorisation
Lignes d ’interconnexions « PSM= Programmable Switch
Matrix » configurables
lignes courtes
lignes longues
Options : multiplicateurs , SRAM , … etc
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Structure d’un circuit FPGA
Description simplifiée d ’un FPGA
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Description simplifiée d ’un FPGA
(Spartan III)
Buffers Gestion d ’horloge (DCM)
Ram
Entrée/Sortie (IOB)
Multiplieurs
Zone d ’interconnexions
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Blocs d ’interconnexions programmables(PSM)
spartan3 XC3S200
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Exemple:
Dans cette figure, on a: 12 IOBs et 5x3 CLBs
IOB
CLB
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Bloc de logique configurable (CLB)
Exemple du virtex 5:
Un CLB est composé de 2 tranches (slices).
Chaque tranche est reliée au réseau d’interconnexion.
Les tranches sont reliées entre elles verticalement.
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Architecture d’une tranche (slice L)
Une tranche est composée de:
• 4 tables de correspondance (LUT) à 6 entrées, pouvant etre
programmées comme:
Fonction logique
ROM
• 4 éléments à mémoire :bascules
• Des multiplexeurs pour router les signaux
• Des portes logiques pour l’addition rapide
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4 LUTs Addition
Bascules
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MUX
Principe de fonctionnement
d ’une cellule logique de base
Bascule Mux
4 entrées LUT D Q
Ck Positionné lors de
SRAM de 16 bits la configuration
(Look Up Table) CE
Mémorisation
du résultat
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Principe de fonctionnement
d ’une cellule logique de base
Fonctionnement purement combinatoire:
Bascule
4 entrées LUT D Q
Ck
Choix
SRAM de 16 bits
(Look Up Table) CE
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Principe de fonctionnement
d ’une cellule logique de base
Mémorisation du résultat:
Bascule
4 entrées LUT D Q
Ck
Choix
SRAM de 16 bits
(Look Up Table) CE
Mémorisation
du résultat
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Look up table (LUT)
0
1
0
4 entrées LUT 1 sortie Sortie
24 bits
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Les Horloges
• Des entrées spécialisées sont prévues pour recevoir les
signaux d'horloge et les distribuer à l'intérieur du circuit.
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4 blocs de gestion d ’horloge (DCM Spartan 3)
f
f avec déphasage
2.f
f /(1,5 2 2,5...16)
( 2…32)/(1..32) . f
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Principaux constructeurs de FPGA
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Carte Genesys équipée d’un FPGA VIRTEX 5 de Xilinx
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Carte DE2 équipée d’un FPGA Cyclone II d’Altera 24
Familles de FPGA « virtex de Xilinx »
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Familles de FPGA «Spartan de Xilinx »
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FPGA hautes performances
«La famille Stratix d’Altera»
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FPGA polyvalent «La famille Arria »
29
FPGA de grande série «La famille Cyclone »
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Applications des FPGA
• Télécommunications,
• Traitement de signal, d’images et de vidéos,
• Aéronautique,
• Transports,
• …. etc
• Ils sont également utilisés pour le prototypage
d'ASIC.
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Les ASICs
• ASIC = Application-Specific Integrated Circuit
• Circuit intégré propre à une application,
• circuit intégré spécialisé.
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