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Raliss par :

Hadj Taieb Omar


Jarraya Wassim
Kammoun Hamdi

Enseignant :
Mr. Baklouti Samir

Anne universitaire :
2017-2018
MANIPULATION 1

I. Le circuit intgr 7442 :

Le circuit intgr 7442 fait partie de la srie des circuits intgrs 7400 utilisant
la technologie TTL.

Ce circuit est un dcodeur BCD vers dcimal.

Aussi , le circuit 7442 cest un dcodeur B.C.D/dcimal qui effectuent la


conversion les entres D, C, B, A dans le nombre dcimal correspondant en
portant au niveau 0, la sortie relative a ce nombre .

1. Schma de montage :

CFM 21 ISET SFAX


2. Table de vrit exprimentale :

D C B A 0 1 2 3 4 5 6 7 8 9
0 0 0 0 0 1 1 1 1 1 1 1 1 1
0 0 0 1 1 0 1 1 1 1 1 1 1 1
0 0 1 0 1 1 0 1 1 1 1 1 1 1
0 0 1 1 1 1 1 0 1 1 1 1 1 1
0 1 0 0 1 1 1 1 0 1 1 1 1 1
0 1 0 1 1 1 1 1 1 0 1 1 1 1
0 1 1 0 1 1 1 1 1 1 0 1 1 1
0 1 1 1 1 1 1 1 1 1 1 0 1 1
1 0 0 0 1 1 1 1 1 1 1 1 0 1
1 0 0 1 1 1 1 1 1 1 1 1 1 0
1 0 1 0 1 1 1 1 1 1 1 1 1 1
1 0 1 1 1 1 1 1 1 1 1 1 1 1
1 1 0 0 1 1 1 1 1 1 1 1 1 1
1 1 0 1 1 1 1 1 1 1 1 1 1 1
1 1 1 0 1 1 1 1 1 1 1 1 1 1
1 1 1 1 1 1 1 1 1 1 1 1 1 1

3. Equitation de sortie simplifie :

0 = A.B.C.D 5 = .B. .D
.D
6 = A. .
1 = .B.C.D

2 = A..C.D 7 = . . .D

8 = A.B.C.
3 = . .C.D

4 = A.B. .D 9 = .B.C.

CFM 21 ISET SFAX


4. logigramme :

CFM 21 ISET SFAX


II. Le circuit intgr 74154 :

Le circuit 74154 cest un dcodeur B.C.D /hexa qui effectuent la conversion


les entres D, C, B, A dans le nombre dcimal correspondant en portant au
niveau 0, la sortie relative a ce nombre .

1. Schma de montage :

CFM 21 ISET SFAX


2. Table de vrit exprimentale :

D C B A 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15
0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1
0 0 0 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1
0 0 1 0 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1
0 0 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1
0 1 0 0 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1
0 1 0 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1
0 1 1 0 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1
0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1
1 0 0 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1
1 0 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1
1 0 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1
1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1
1 1 0 0 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1
1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1
1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1
1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0

3. Equitation de sortie simplifie :

0 = A.B.C.D
8 = A.B.C.

1 = .B.C.D 9 = .B.C.

2 = A..C.D 10 = .B. .D

3 = . .C.D 11 = A.B. .D

4 = A.B. .D 12 = ..C.D

5 = .B. .D 13 = A..C.D
.D
6 = A. . 14 = .B.C.D

7 = . . .D 15 = A.B.C.D

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4. Logigramme :

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MANIPULATION 5

ANALYSE D'UN COMPARATEUR INTGR : LE 7485

Le circuit intgr 7485 est un comparateur 4 bits, c'est--dire qu'il effectue la


comparaison de deux nombres de 4 bits.

De plus, il dispose de 3 entres notes A = B, A > B et A < B qui autorisent la


mise en cascade de plusieurs circuits comparateurs du mme type.

Ainsi, on peut comparer des nombres de 8, 12, 16 bits....

Le brochage de ce circuit est donn la figure 21, tandis que la figure 22


reprsente son schma logique.

Avec ce circuit, on compare le nombre A compos des bits A3, A2, A1 et A0 (A3
= MSB et A0 = LSB) avec le nombre B compos des bits B3, B2, B1 et B0 (B3 =
MSB et B0 = LSB).

La table de vrit de la figure 23 met en vidence l'action des entres A > B, A <
B et A = B.

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Si l'on souhaite que la sortie A = B passe l'tat 1 chaque fois que les deux
nombres binaires sont gaux, il suffit de porter l'entre A = B l'tat 1, l'tat
des entres A < B et A > Bn'ayant alors pas d'importance.

Si l'on souhaite que la sortie A > B passe l'tat 1 galement dans le cas
o les deux nombres binaires sont gaux, il suffit de porter l'entre A > B
l'tat 1 et de porter les entres A < B et A = B l'tat 0.

Dans cette configuration de l'tat des entres A > B, A < B et A = B, la sortie

A > B est l'tat 1 lorsque le nombre binaire A est suprieur au nombre


binaire B ou quand ces deux nombres sont gaux. Elle indique donc si A B.

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De mme, en portant l'entre A < B l'tat 1 et les entres A > B et A = B
l'tat 0, la sortie A < B indique le nombre binaire A est infrieur ou gal au
nombre binaire B.

En mettant en srie deux comparateurs 7485, on peut comparer deux nombres


de 8 bits. Il suffit de relier la sortie A = B du premier comparateur l'entre
correspondante du second et de faire de mme avec les sorties A > B et A < B.
Les liaisons effectuer sont indiques la figure 24.

Ainsi, on compare le nombre A form des 8 bits A7 A0 (A7 = MSB et A0 = LSB)


et le nombre B form des 8 bits B7 B0 (B7 = MSB et B0 = LSB).

Le premier circuit compare les poids faibles de A avec le poids faibles de B. Le


rsultat de cette comparaison est transmis aux entres A < B, A = B et A > B du
deuxime circuit.

Celui-ci compare les poids forts de A avec les poids forts de B et, en fonction du
rsultat de la comparaison des bits de poids faibles de A et B, indique sur ses
sorties A > B, A = B et A < B le rsultat de la comparaison des nombres A et B.

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