Microprocesseurs-Microcontrôleurs - PDF

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Microprocesseurs-Microcontrôleurs
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 Julie Martin (/user/37718123/)  il y a 6 ans  Total affichages : 26

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1 Microprocesseurs-Microcontrôleurs ENSEA ETIS / ENSEA Mel : Bertrand.Granado@ensea.fr Automne 2010 ENSEA
(ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
2 1 Présentation 2 Embarquons La e-life Les MicroContrôleurs 3 Le micro-contrôleur STM32 4 Les interruptions

Réagir aux événements externes ou aux fautes Les interruption du microcontrôleur STM32 Registres Spéciaux liés
aux interruptions Déroulement d une interruption Les priorités Les vecteurs d interruption Fonctionnement des
interruptions Exceptions système Système d exploitation Contrôleur NVIC 5 Exemple de périphériques Le
convertisseur Analogique-Numérique Le DMA : Direct Memory Acces ENSEA (ETIS / ENSEA) Microprocesseurs-
Microcontrôleurs Automne / 200
3 Présentation Sommaire 1 Présentation 2 Embarquons 3 Le micro-contrôleur STM32 4 Les interruptions 5 Exemple

de périphériques ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
4 Présentation Les Chefs Samuel Garcia Mahmoud Karabernou Lounis Kessal Laurent Monchal Nicolas Simond Antoine Tauvel ENSEA (ETIS /
ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
5 Présentation La Sauce 10 h de Cours 4 h de TD 16 h de Mini-Projet ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
6 Présentation Le Dessert ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
7 Embarquons Sommaire 1 Présentation 2 Embarquons La e-life Les MicroContrôleurs 3 Le micro-contrôleur STM32 4 Les interruptions 5 Exemple
de périphériques ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
8 Embarquons La e-life e-life 1 ordinateur pour des centaines de personnes des dizaines d'équivalents ordinateur pour une personne ENSEA (ETIS
/ ENSEA) Microprocesseurs-Microcontro leurs Automne / 200
9 Embarquons La e-life Support de la e-life MicroProcesseurs Processeur Spécialisés : DSP, GPU Circuits Reconfigurables : FPGA, PLD Circuits
Spécifiques : ASIC, ASIP MicroContrôleurs ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
10 Embarquons Les MicroContrôleurs Les MicroContrôleurs Interaction forte avec l environnement Concevoir un composant qui associe 3 aspects
Acquisition Traitement Commande Premier SoC (System on Chip ou système sur puce) Dans la pratique : faible capacité de traitement Dédié plutôt
contrôle ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
11 Embarquons Les MicroContrôleurs Les MicroContrôleurs : Principes transformation grandeur physique grandeur électrique transformation
continu-discret MicroContrôleur Capteur Coeur Processeur transformation discret-continu transformation grandeur électrique grandeur physique
Actionneur ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
12 Embarquons Les MicroContrôleurs Les MicroContrôleurs : 8051 Intel 8051 Microarchitecture P0.0 - P0.7 P2.0 - P2.7 Vcc Vss Port 0 Drivers Port 2
Drivers RAM Addr. Register RAM Port 0 Latch Port 2 Latch EPROM/ ROM 8 ACC Stack Pointer Program Address Register B Register TMP2 TMP1 Buffer
ALU Interrupt, Serial Port, and Timer Blocks PC Incrementer 16 PSW 8 Program Counter PSEN# ALE/PROG# EA#/VPP RST Timing and Control
Instruction Register DPTR Port 1 Latch Port 3 Latch OSC. Port 1 Drivers Port 3 Drivers XTAL1 XTAL2 P1.0 - P1.7 P3.0 - P3.7 ENSEA (ETIS / ENSEA)
Microprocesseurs-Microcontrôleurs Automne / 200
13 Embarquons Les MicroContrôleurs Le marché des microcontrôleurs ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
14 Le micro-contrôleur STM32 Sommaire 1 Présentation 2 Embarquons 3 Le micro-contrôleur STM32 4 Les interruptions 5 Exemple de
périphériques ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
15 Le micro-contrôleur STM32 Le STM32 : présentation ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
16 Le micro-contrôleur STM32 Le STM32 : présentation MicroContrôleur ST basé sur le processeur ARM Cortex M3 Processeur RISC Architecture
Harvard : bus instructions et données séparés Mode de gestion de la consommation Supporte uniquement le jeu d instruction Thumb2 Cours
Mahmoud Karabernou - Première année (MOODLE) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
17 Le micro-contrôleur STM32 Le STM32 : evolution architecture ARM v7-m (Microcontroller; e.g., Cortex-M3) ENSEA (ETIS / ENSEA)
18 Le micro-contrôleur STM32 Le STM32 : evolution architecture ARM ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
19 Le micro-contrôleur STM32 STM32 : Cortex M3 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
20 Le micro-contrôleur STM32 Le STM32 : environnement ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
21 Le micro-contrôleur STM32 Le STM32 : famille 2007 STM32F103C8 STM32F101C8 STM32F103RB STM32F101RB STM32F103R8 STM32F101R8
STM32F103VB STM32F101VB STM32F103V8 STM32F101V8 Performance line Access line STM32F103C6 STM32F101C6 STM32F103R6 STM32F101R6
ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
22 Le micro-contrôleur STM32 Le STM32 : famille pins 64 pins 100 pins 48 pins 64 pins 100 pins Part number Program memory type Flash Prog.
(Bytes) RAM (Bytes) Timer functions 12 or 16-bit (IC/OC/PWM) STM32F101C6 32 K 6 K 2x16-bit (8/8/8) Others Serial interface STM32 (ARM Cortex-M3)
- 32-bit microcontrollers I/Os (High current) Packages Supply voltage 1xSPI/1xI²C/2xUSART* 32(32) LQFP48 2 to 3.6 V STM32F101C8 64 K 10 K 3x16-
bit (12/12/12) 2xSPI/2xI²C/3xUSART* 32(32) LQFP48 2 to 3.6 V STM32F101R6 32 K 6 K 2x16-bit (8/8/8) 1xSPI/1xI²C/2xUSART* 49(49) LQFP64 2 to 3.6 V
STM32F101R8 64 K 10 K 3x16-bit (12/12/12) 2xSPI/2xI²C/3xUSART* 49(49) LQFP64 2 to 3.6 V STM32F101RB 128 K 16 K 3x16-bit (12/12/12)
2xSPI/2xI²C/3xUSART* 49(49) LQFP64 2 to 3.6 V STM32F101V8 64 K 10 K 3x16-bit (12/12/12) 2xWDG, 2xSPI/2xI²C/3xUSART* 80(80) LQFP100 2 to 3.6 V
STM32F101VB RTC, 128 K 16 K 3x16-bit (12/12/12) 24-bit 2xSPI/2xI²C/3xUSART* 80(80) LQFP100 2 to 3.6 V STM32F103C6 32 K 10 K 3x16-bit
(12/12/14) down 1xSPI/1xI²C/2xUSART*/USB/CAN 32(32) LQFP48 2 to 3.6 V STM32F103C8 64 K 20 K 4x16-bit (16/16/18) counter
2xSPI/2xI²C/3xUSART*/USB/CAN 32(32) LQFP48 2 to 3.6 V STM32F103R6 32 K 10 K 3x16-bit (12/12/14) 1xSPI/1xI²C/2xUSART*/USB/CAN 49(49)
LQFP64 2 to 3.6 V STM32F103R8 64 K 20 K 4x16-bit (16/16/18) 2xSPI/2xI²C/3xUSART*/USB/CAN 49(49) LQFP64 2 to 3.6 V STM32F103RB 128 K 20 K
4x16-bit (16/16/18) 2xSPI/2xI²C/3xUSART*/USB/CAN 49(49) LQFP64 2 to 3.6 V STM32F103V8 64 K 20 K 4x16-bit (16/16/18)
2xSPI/2xI²C/3xUSART*/USB/CAN 80(80) LQFP100/BGA100 2 to 3.6 V STM32F103VB 128 K 20 K 4x16-bit (16/16/18) 2xSPI/2xI²C/3xUSART*/USB/CAN
80(80) LQFP100/BGA100 2 to 3.6 V *(IrDA/ISO7816/LIN master/slave) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
23 Le micro-contrôleur STM32 Le STM32 : famille 2010 Table 3. STM32F103xx family Low-density devices Medium-density devices High-density
devices XL-density devices Pinout 16 KB Flash 32 KB Flash (1) 64 KB Flash 128 KB Flash 256 KB Flash 384 KB Flash 512 KB Flash 768 KB Flash 1 MB
Flash 6 KB RAM 10 KB RAM 20 KB RAM 20 KB RAM 48 or 64 KB (2) RAM 64 KB RAM 64 KB RAM 96 KB RAM 96 KB RAM ENSEA (ETIS / ENSEA)
24 Le micro-contrôleur STM32 Le STM32 : synoptique ô é à é ô é é éé ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
25 Le micro-contrôleur STM32 Le STM32 : Outils de Développement Fournisseur Hitex : IAR : Keil : Raisonance : Rowley : Description Atelier, GNU
C/C++, USB/JTAG Atelier, IAR C/C++, USB/JTAG Atelier, ARM C/C++, USB/JTAG Atelier, GNU C/C++, USB/JTAG Atelier, GNU C/C++, JTAG ENSEA (ETIS /
26 Le micro-contrôleur STM32 Le STM32 : Cartes de Développement Fournisseur Description Hitex : STM3210B-SK/HIT IAR : STM3210B-SK/IAR Keil :
STM3210B-SK/Keil Raisonance : STM3210B-PRIMER Raisonance : STM3210B-SK/RAIS ST : STM3210B-MCKIT ENSEA (ETIS / ENSEA) Microprocesseurs-
27 Le micro-contrôleur STM32 Le STM32 : Cartes de Développement ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
28 Le micro-contrôleur STM32 Le STM32 : Système d Exploitation Fournisseur Micrium : IAR : Keil : Segger : CMX Systems : RTOS µc/os-ii PowerPac
ARTX-ARM FreeRTOS embos CMX-RTX ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
29 Le micro-contrôleur STM32 Le STM32 : mapping mémoire CortexM3 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
30 Le micro-contrôleur STM32 Le STM32 : mapping mémoire Reserved ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
31 Le micro-contrôleur STM32 Le STM32 : Accès à des bits ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
32 Le micro-contrôleur STM32 Le STM32 : Accès à des bits ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
33 Le micro-contrôleur STM32 Le STM32 : les registres ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
34 Le micro-contrôleur STM32 Le STM32 : le registre xpsr : :20 19:16 15: :0 APSR N Z C V Q IPSR Exception Number EPSR ICI/IT T ICI/IT : :20 19:16 15:
:0 xpsr N Z C V Q ICI/IT T ICI/IT Exception Number ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
35 Les interruptions 4 Les interruptions Réagir aux événements externes ou aux fautes Les interruption du microcontrôleur STM32 Registres
Spéciaux liés aux interruptions Déroulement d une interruption Les priorités Les vecteurs d interruption Fonctionnement des interruptions
Exceptions système Système d exploitation Contrôleur NVIC ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200 Sommaire 1
Présentation 2 Embarquons 3 Le micro-contrôleur STM32
36 Les interruptions Réagir aux événements externes ou aux fautes Evénements externes Evénement externe est asynchrone Impossibilité, en
règle générale, de connaître le moment d apparition de l événement Difficile d inclure son traitement dans le flot synchrone d un programme
Nécessité de méthodes pour capturer cet événement Fautes d exécution tel que division par zéro peuvent être synchrone mais imprédictible ENSEA
37 Les interruptions Réagir aux événements externes ou aux fautes Attente Active Détection d un appui sur un bouton Scrutation périodique
38 Les interruptions Réagir aux événements externes ou aux fautes Attente Active #include <stm32f10x_lib.h> void S2appuye(void) { if (S2presse) {
if (!((GPIOA->IDR & 0x0001) == 0 )) { // S2 n est pas appuyé S2presse = 0; Tempo(500000); } } else { if (((GPIOA->IDR & 0x0001) == 0 )) { // S2 est appuyé
S2presse = 1; Tempo(500000); } } } int main(void) { while(1) { S2appuye(); } } ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
39 Les interruptions Réagir aux événements externes ou aux fautes Attente Active Monopolise du temps processeur inutilement Temps de
réaction à l événement possiblement long Difficilement envisageable dans des systèmes temps réel ENSEA (ETIS / ENSEA) Microprocesseurs-
40 Les interruptions Réagir aux événements externes ou aux fautes Une autre alternative ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
41 Les interruptions Réagir aux événements externes ou aux fautes Interruptions : qu est-ce que c est? C est un événement qui provoque l arrêt de
l exécution normale d un programme : le programme est interrompu la sauvegarde de l état du programme en cours d exécution : le contexte d
exécution l exécution d une routine spécifique liée à cet événement : la routine de service de l interruption la restauration du contexte d exécution
le retour à l exécution du programme interrompu ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
42 Les interruptions Réagir aux événements externes ou aux fautes Interruptions : définitions Interruptions : surviennent de façon asynchrones.
Elles sont commandées par le matériel (interruption externe) ou par le système (interruption système ou exception). Aucune relation avec les
instructions en cours d exécution. Exceptions : déclenchées par des accidents dans l exécution du programme : débordement arithmétique, erreur
de bus, tentative d utilisation d instructions réservées, erreur d adressage, défaut de cache, défaut de page... Gestion Précise : l état du processeur
qui résulterait de l exécution séquentielle de toutes les instructions antérieures à l instruction provoquant l interruption peut être reconstruit dans
tous les cas. Gestion Imprécise : Impossibilité de reconstruction de l état du processeur. ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
43 Les interruptions Les interruption du microcontrôleur STM32 Interruptions STM32 INTERRUPTION ENSEA (ETIS / ENSEA) Microprocesseurs-
44 Les interruptions Les interruption du microcontrôleur STM32 Interruptions STM32 Les interruptions du STM32 sont dites vectorisées A chaque
source d interruption correspond un vecteur d interruption sur 32 bits Le vecteur d interruption contient l adresse de la routine de service de l
interruption Pour l exception système reset, la valeur du vecteur est la valeur initiale du compteur de programme Les vecteurs d interruption sont
contenus dans une table qui est relogeable ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
45 Les interruptions Les interruption du microcontrôleur STM32 Interruptions STM32 Pour la gestion des interruption le microcontrôleur STM32
via le CortexM3 fournit Sauvegarde et restauration automatique du contexte d exécution. Le processeur empile les registres avant de servir l
interruption et les dépile après exécution de la routine de service de l interruption. Pas de nécessité d instruction spécifique, c est automatique et
transparent pour le programmeur. Lecture automatique d une table dite de table de vecteur qui contient les adresses des routines de service des
interruptions. Effectué en parallèle de la sauvegarde de contexte. ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
46 Les interruptions Les interruption du microcontrôleur STM32 Interruption STM32 Le microcontrôleur STM32 a deux types d interruptions : les
exceptions système les interruptions externes numérotées de 0 à 59 le numéro de l interruption en cours de service peut-être connue par le
registre spécial IPSR (Interrupt Program Status Register) le registre ICSR (Interrupt Control State Register) du NVIC (Nested Vectored Interrupt
Controller) dans le champs VECTACTIVE les interruptions ont des priorités permettant d avoir un système préemptif ENSEA (ETIS / ENSEA)
47 Les interruptions Les interruption du microcontrôleur STM32 Liste Numéro Exception Exceptions système Type Priorité Description 1 Reset -3
(Plus élevée) Reset 2 NMI -2 Exception Non Masquable 3 Hard Fault -1 Toutes les exceptions matérielles 4 MemManageFault Programmable
Exception du à la gestion mémoire 5 BusFault Programmable Erreur matérielle du au bus 6 UsageFault Programmable Erreur du au programme 7-
10 Reserved Pas utilisée 11 SVC Programmable Appel système 12 DebugMonitor Programmable Moniteur de mise au point 13 Reserved Pas utilisée
14 PendSV Programmable Requête de service d exception 15 SYSTICK Programmable Timer interne cortex M3 ENSEA (ETIS / ENSEA)
48 Les interruptions Les interruption du microcontrôleur STM32 Interruptions externes Liste Numéro Exception Type Priorité 0 Watchdog
Programmable 1 PVD Programmable 2 TAMPER Programmable DMA2 Channel3 Programmable 59 DMA2 Channel4 5 Programmable ENSEA (ETIS /
49 Les interruptions Les interruption du microcontrôleur STM32 Table Vecteur Complète Position Priority Type of priority Acronym Description
Address ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
52 Les interruptions Registres Spéciaux liés aux interruptions le registre xpsr : :20 19:16 15: :0 APSR N Z C V Q IPSR Exception Number EPSR ICI/IT T
ICI/IT : :20 19:16 15: :0 xpsr N Z C V Q ICI/IT T ICI/IT Exception Number ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
53 Les interruptions Registres Spéciaux liés aux interruptions PRIMASK, FAULTMASK, BASEPRI Nom Valeur Initiale Description PRIMASK 0 Registre 1
bit. Autorise l interruption NMI et les exceptions matérielles. Toutes les autres interruptions sont interdites FAULTMASK 0 Registre 1 bit. Autorise
seulement l interruption NMI. Toutes les autres interruptions sont interdites BASEPRI 0 Registre 8 bits. Défini le niveau de priorité. Permet d
interdire toute interruption de niveau même niveau ou de niveau plus faible. Les interruptions de niveau plus haut sont autorisées. ENSEA (ETIS /
54 Les interruptions Registres Spéciaux liés aux interruptions Registre CONTROL bit Description 1 Etat de la Pile = 0 Pile principale MSP = 1 Pile
alternative 0 = 0 Mode superviseur = 1 Mode utilisateur ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
55 Les interruptions Registres Spéciaux liés aux interruptions Registre CONTROL Superviseur Utilisateur Interruption mode Handler Non Autorisé
CONTROL[1]=0 Programme Principal mode Thread mode Thread CONTROL[0]=0 CONTROL[0]=1 CONTROL[1]=0(1) CONTROL[1]=0(1) ENSEA (ETIS /
56 Les interruptions Déroulement d une interruption Déroulement ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
57 Les interruptions Déroulement d une interruption Déroulement é é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
58 Les interruptions Les priorités Premier Evénement : Demande d affichage d un message de contrôle sur l écran du pilote d un avion de ligne
Seconde Evénement : Extinction d un réacteur de cet avion Il semble qu il soit plus urgent de redémarrer le réacteur que d afficher des informations
ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200 Le besoin de priorités Certains événements provoquant des interruptions
sont plus critiques que d autres
59 Les interruptions Les priorités Le besoin de priorités Nécessité de définir une politique de gestion des priorités Elle doit permettre qu une
interruption plus prioritaire interrompe une interruption moins prioritaire en cours d exécution Elle doit interdire qu une interruption moins
prioritaire interrompe une interruption plus prioritaire en cours d exécution Elle peut fixer des priorités non modifiables Cas du reset par exemple
Pour plus de souplesse de programmation elle doit offrir la possibilité de choisir le niveau de priorité de la plupart des sources d interruption ENSEA
60 Les interruptions Les priorités Schéma des priorités du STM32 Priorités à 3 bits Bit 7 Bit 6 Bit 5 Bit 4 Bit 3 Bit 2 Bit 1 Bit 0 Actifs Inactifs 8 niveaux
de priorités Priorités à 4 bits Bit 7 Bit 6 Bit 5 Bit 4 Bit 3 Bit 2 Bit 1 Bit 0 Actifs Inactifs 16 niveaux de priorités ENSEA (ETIS / ENSEA) Microprocesseurs-
61 Les interruptions Les priorités Registre AIRCR Adresse : 0xE000ED0C Bits Nom Type Valeur Reset Description 31:16 VECTKEY R/W 0x05FA 15
ENDIANNESS R Indique l arrangement des octets : 1 pour Big Endian, 0 pour Little Endian 10:8 PRIGROUP R/W 0 Numéro du groupe de priorités 2
SYSRESETREQ W Requête de contrôle du circuit pour générer un reset 1 VECTCLRACTIVE W Efface toutes les informations sur l état des exceptions 0
VECTRESET W Reset du coeur du processeur CortexM3 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
62 Les interruptions Les priorités Schéma des priorités avec utilisation des groupes de priorités liste Groupe de Priorité Priorité Sous-Priorité
Nombre de Priorités 0 Bit[7:1] Bit[0] Bit[7:2] Bit[1:0] Bit[7:3] Bit[2:0] Bit[7:4] Bit[3:0] Bit[7:5] Bit[4:0] Bit[7:6] Bit[5:0] Bit[7] Bit[6:0] Aucune Bit[7:0]
Nombre de Sous-Priorités ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
63 Les interruptions Les priorités Schéma des priorités avec utilisation des groupes de priorités Priorités à 3 bits avec Groupe de priorité égal à 5
Bit 7 Bit 6 Bit 5 Bit 4 Bit 3 Bit 2 Bit 1 Bit 0 Priorité Sous- Priorité Inactifs 4 niveaux de priorités et 2 niveaux de sous-priorités Priorités à 3 bits avec
Groupe égal à 1 Bit 7 Bit 6 Bit 5 Bit 4 Bit 3 Bit 2 Bit 1 Bit 0 Priorité Priorité toujours à 0 Sous Priorité toujours à 8 niveaux de priorités 0 ENSEA (ETIS /
64 Les interruptions Les priorités Schéma des priorités avec utilisation des groupes de priorités Priorités à 3 bits avec Groupe égal à 1 Bit 7 Bit 6 Bit
5 Bit 4 Bit 3 Bit 2 Bit 1 Bit 0 8 niveaux de priorités Priorité Sous Priorité ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
65 Les interruptions Les vecteurs d interruption Vectorisation dans le STM32 Quand une interruption intervient il est nécessaire d identifier la
bonne routine de service Pour cela il faut déterminer l adresse du programme correspondant à cette routine Cette information est stockée dans
une table des vecteurs d interruption Par défaut cette table est stockée à l adresse 0 Cette table est relogeable via le registre VTOR (Vector Table
Offset Register) La table est organisée en mot de 4 octets (32 bits) L adresse du vecteur d une interruption est calculée en multipliant par 4 son
numéro. ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
66 Les interruptions Les vecteurs d interruption Vecteur Interruption Table des vecteurs d exception après mise sous tension Adresse Numéro
Valeur de l exception 0x Valeur initiale de MSP 0x Valeur initiale du Compteur de Programme (vecteur de Reset) 0x Adresse de la fonction de gestion
de l exception NMI 0x C 3 Adresse de la fonction de gestion de l exception HardFault Autres adresse des fonctions de gestion des exceptions ENSEA
67 Les interruptions Les vecteurs d interruption Registre VTO Adresse 0xE000ED08 Bits Nom Type Valeur initiale Description 29 TBLBASE R/W 0
Base de la table : 0 pour ROM, 1 pour RAM 28:7 TBLOFF R/W 0 Valeur du décalage de la table des vecteurs d exceptions ENSEA (ETIS / ENSEA)
68 Les interruptions Fonctionnement des interruptions Traitement d une interruption Quand une interruption est servie il est réalisé : L
empilement de 8 registres Le chargement du vecteur de la routine d interruption La mise à jour du pointeur de pile, du registre de lien (LR) et du
compteur de programme(pc) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
69 Les interruptions Fonctionnement des interruptions Empilement des registres Empilement des registres R0 à R3,R12,LR, PC et PSR Utilisation de
la Pile utilisateur PSP si le code du programme était exécuté en mode utilisateur Utilisation de la Pile principale MSP si le code du programme était
exécuté en mode superviseur Pendant le service de l interruption dans tous les cas seule la pile principale MSP sera utilisée Pour plus d efficacité les
valeurs de PC et PSR sont les premières à être empilées ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
70 Les interruptions Fonctionnement des interruptions Empilement des registres Adresse Données Ordre d empilement Ancien SP(N) N-4 PSR 2 N-
8 PC 1 N-12 LR 8 N-16 R12 7 N-20 R3 6 N-24 R2 5 N-28 R1 4 Nouveau SP(N-32) R0 3 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
71 Les interruptions Fonctionnement des interruptions Chargement du vecteur d interruption Le bus de données est occupé aux empilements de
registres Sur le bus d instruction est chargé le vecteur d interruption Puisque les deux opérations utilisent deux bus disctinct elles sont réalisées en
parallèle ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
72 Les interruptions Fonctionnement des interruptions Mise à jour des registres Le pointeur de pile (MSP ou PSP) est actualisé après empilement
des registres La partie IPSR du registre d état PSR est mise à jour avec le numéro de l interruption Le compteur de programme est mise à la valeur
de l adresse de la routine de service de l interruption via le vecteur d interruption Le registre de lien LR est mis à jour avec une valeur spéciale
appelée EXC RETURN permettant de gérer les retours d interruption. Les 4 bits de poids faible de ce nouveau LR contiennent l information de
retour. ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
73 Les interruptions Fonctionnement des interruptions Valeur EXC RETURN Bits 31 à Description 0xFFFFFFF Mode de retour Pile de retour 0 Etat
Processus (Thread/Handler) (MSP/PSP) (Thumb/ARM) Valeur Condition 0xFFFFFFF1 Retour à une routine de service d interruption 0xFFFFFFF9 Retour
à un programme principal en mode superviseur 0xFFFFFFFD Retour à un programme principal en mode utilisateur ENSEA (ETIS / ENSEA)
74 Les interruptions Fonctionnement des interruptions Augmenter la réactivité du service des interruptions ENSEA (ETIS / ENSEA)
75 Les interruptions Fonctionnement des interruptions Augmenter la réactivité du service des interruptions ENSEA (ETIS / ENSEA)
76 Les interruptions Fonctionnement des interruptions Déterminer les retours d interruption en mode superviseur ENSEA (ETIS / ENSEA)
77 Les interruptions Fonctionnement des interruptions Déterminer les retours d interruption en mode utilisateur ENSEA (ETIS / ENSEA)
78 Les interruptions Fonctionnement des interruptions Mise en attente interruption ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
79 Les interruptions Fonctionnement des interruptions Mise en attente interruption avec raz avant service ENSEA (ETIS / ENSEA) Microprocesseurs-
80 Les interruptions Fonctionnement des interruptions Requête maintenue lors du début de service de l interruption ENSEA (ETIS / ENSEA)
81 Les interruptions Fonctionnement des interruptions Requête maintenue après service de l interruption ENSEA (ETIS / ENSEA) Microprocesseurs-
82 Les interruptions Fonctionnement des interruptions Requête hoquetante ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne /
200
83 Les interruptions Fonctionnement des interruptions Requête pendant service ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
84 Les interruptions Exceptions système Gestion des exceptions système ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
85 Les interruptions Exceptions système registre BFS Adresse 0xE000ED29 Bits Nom Type Valeur Initiale Description 7 BFARVALID 0 Indique si le
contenu du registre BFAR est valide 6:5 4 STKERR R/Wc 0 Erreur d empilement 3 UNSTKERR R/Wc 0 Erreur de dépilement 2 IMPRECISERR R/Wc 0
Violation d accès aux données imprécis 1 PRECISERR R/Wc 0 Violation d accès aux données précis 0 IBUSERR R/Wc 0 Violation d accès aux
instructions ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
86 Les interruptions Exceptions système registre MMS Adresse 0xE000ED28 Bits Nom Type Valeur Initiale Description 7 MMARVALID 0 Indique si le
contenu du registre MMAR est valide 6:5 4 MSTKERR R/Wc 0 Erreur d empilement 3 MUNSTKERR R/Wc 0 Erreur de dépilement 2 1 DACCVIOL R/Wc 0
Violation d accès aux données 0 IACCVIOL R/Wc 0 Violation d accès aux instructions ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
87 Les interruptions Exceptions système registre UFS Adresse 0xE000ED2A Bits Nom Type Valeur Initiale Description 9 DIVBYZERO 0 Indique si qu
une division par zéro a eu lieu (nécessite que DIV 0 TRP soit positionné) 8 UNALIGNED R/Wc 0 Indique qu un accès aux donnée nonaligné a eu lieu
7:4 3 NOCP R/Wc 0 Indique un essai d exécution d une instruction coprocesseur 2 INVCP R/Wc 0 Indique un essai de retour d exception avec une
valeur erronée du PC 1 INVSTATE R/Wc 0 Indique un essai de changement d état invalide (état ARM) 0 UNDEFINSTR R/Wc 0 Indique un essai d
exécution d une instruction non définie ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
88 Les interruptions Exceptions système registre HFS Adresse 0xE000ED2C Bits Nom Type Valeur Initiale Description 31 DEBUGEVT R/Wc 0 Indique
qu une faute matérielle est déclenché par un événement de debug 30 FORCED R/Wc 0 Indique qu une faute matérielle est déclenchée du à une
faute mémoire, de bus ou d usage 29:2 1 VECTL R/Wc 0 Indique une faute matérielle causée par l échec du chargement de la table des vecteurs d
exception 0 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
89 Les interruptions Système d exploitation Système d exploitation ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
90 Les interruptions Système d exploitation Utilisation de SVC ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
91 Les interruptions Système d exploitation Simple Scénario avc SYSTICK ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
92 Les interruptions Système d exploitation Problème lors d une arrivé d interruption ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
93 Les interruptions Système d exploitation Utilisation de SVC et PendSV ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
94 Les interruptions Contrôleur NVIC Le contrôleur d interruption du STM32 Le STM32 hérite du contrôleur d interruption du CortexM3 Le NVIC
(Nested Vectored Interrupt Controller) Il contrôle les interruptions via des registres de configurations Autorisation ou Interdiction d une source d
interruption Réglage du niveau de priorité des sources d interruption Il contrôle aussi un timer système nommé SYSTICK ENSEA (ETIS / ENSEA)
95 Les interruptions Contrôleur NVIC Fonctionnement de base du NVIC Registres de configuration pour autoriser et interdire les sources d
interruptions Registres de configuration pour positionner ou annuler une demande d interruption Registres de configuration des niveaux de priorité
des sources d interruptions Registre d état d activité des routines de service des interruptions ENSEA (ETIS / ENSEA) Microprocesseurs-
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96 Les interruptions Contrôleur NVIC Registres de configuration d autorisation d interruptions : NVIC ISER0 Adresse Nom Type Valeur Init.
Description 0xE000E100 SETENA R/W 0 Autorisation source interruption numéro 0 à 31 bit[0] pour l interruption numéro 0 (Watchdog) bit[1] pour l
interruption numéro 1 (PVD)... bit[31] pour l interruption numéro 31 (I2C1 EV) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet ENSEA (ETIS / ENSEA)
97 Les interruptions Contrôleur NVIC Registres de configuration d autorisation d interruptions : NVIC ISER1 0xE000E104 SETENA R/W 0 Autorisation
source interruption numéro 32 à 63 bit[0] pour l interruption numéro 32 (I2C1 ER) bit[1] pour l interruption numéro 33 (I2C2 EV)... bit[27] pour l
interruption numéro 59 (DMA2 Channel4 5) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet ENSEA (ETIS / ENSEA) Microprocesseurs-
98 Les interruptions Contrôleur NVIC Registres de configuration d interdiction d interruptions : NVIC ICER0 Adresse Nom Type Valeur Init.
Description 0xE000E180 CLRENA R/W 0 Interdiction source interruption numéro 0 à 31 bit[0] pour l interruption numéro 0 (Watchdog) bit[1] pour l
interruption numéro 1 (PVD)... bit[31] pour l interruption numéro 31 (I2C1 EV) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet ENSEA (ETIS / ENSEA)
99 Les interruptions Contrôleur NVIC Registres de configuration d interdiction d interruptions : NVIC ICER1 Adresse Nom Type Valeur Init.
Description 0xE000E184 CLRENA R/W 0 Interdiction source interruption numéro 32 à 63 bit[0] pour l interruption numéro 32 (I2C1 ER) bit[1] pour l
interruption numéro 33 (I2C2 EV)... bit[27] pour l interruption numéro 59 (DMA2 Channel4 5) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet ENSEA
100 Les interruptions Contrôleur NVIC Registre de demande d interruption : NVIC ISPR0 Adresse Nom Type Valeur Init. Description 0xE000E200
SETPEND R/W 0 Demande d interruption des numéro 0 à 31 bit[0] pour l interruption numéro 0 (Watchdog)... bit[31] pour l interruption numéro 31
(I2C1 EV) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet La lecture indique les demandes en cours ENSEA (ETIS / ENSEA) Microprocesseurs-
101 Les interruptions Contrôleur NVIC Registre de demande d interruption : NVIC ISPR1 Adresse Nom Type Valeur Init. Description 0xE000E204
SETPEND R/W 0 Demande d interruption des numéro 32 à 63 bit[0] pour l interruption numéro 32 (I2C1 ER)... bit[27] pour l interruption numéro 59
(DMA2 Channel4 5) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet La lecture indique les demandes en cours ENSEA (ETIS / ENSEA)
102 Les interruptions Contrôleur NVIC Registre d invalidation de demande d interruption : NVIC ICPR0 Adresse Nom Type Valeur Init. Description
0xE000E280 CLRPEND R/W 0 Invalidation demande d interruption des numéro 0 à 31 bit[0] pour l interruption numéro 0 (Watchdog)... bit[31] pour l
interruption numéro 31 (I2C1 EV) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet La lecture indique les demandes en cours ENSEA (ETIS / ENSEA)
103 Les interruptions Contrôleur NVIC Registre d invalidation de demande d interruption : NVIC ICPR1 Adresse Nom Type Valeur Init. Description
0xE000E284 CLRPEND R/W 0 Invalidation demande d interruption des numéro 32 à 63 bit[0] pour l interruption numéro 32 (I2C1 ER)... bit[27] pour l
interruption numéro 59 (DMA2 Channel4 5) Ecrire 1 pour autoriser - Ecrire 0 n a aucun effet La lecture indique les demandes en cours ENSEA (ETIS /
104 Les interruptions Contrôleur NVIC Registre de priorité des interruptions : NVIC IPR0 Adresse Nom Type Valeur Init. Description 0xE000E400
IP[0] R/W 0(8bits) Niveau de priorité de l interruption numéro 0 (Watchdog) IP[1] R/W 0(8bits) Niveau de priorité de l interruption numéro 1 (PVD)
IP[2] R/W 0(8bits) Niveau de priorité de l interruption numéro 2 (TAMPER) IP[3] R/W 0(8bits) Niveau de priorité de l interruption numéro 3 (RTC) NVIC
IPR0, NVIC IPR1 à NVIC IPR14 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
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IP[32] R/W 0(8bits) Niveau de priorité de l interruption numéro 32 (I2C1 ER) IP[33] R/W 0(8bits) Niveau de priorité de l interruption numéro 33 (I2C1
EV) IP[34] R/W 0(8bits) Niveau de priorité de l interruption numéro 34 (I2C1 ER) IP[35] R/W 0(8bits) Niveau de priorité de l interruption numéro 35
(SPI1) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
IP[56] R/W 0(8bits) Niveau de priorité de l interruption numéro 56 (DMA2 Channel1) IP[57] R/W 0(8bits) Niveau de priorité de l interruption numéro
57 (DMA2 Channel2) IP[58] R/W 0(8bits) Niveau de priorité de l interruption numéro 58 (DMA2 Channel3) IP[59] R/W 0(8bits) Niveau de priorité de l
interruption numéro 59 (DMA2 Channel4 5) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
107 Les interruptions Contrôleur NVIC Registre d activité des interruptions : NVIC IABR0 Adresse Nom Type Valeur Init. Description 0xE000E300
ACTIVE R 0 Etat d activité des interruptions 0 à 31 bit[0] pour l interruption numéro 0 (Watchdog)... bit[31] pour l interruption numéro 31 (I2C1 EV)
108 Les interruptions Contrôleur NVIC Registre d activité des interruptions : NVIC IABR1 Adresse Nom Type Valeur Init. Description 0xE000E304
ACTIVE R 0 Etat d activité des interruptions 32 à 59 bit[0] pour l interruption numéro 32 (I2C1 ER)... bit[27] pour l interruption numéro 59 (DMA2
Channel4 5) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
109 Exemple de périphériques Sommaire 1 Présentation 2 Embarquons 3 Le micro-contrôleur STM32 4 Les interruptions 5 Exemple de
périphériques Le convertisseur Analogique-Numérique Le DMA : Direct Memory Acces Les Timers L édition de lien ENSEA (ETIS / ENSEA)
110 Exemple de périphériques Le convertisseur Analogique-Numérique Convetisseur Analogique Numérique ou ADC (Analog Digital Conversion)
111 Exemple de périphériques Le convertisseur Analogique-Numérique ADC : Définitions Signal continu Signal échantillonné Signal quantifié ENSEA
112 Exemple de périphériques Le convertisseur Analogique-Numérique ADC : Caractéristiques Résolution : Amplitude de la plus petite variation.
Correspond au LSB (Least Significant Bit) Temps de conversion : Temps de stabilisation de la donnée en sortie Erreur de Quantification : Incertitude
du à la conversion Pleine Echelle : Etendue de la grandeur Analogique d entrée ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne /
200
113 Exemple de périphériques Le convertisseur Analogique-Numérique ADC : Types Il exite différents type de conversion La conversion à rampe La
conversion à double rampe La conversion à approximation successive La conversion Flash La conversion Sigma-Delta ENSEA (ETIS / ENSEA)
114 Exemple de périphériques Le convertisseur Analogique-Numérique La conversion à approximations successives Vin - + Registre CNA Horloge N
Controle ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
115 Exemple de périphériques Le convertisseur Analogique-Numérique La conversion à approximations successives Détermination des valeurs de
bits de N les unes après les autres en commençant par le bit de poids fort On fixe le bit de poids fort à 1 et les autres à 0. Conversion NA du registre
et comparaison à V in Si V in est plus grand alors le bit reste à 1 sinon il passe à 0. On garde la valeur du bit de poids fort et on passe au bit suivant
On refait le même traitement que précédemment pour ce bit et ainsi de suite jusqu au bit de poids faible. ENSEA (ETIS / ENSEA) Microprocesseurs-
116 Exemple de périphériques Le convertisseur Analogique-Numérique La conversion à approximations successives Exemple : Convertisseur 8 bits,
V ref =10 V Tension à convertir 6,92 V = 5V < 6, 92 B 7 = = 7, 5V > 6, 92 B 6 = = 6, 25V < 6, 92 B 5 = = 6, 675V < 6, 92 B 4 = = 7, 1875V > 6, 92 B 3 = = 7,
03125V > 6, 92 B 2 = = 6, 95312V > 6, 92 B 1 = = 6, 91406V < 6, 92 B 0 = 1 Valeur Numérique : ENSEA (ETIS / ENSEA) Microprocesseurs-
117 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Caractéristiques Principales Résolution de 12 bits Interruption
de fin de conversion Mode simple conversion ou conversion continue Mode de balayage multi-canal Auto-Calibration Alignement des données sur
16 bits (droite ou gauche) Temps de conversion programmable canal par canal Déclenchement par signal externe Mode de conversion discontinue
lors de balayage Chainage de convertisseur (si le circuit en possède au moins 2) Tension requise entre 2,4 V et 3,6V Plage de conversion entre V ref V
in V ref + Requête DMA pour la conversion régulière ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
118 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Schéma ENSEA (ETIS / ENSEA) Microprocesseurs-
119 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Mise sous tension Mise sous
tension via la mise à 1 du bit ADON (registre CR2 de l ADC) La première mise à 1 du bit ADON met sous tension l ADC La seconde mise à 1 du bit
ADON démarre la conversion La mise hors tension et l arrêt de la conversion s effectue en mettant à 0 le bit ADON En mode hors tension l ADC ne
consomme que quelques µa Horloge l horloge ADCCLK du convertisseur est synchrone avec celle du bus APB2, l horloge PCLK2 Il est possible de
programmer un prédiviseur, par rapport à PCLK2, pour l horloge ADCCLK dans le contrôleur RCC ENSEA (ETIS / ENSEA) Microprocesseurs-
120 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Sélection des Canaux Il y a 16
canaux de conversions multiplexés Organisation possible en deux groupes : réguliers et injectés Un groupe est une séquence de conversions (16 au
plus pour réguliers, 4 au plus pour injectés) Une séquence peut-être réalisée dans un ordre aléatoire Le nombre de conversions, l ordre de
conversion sont fixés via les registres SQRx et JSQR Capteur de Température/Tension Un capteur de température interne est connecté au canal 16
Une tension V refint interne est connectée au canal 17 Accessible avec l ADC1 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne /
200
121 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Mode Simple Conversion Bit CONT
à 0 (registre CR2) Démarrage par bit ADON uniquement pour groupe réguliers Une fois le canal converti La donnée convertie est stockée dans le
registre 16bits DR Le drapeau EOC est positionnée Une interruption est générée si le bit EOCIE est à 1 Mode Conversion Continue Bit CONT à 1
(registre CR2) Démarrage par bit ADON uniquement pour groupe réguliers Une fois le canal converti La donnée convertie est stockée dans le
registre 16bits DR Le drapeau EOC est positionnée Une interruption est générée si le bit EOCIE est à 1 ENSEA (ETIS / ENSEA) Microprocesseurs-
122 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Diagramme Temporel Simple
Conversion è à é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
123 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Balayage Multi-Canaux Bit SCAN à 1
(registre CR1) Conversion des canaux sélectionnés via les registres SQRx et JSQR Une conversion est effectuée pour chaque canal du groupe Après la
fin de conversion d un canal, le canal suivant est directement traité Nécessité d utiliser le DMA pour récupérer les données Une interruption est
générée, si EOCIE est à 1, après la dernière conversion Mode Discontinu Bit DISCEN à 1 (registre CR1) Conversion d un sous ensemble de canaux d
un groupe Taille du sous ensemble n 8 Taille spécifiée via les bits DISCNUM[2:0] (registre CR1) Piloté par un événement externe Lors de l
événement, conversion des n canaux parmi le groupe Exemple : n = 3, groupe canal=[0,1,2,3,6,7,9,10] 1 er événement, conv. des canaux [0,1,2] 2
ieme événement, conv. des canaux [3,6,7] 3 ieme événement, conv. des canaux [9,10] et EOC ENSEA (ETIS / ENSEA) Microprocesseurs-
Microcontrôleurs Automne / 200 ieme
124 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Calibration Procédure d auto-
calibration Réduction des erreurs de précision du aux variations des capacités internes Calcul de l erreur pour chaque capacité Démarrage par mise
à 1 du bit CAL (registre CR2) Remise à zéro automatique du bit CAL après calibration Procédure recommandée à la mise sous tension de l ADC
Alignement des Données Bit ALIGN (registre CR2) Alignement à droite si ALIGN = 0 Alignement à gauche si ALIGN = 1 ENSEA (ETIS / ENSEA)
125 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Temps de Conversion
Echantillonage sur n ADCCLK cycles n modifiable bits SMPx[2:0] pour le canal x (registres SMPR1 et SMPR2) Différenciation du temps par canal
Temps Total T conv = Tps Echant.+12, 5 cycles Déclenchement externe Conversion pilotable par événement externe Entrée EXTI bit EXTTRIG à 1
(registre CR2) bits EXTSEL[2:0] pour sélectionner le type de l événement ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
126 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Source de l événement Type Valeur
EXTSEL[2:0] TIM1 CC1 Interne 000 TIM1 CC2 Interne 001 TIM1 CC3 Interne 010 TIM2 CC2 Interne 011 TIM3 TRGO Interne 100 TIM4 CC4 Interne 101
EXTI line11/tim8 TRGO Externe/Interne 110 SWSTART Logiciel 111 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
127 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Description Fonctionnelle Requête DMA Résultat de la
conversion pour groupe régulier stocké dans un unique registre DR Eviter la perte des données EOC d un canal génère une requête DMA
permettant le transfert du registre DR en mémoire Emplacement mémoire spécifié par l utilisateur Interruptions de l ADC Possibilité de générer une
interruption à la fin de la conversion Autorisation par bit EOCIE (groupe régulier) ou JEOCIE (groupe injecté) Les interruption de l ADC1 et ADC2 sont
mappées sur le même vecteur d interruption ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
128 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre Horloge RCC CFGR, Adresse Base ADC1 = 0x , Offset =
0x04, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
129 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre Horloge RCC APB2ENR, Adresse Base ADC1 = 0x ,
Offset = 0x18, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
130 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre SR, Adresse Base ADC1 = 0x , Offset = 0x00, Valeur
Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
131 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre CR1, Adresse Base ADC1 = 0x , Offset = 0x04, Valeur
Initiale = 0x CR2, Adresse Base ADC1 = 0x , Offset = 0x08, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne /
200
132 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre SMPR1, Adresse Base ADC1 = 0x , Offset = 0x0C,
Valeur Initiale = 0x SMPR2, Adresse Base ADC1 = 0x , Offset = 0x10, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
133 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre SQR1, Adresse Base ADC1 = 0x , Offset = 0x2C, Valeur
Initiale = 0x SQR2, Adresse Base ADC1 = 0x , Offset = 0x30, Valeur Initiale = 0x SQR3, Adresse Base ADC1 = 0x , Offset = 0x34, Valeur Initiale = 0x
134 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre DR, Adresse Base ADC1 = 0x , Offset = 0x4C, Valeur
Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
135 Exemple de périphériques Le convertisseur Analogique-Numérique ADC STM32 : Registre Autres Registres JOFR1, JOFR2, JOFR3, JOFR4 Offset
pour groupe injecté. A soustraire de la valeur convertie HTR, LTR Seuils Haut (HTR) et Bas (LTR) des tensions pour le watchdog JSQR Nombre de
conversion en groupe injecté JDR1, JDR2, JDR3, JDR4 Données lors de conversion groupe injecté ENSEA (ETIS / ENSEA) Microprocesseurs-
136 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Caractéristiques Principales 12 canaux indépendants, 7 pour DMA1 et 5
pour DMA2 Connectés sur les périphériques du STM32 Priorités programmables entre canaux Adressage circulaire supporté 3 événements possible
: demi-transfert DMA, transfert complet DMA et erreur de transfert Transferts mémoire-mémoire, périphérique-périphérique Transferts
périphérique-mémoire, mémoire-périphérique Nombre de données à transférer programmable jusqu à ENSEA (ETIS / ENSEA) Microprocesseurs-
137 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Description fonctionnelle le DMA réalise des transferts directs en
mémoire en partageant le bus Système avec le Cortex-M3 Après un événement (fin de conversion par exemple) le périphérique envoie une requête
au DMA Le DMA traite la requête en fonction de la priorité du canal lié Le transfert s effectue suivant 3 étapes : Chargement de la donnée à
transférer. Adresse spécifiée par le registre DMA CPARx (périphérique) ou DMA CMARx (mémoire) Sauvegarde de la donnée transférée. Adresse
spécifiée par le registre DMA CPARx (périphérique) ou DMA CMARx (mémoire) Décrémentation du registre contenant le nombre de transferts à
réaliser DMA CNDTRx ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
138 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Contrôleur Peripheral request signals Fixed hardware priority ENSEA
139 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Canaux DMA1 Peripherals Channel 1 Channel 2 Channel 3 Channel 4
Channel 5 Channel 6 Channel 7 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
140 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Canaux DMA2 Peripherals Channel 1 Channel 2 Channel 3 Channel 4
Channel 5 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
141 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Registre ISR, Adresse Base DMA1 = 0x , Offset = 0x00, Valeur Initiale =
0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
142 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Registre CCRx, Adresse Base DMA1 = 0x , Offset = 0x d * Numéro Canal,
Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
143 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Registre CNDTRx, Adresse Base DMA1 = 0x , Offset = 0x0C + 20d *
Numéro Canal, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
144 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Registre CPARx, Adresse Base DMA1 = 0x , Offset = 0x d * Numéro
Canal, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
145 Exemple de périphériques Le DMA : Direct Memory Acces DMA STM32 : Registre CMARx, Adresse Base DMA1 = 0x , Offset = 0x d * Numéro
Canal, Valeur Initiale = 0x ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
146 Exemple de périphériques Les Timers Timer STM32 : Caractéristiques Générales Compteur/Décompteur 16 bits rechargeable
automatiquement. Prédiviseur 16 bits programmable Jusqu à 4 canaux indépandant permettant : La capture d événements La comparaison avec le
compteur Un mode PWM (Pulse Width Modulation) Mode one-pulse Circuit de synchronisation externe et chainage des différents timers possible
Génération d Interruption ou de requête DMA sur différents événements : Recyclage du compteur, initialisation du compteur Déclenchemebt (Start,
Stop, initialisation ou déclenchement interne/externe) Capture d événement Comparaison ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
147 Exemple de périphériques Les Timers Timer STM32 : Schéma Fonctionnel Internal Clock (CK_INT) ETRF ETRP ETR TRGO ITR0 ITR1 TGI ITR ITR2
TRC TRGI ITR3 TI1F_ED Diviseur de Fréquence TI3 TI1 TI2 TI4 TI1FP1 TI1FP2 TRC TI2FP1 TI2FP2 TRC TI3FP3 TI3FP4 TRC TI4FP3 TI4FP4 TRC IC1 IC2 IC3
IC4 TI1FP1 TI2FP2 U CC1I U IC1PS IC2PS IC3PS IC4PS CC2I U CC3I U CC4I U PSC +/- CNT ETRF U UI CC1I OC1REF CC2I OC2REF CC3I OC3REF CC4I
OC4REF Compteur OC1 OC2 OC3 OC4 U Analyse signaux entrée (détection événements) Génération de signaux de sortie Capture du timer ENSEA
148 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Unité de base Fonctionnement Le composant principal : un
compteur 16 bits Mode décompteur/compteur - Auto chargement Prédiviseur de l horloge du compteur Les registres Registre du compteur : TIMx
CNT Registre du prédiviseur : TIMx PSC Registre d auto chargement : TIMx ARR Le registre d auto-chargement (ARR) est préchargé Lire ou écrire
dans le registre d auto-chargement revient à accéder au registre de préchargement Le contenu du registre de préchargement est transférer dans le
registre d auto-chargement (Shadow) soit de façon permanente ou à chaque événement de mise à jour (bit UEV) en fonction du bit ARPE dans le
registre CR1 L événement de mise à jour est généré quand le compteur recycle (ou logiciellement) et que le bit UDIS du registre CR1 est à 0 ENSEA
149 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Prédiviseur Le compteur est piloté par une horloge prédivisé CK
CNT Cette horloge est activée uniquement si le bit CEN du registre CR1 est à 1 Remarque : le signal CNT EN relié à CK CNT passe à 1 après 1 cycle d
horloge suite à la mise à 1 du bit CEN. Il peut diviser l horloge d un facteur compris entre 1 et C est un compteur 16 bits contrôler par le registre 16
bits PSC Sa valeur peut être changée au fil de l eau elle sera alors prise en compte au prochain événement de mise à jour Mode compteur Bit CMS =
00 et bit DIR = 0 (registre CR1) Dans ce mode le compteur compte de 0 à la valeur du registre d auto-chargement (registre ARR) Arrivée à la valeur du
registre ARR il recycle en redémarrant un cycle de comptage de 0 Au recyclage un événement de dépassement de capacité est généré (Overflow) Un
événement de mise à jour peut être généré à chaque recyclage ou en positionnant le bit UG du registre EGR ENSEA (ETIS / ENSEA)
150 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Compteur Mode compteur - Mise à jour L événement de
mise à jour peut être désactivé via le bit UDIS du registre CR1 Si le bit URS (registre CR1) est à 1, positionner le bit UG génére un événement de mise
à jour sans générer d interruption Quand un événement de mise à jour survient, tous les registres sont mise à jour et le bit d interruption IUF du
registre SR est mis à 1 en fonction de la valeur du bit URS. Le registre tampon du prédiviseur est rechargé avec la valeur du registre PSC Le registre d
auto-chargement est rechargé avec la valeur du registre ARR ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
151 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Compteur Prédivision par 1 Mode compteur Prédivision
par 2 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
152 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Compteur Prédivision par 4 Mode compteur Prédivision
par N ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
153 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Compteur UEV quand ARPE=0 Mode compteur UEV quand
ARPE=1 ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
154 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Compteur - Changement Prédivision de 1 à 2 ENSEA (ETIS /
155 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode décompteur Bit CMS = 00 et bit DIR = 0 (registre CR1) Idem
mode compteur sauf que comptage de la valeur du registre de pré-chargement à 0 Mode Alterné Bit CMS = 01, 10 ou 11 (registre CR1) Dans un
premier temps mode compteur de 0 à valeur d auto-chargement Puis recyclage Dans un second temps mode décompteur de valeur d auto-
chargement à 0 Puis recyclage et reprise en mode compteur et ainsi de suite ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne /
200
156 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Décompteur - Prédivision par 1 ENSEA (ETIS / ENSEA)
157 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Mode Alterné - ARR = 6 ENSEA (ETIS / ENSEA) Microprocesseurs-
158 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Sélection d horloge Sélection d horloge L horloge du compteur
peut provenir de L horloge interne par défaut CK INT qui est générée par : HSI par défaut Oscillateur 8 MHz (bits SW = 00 registre CFGR unité CRR)
HSE oscillateur externe (bits SW = 01 registre CFGR unité CRR) PLL (bits SW = 10 registre CFGR unité CRR) Une première horloge externe sur une
broche TIx Une seconde horloge externe sur une entrée de déclenchement ETR Un signal de déclenchement interne (ITRx) utilisant un timer comme
prédiviseur pour un autre timer. Par exemple le Timer1 sert de prédiviseur au Timer2. Sélection de CK INT quand le champs SMS=000 dans le
registre SMCR Sélection première horloge externe quand SMS=111 Sélection seconde horloge externe quand ECE=1 dans le registre SMCR ENSEA
159 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Arbre d Horloge du STM32 Legend: ENSEA (ETIS / ENSEA)
160 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Arbre d Horloge du bus APB1 ENSEA (ETIS / ENSEA)
161 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Arbre d Horloge des Timerx - HSI - Horloge par Défaut ENSEA
162 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Arbre d Horloge des Timerx - HSE ENSEA (ETIS / ENSEA)
163 Exemple de périphériques Les Timers TIMx STM32 : Description Fonctionnelle Sélection d horloge Sélection d horloge ENSEA (ETIS / ENSEA)
164 Exemple de périphériques Les Timers TIMx STM32 : Registre Horloge RCC CFGR, Adresse Base RCC = 0x , Offset = 0x04, Valeur Initiale = 0x
165 Exemple de périphériques Les Timers TIMx STM32 : Registre Horloge RCC APB1ENR, Adresse Base RCC = 0x , Offset = 0x1C, Valeur Initiale = 0x
166 Exemple de périphériques Les Timers TIMx STM32 : Registre CR1, Adresse Base TIM2 = 0x , Offset = 0x00, Valeur Initiale = 0x0000 ENSEA (ETIS /
169 Exemple de périphériques Les Timers TIMx STM32 : Registre DIER, Adresse Base TIM2 = 0x , Offset = 0x0C, Valeur Initiale = 0x0000 ENSEA (ETIS
/ ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
170 Exemple de périphériques Les Timers TIMx STM32 : Registre SR, Adresse Base TIM2 = 0x , Offset = 0x10, Valeur Initiale = 0x0000 ENSEA (ETIS /
171 Exemple de périphériques Les Timers TIMx STM32 : Registre EGR, Adresse Base TIM2 = 0x , Offset = 0x14, Valeur Initiale = 0x0000 ENSEA (ETIS /
172 Exemple de périphériques Les Timers TIMx STM32 : Registre CNT, Adresse Base TIM2 = 0x , Offset = 0x24, Valeur Initiale = 0x0000 ENSEA (ETIS /
173 Exemple de périphériques Les Timers TIMx STM32 : Registre PSC, Adresse Base TIM2 = 0x , Offset = 0x28, Valeur Initiale = 0x0000 ENSEA (ETIS /
174 Exemple de périphériques Les Timers TIMx STM32 : Registre ARR, Adresse Base TIM2 = 0x , Offset = 0x2C, Valeur Initiale = 0x0000 ENSEA (ETIS /
175 Exemple de périphériques Les Timers Capture Compare TIMx STM32 : Description Fonctionnelle Après le minuteur Les unités TIMx du STM32
ont hormis le mode minuteur basique deux autres mode d utilisation : Le mode Capture-Compare. Dans ce mode il est possible d une part de
capturer en fonction d un événement la valeur du compteur du Timer, d autre part de comparer la valeur du compteur à une valeur préalablement
charger dans le registre Capture-Compare. Le mode PWM : Pulse Width Modulation, qui permet de générer des signaux périodiques ayant un
rapport cyclique variable. Ces fonctions sont mises en œuvre à l aide de 4 canaux indépendants. ENSEA (ETIS / ENSEA) Microprocesseurs-
176 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc d entrée Echantillonage de l entrée TIx correspondant au canal (TI1
pour le canal1) Filtrage de cette entrée pour créer le signal TIxF Génération d un signal TIxFPx après détection de front et sélection de polarité. Le
signal TIxFPx peut être utilisé comme un déclencheur ou comme une commande de capture. Il est prédivisé avant d être envoyé vers le registre de
capture (ICxPS) ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
177 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc d entrée éé TI1F_ED to the slave mode controller TI1F_Rising TI1 0
filter TI1F Edge TI1FP1 01 f DTS downcounter Detector TI1F_Falling 1 TI2FP1 IC1 divider IC1PS 10 /1, /2, /4, /8 ICF[3:0] CC1P TRC 11 TIMx_CCMR1
TIMx_CCER (from slave mode controller) TI2F_rising 0 (from channel 2) CC1S[1:0] ICPS[1:0] CC1E TI2F_falling 1 (from channel 2) TIMx_CCMR1
TIMx_CCER ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
178 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc Principal Le bloc principal est composé : d un registre
capture/compare de préchargement d un registre capture/compare fantôme Les accès en lecture et écriture s effectue dans le registre
capture/compare de préchargement En mode capture, les captures s effectue dans le registre capture/compare fantôme, qui est ensuite copié dans
le registre capture/compare de préchargement En mode compare, le contenu du registre capture/compare de préchargement est copié dans le
registre capture/compare fantôme qui est ensuite comparé au compteur Le registre capture/compare est nommé TIM CCRx ENSEA (ETIS / ENSEA)
179 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc Principal é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
180 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc de sortie Dans le bloc de sortie est généré un signal intermédiaire
OCxRef OCxRef est actif à l état haut Il est utilisé comme référence La polarité intervient en bout de chaîne. ENSEA (ETIS / ENSEA) Microprocesseurs-
181 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Bloc de sortie é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
182 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Capture En mode capture, le registre TIMx CCRx copie la valeur du
compteur après la détection d une transition sur le signal ICx Quand une capture est réalisée, le drapeau correspondant CCxIF du registre TIMx SR
est mis à 1 Une interruption ou une requête DMA peut être prise en compte si elle est autorisée (bits CCxIE et CCxDE du registre TIMx DIER). Si une
capture intervient alors que le drapeau CCxIF est à 1, alors le drapeau CCxOF (over-capture) du registre TIM SR est mis à 1. Le drapeau CCxIF est mis
à 0 soit par logiciel, soit en lisant la valeur du registre TIMx CCR. Le drapeau CCxOF est mis 0 par logiciel. ENSEA (ETIS / ENSEA) Microprocesseurs-
183 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Capture é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
184 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Compare Mode utilisé pour contrôler un signal de sortie ou indiqué une
échéance temporelle. Quand une correspondance est trouvée entre le registre de capture/compare et le compteur La sortie correspondante
(dépendant du canal) est mise à une valeur définie par le mode de comparaison (les bits OCxM du registre TIMx CCMRx) et la polarité de sortie (le
bit CCxP du registre TIMx CCER) Le bit d interruption CCxIF du registre TIMx SR est mis à 1 L interruption est prise en compte si le bit CCxIE du
registre TIMx DIER est à 1 Une requête DMA est générée sur le bit CCxDE du registre TIMx DIER et le bit CCDS du registre TIMX CR2 sont à 1. ENSEA
185 Exemple de périphériques Les Timers Capture Compare TIMx STM32 Compare é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs
Automne / 200
186 Exemple de périphériques Les Timers Capture Compare TIMx STM32 PWM Ce mode permet de générer un signal périodique de fréquence fixé
par le registre TIMx ARR et de rapport cyclique fixé par le registre TIMx CCRx. Les 4 canaux peuvent être indépendamment initialisés dans ce mode
en mettant les valeurs 110 ou 111 dans les bits OCxM du registre TIMx CCMRx. Il faut autoriser la sortie via le bit OCxPE du registre TIMx CCMRx
Possibilité d utiliser le mode Capture pour spécifier la valeur de la fréquence et du rapport cyclique ENSEA (ETIS / ENSEA) Microprocesseurs-
187 Exemple de périphériques Les Timers Capture Compare TIMx STM32 PWM - Mode Comptage ENSEA (ETIS / ENSEA) Microprocesseurs-
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189 Exemple de périphériques Les Timers Capture Compare TIMx STM32 PWM - Capture Fréquence et Rapport Cyclique ENSEA (ETIS / ENSEA)
190 Exemple de périphériques 2 I C/SPI L édition de lien Chaine de Développement Microcontroller Development Kit (MDK) n Best-in-class ARM
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provides a wide range of evaluation boards for 8, 16 and 32-bit devices ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
191 Exemple de périphériques L édition de lien Chaine de Compilation é é ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
192 Exemple de périphériques L édition de lien Editeur de lien Crée les liens entre les différents fichiers objets Résoud les références Génére les
adresses finales de variables et fonction S appuie sur un fichier de description du mappage entre la mémoire et les données (fonctions et variables)
193 Exemple de périphériques L édition de lien Editeur de Lien ENSEA (ETIS / ENSEA) Microprocesseurs-Microcontrôleurs Automne / 200
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