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Compteurs asynchrones
Exercice 1
Exercice 2
Exercice 3
Exercice 1
Exercice 2
Exercice 3
Compteurs synchrones
Rappel :
Table de vérité d’une bascule JK
J K Q
0 0 Q0
0 1 0
1 0 1
1 1 ̅
Pour réaliser des compteurs synchrones à base des bascules JK, on utilise la table
suivante :
Qn Qn+1 J K
0 0 0 x
0 1 1 x
1 0 x 1
1 1 x 0
Q3 Q2 Q1 Q0 J3 K3 J2 K2 J1 K1 J0 K0
état actuel 1 0 1 0 x 0 0 x 0 x 1 x
état suivant 1 0 0 1
Table de vérité d’une bascule D
Dn Qn+1
0 0 Qn+1 = Dn
1 1
Exemple : passage de l’état actuel à l’état suivant
Q3 Q2 Q1 Q0 D3 D2 D1 D0
Etat actuel 1 0 1 0 1 0 0 1
Etat suivant 1 0 0 1
Exercice 1
En utilisant les bascules JK, étudier et donner les schémas des compteurs suivants :
→ 0 → 3 → 5 → 7→10 → 12→
Exercice 2
En utilisant les bascules D à front montant d’horloge, étudier et donner les schémas
des compteurs suivants :
Exercice 3
QD QC QB QA JD KD JC KC JB KB JA KA
0 0 0 0
Exercice 4
QC QB QA JC KC JB KB JA KA
0 0 0
Registres à décalage
Exercice 1
Etat de l’interrupteur I H Q0 Q1 Q2 Q3
fermé X
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
Etat de l’interrupteur I H Q0 Q1 Q2 Q3
fermé X
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
ouvert ↑
Exercice 2
Exercice 3
1. Donner l’équation de Y
2. Si S = 0, donner Y.
3. Si S = 1, donner Y.
4. Quelle est la fonction réalisée ?
On veut réaliser un registre à décalage 4 bits a entrée parallèle ou série et sortie série.
S Fonction Equation
0 Décalage à droite Di = Qi-1 (D0 = Es)
1 Chargement parallèle Di = Ei iЄ{0,1,2,3}
Exercice 4
X Y Fonction
0 0
1 1
0 1
H0 est une horloge manuelle. Chaque fois qu’on pousse et on relâche le bouton
poussoir, on obtient une impulsion d’horloge. Compléter le tableau suivant :
H0 X Y Fonction
Etat initial (bouton relâché) 1 0 0
↑
↑
↑
Rappel :
Connexions Mémoires -Unité Centrale de Traitement (UCT)
Définitions
Espace adressable :
C’est le nombre de mots mémoire adressables par un bus d’adresses de n bits = 2n mots
mémoire (adresses).
Plage d’adresses : c’est le champ d’adresses occupé par un circuit (boîtier) mémoire de
l’adresse minimale (adresse basse) à l’adresse maximale (adresse haute).
Exemple :
N. ROUSSAFI electroussafi.ueuo.com Mémoires et décodage d'adresses
electroussafi.ueuo.com 2/6
Décodeur d’adresses
Le décodeur d’adresses a pour fonction de générer des signaux pour la sélection des
différents boîtiers avec lesquels le processeur doit communiquer. Pour éviter que deux
boîtiers répondent simultanément et créent alors un conflit sur les bus, chaque boîtier doit
répondre à une plage d’adresses différente des autres boîtiers (on affecte à chaque boîtier
une plage d’adresses différente des autres boîtiers).
Exemple
On désire construire une mémoire de 1Ko à partir de 2 boîtiers de 512 octets chacun.
Pour les 2 circuits; on aura donc une capacité totale de 1024 (2 10) octets c'est à dire une
plage d'adresses de 0 (adresse minimale) à 1023 (adresse maximale). Pour adresser toute la
plage d'adresses il nous faut un bus d'adresses de 10 lignes (A0 - A9). La ligne d'adresse
(A9) servira à sélectionner un boîtier parmi les deux.
Le tableau d'adressage :
On place un x pour toutes les lignes d’adresses non utilisées pour la sélection du boîtier.
L’adresse minimale est obtenue en supposant que tous les x sont à un niveau 0. Pour
l’adresse maximale, les x représentent des niveaux 1.
Exercice 1
A0-A12 Address
̅̅̅̅ Chip Enable
̅̅̅̅ Output Enable
D0-D7 Outputs
2. Quelles sont les lignes de bus de commande (contrôle) de ces deux mémoires.
Exercice 2
- Le plus grand nombre hexadécimal pouvant être placé dans un mot mémoire est :
FFFF
Exercice 3