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Comprendre cest quoi une mmoire Comprendre le rle et la structure dune mmoire centrale. Apprendre concevoir une mmoire centrale ( modulaire et entrelace ).
1. Introduction
Avec une bascule cest possible de mmoriser une information sur 1 seul bit. Avec un registre cest possible de mmoriser une information sur n bits. Si on veut mmoriser une information de taille important il faut utiliser une mmoire .
UC Processeur
Mmoire Centrale
(addition, soustraction, multiplication, . . .) du processeur chaque top dhorloge. - Lunit de commande contrle les oprations sur la mmoire (lecture/criture) et les oprations raliser par lUAL selon linstruction en cours dexcution. Pour pouvoir effectuer les oprations sur des donnes et excuter des programmes lUC doit disposer dun espace de travail . Cette espace de travail sappel la mmoire centrale.
Exemple de mmoire :
La mmoire centrale Un disque dure Une disquette Un flash disque ..
La mmoire peut tre dans le processeur ( des registres) , interne (Mmoire centrale ou principale) ou externe (Mmoire secondaire ).
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Demande de la lecture
Le temps daccs est un critre important pour dterminer les performances dune mmoire ainsi que les performances dune machine. 10
5. Mmoire semi-conducteur
Mmoire semi-condeucteurs
vives
Mortes
Statiques
Dynamiques
Associatives
ROM
PROM
EPROM
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La mmoire centrale
Cest lorgane principal de rangement des informations utilises par le processeur.
Dans une machine (ordinateur / calculateur) pour excuter un programme il faut le charger ( copier ) dans la mmoire centrale . Le temps daccs la mmoire centrale et sa capacit sont deux lments qui influent sur le temps dexcution dun programme ( performance dune machine ).
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D E C
Bus dadresse
R A M
O D E U R E
Structure interne
RIM
K bits
K bits
Exemple : Dans une mmoire la taille du bus dadresses K=14 et la taille du bus de donnes n=4. Calculer la capacit de cette mmoire ? C=214 = 16384 Mots de 4 bits C= 214 * 4 = 65536 Bits = 8192 Octets = 8 Ko
n bits
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Pour lire une information en mmoire centrale il faut effectuer les oprations suivantes: Charger dans le registre RAM ladresse du mot lire. Lancer la commande de lecture ( R/W=1) Linformation est disponible dans le registre RIM au bout dun certain temps ( temps daccs)
Pour crire une information en MC il faut effectuer les oprations suivantes: Charger dans le RAM ladresse du mot ou se fera lcriture. Placer dans le RIM linformation crire. Lancer la commande dcriture pour transfrer le contenu du RIM dans la mmoire .
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Problme ?
On veut raliser une mmoire de capacit C , mais nous disposons uniquement de botiers ( des circuits ) de taille infrieur ?
6. Conception des MC
m
Botier Capacit C
?
Mmoire Capacit C m
n
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Solution
Soit M une mmoire de capacit C , tel que m est le nombre de mot et n la taille dun mot. Soit M un botier de capacit C , tel que m le nombre de mot et n la taille dun mot.
CS (Chip Select ) : cest une commande en logique ngative qui permet de slectionner ( activer ) un botier . CS=0 le botier est slectionn CS=1 le botier nest pas slectionn
R/W
CS
On suppose que C > C ( m >= m , n >=n) Quel est le nombre de botiers M ncessaire pour raliser la mmoire M ?
D E
R A M
C O D E U R E
Un Botier
Pour connatre le nombre de botiers ncessaire , il faut calculer les deux facteurs suivants : P =m/m Q=n/n
RIM
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Solution (suite )
P : permet de dterminer de nombre de botiers M ncessaire pour obtenir le nombre de mots de la mmoire M ( extension lignes ).
Exemple 1
Raliser une mmoire de 1Ko ( la taille dun mot est de 8 bits) en utilisant des botiers de taille 256 mots de 8 bits ? Solution :
Q : permet de dterminer le nombre de botier M ncessaire pour obtenir la taille de mot de la mmoire M ( extension mots ou extension colonnes). P.Q donne le nombre totale de botiers ncessaire pour raliser la mmoire M. Pour slectionner les botiers on utilise les bits de poids forts dadresses. Si P est le facteur dextension lignes alors on prend k bits tel que P=2k. Les autres bits dadresses restants sont utiliss pour slectionner un mot dans un botier.
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(m,n)=(1024,8) taille du bus dadresses est de 10 bits A90(A9A0), taille du bus de donnes est de 8 bits D70(D7.D0) (m,n)=(256,8) taille du bus dadresses est de 8 bits (A7A0), taille du bus de donnes est de 8 bits (D7.D0) Calculer les deux facteurs dextension lignes et colonnes : (extension colonnes) P= m/m =1024/256=4 ( extension lignes ) Q= n/n =8/8=1
R/W
CS
D 70 D7
0
Exemple 2
On veut raliser une mmoire de 1Ko ( la taille dun mot est de 16 bits) en utilisant des botiers de taille 1Ko mots de 4 bits ) ? Solution :
8 bits
CS
A98
D 70
(m,n)=(1024,16) taille du bus dadresses est de 10 bits (A9A0), taille de bus de donnes est du 16 bits (D15.D0) (m,n)=(1024,4) taille du bus dadresses est de 10 bits (A9A0), taille de bus de donnes est du 4 bits (D3.D0) P=1024/1024=1 ( extension lignes ) Q=16/4=4 (extension colonnes)
CS
D 70
CS
A70
8 bits
D 70
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Exemple 3
R/W
D150
On veut raliser une mmoire de 1KO ( la taille dun mot est de 8 bits) en utilisant des botiers de taille 256 mots de 4 bits ) ? Solution :
CS
CS
CS
CS
(m,n)=(1024,8) taille du bus dadresses est de 10 bits (A9A0), taille du bus de donnes est de 8 bits (D7.D0)
D1512 D118 D74 D30
(m,n)=(256,4) taille du bus dadresses est de 8 bits (A7A0), taille du bus de donnes est de 4 bits (D3.D0) P=1024/256=4 ( extension lignes ) Q=8/4=2 (extension colonnes)
A90
10 bits
16 bits
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R/W
CS CS
D 70 D7 D3
Exercice
Raliser une mmoire de 8K X12 ( la taille dun mot est de 12 bits) en utilisant des botiers de taille 2048 mots de 4 bits ) ?
8 bits
CS
CS
A98
D 74 D 30
CS
CS
D 74
D 30
CS
CS
A70
8 bits
D 74
D 30
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Dans une architecture un seul processeur : le processeur lexclusivit daccder la mmoire. Le rendement de lUC nest conditionne que par le temps daccs la MC.
Processeur
Mmoire Centrale
Demande de la lecture
Disponibilit de linformation
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UC inactive
Si le calculateur possde plusieurs processeurs qui fonctionnent en parallle ( en mme temps ), cest possible que deux processeurs ou plus demandent daccder la mmoire la mme instant. Si la mmoire est structure en un seul bloc alors un processeur peut monopoliser la MC. Mme si le temps daccs est trs petit, des processeurs vont tre pnaliss donc la structure de la MC est aussi importante.
MC P1 P2 P3 P4
P1
P2
P3
P4
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Remarques : Les adresses lintrieur dun module sont squentiels ( successives ) Cest possible quun module soit raliser avec des botiers de taille infrieur ( il faut calculer les facteur dextension lignes et colonnes ) 38
Exemple
Soit une mmoire de taille de 4 Ko. Cette mmoire est dcoupe en 4 modules. Donner le schma de cette mmoire en utilisant des botiers de 1 Ko? Solution : Capacit = 4 Ko = 4* 210 = 212 12 bits ( A110). 4 modules A1110) la taille du bus dadresses est de
Nmodule
adresse mot
Les autres bits pour la slection dun mot dans un module ( A90)
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R/W
CS
Module 0
D 70
D 70
8 bits
Exercice 1 :
CS
A1110
D 70
Module 1
Soit une mmoire de taille de 4 Ko. Cette mmoire est dcoupe en 4 modules. Donner le schma de cette mmoire en utilisant des botiers de 512 mots de 8 bits? Exercice2 : Soit une mmoire de taille de 4 Ko. Cette mmoire est dcoupe en 4 modules. Donner le schma de cette mmoire en utilisant des botiers de 512 mots de 4 bits?
CS
Module 2
D 70
CS
Module 3
A90 10 bits
D 70
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Adresse du mot
Nbloc
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Exemple 2
Raliser une mmoire de capacit 512 mots de 8 bits avec des botiers de 128 mots de 8 bits avec un degr entrelacement de 4. Capacit 512 =29 ( taille de bus dadresses =9 ) Taille dun mot =8 4 blocs taille du bus de donnes =8 un botier par bloc est suffisant taille dun bloc = 512/4 =128
2 bits de poids faibles pour la slection dun bloc A10 Les bits de poids fort ( A82) pour slectionner un mot dans un bloc.
0001 0101 1001 1101 0010 0110 1010 1110 0011 0111 1011 1111
Bloc 0
Bloc 1
Bloc 2
Bloc 3
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R/W
CS
Bloc 0
D 70 D7
0
Exercices
Exercice 1 : Raliser une mmoire de capacit 512 mot de 8 bits avec des botiers de 64 mots de 8 bits avec un degr entrelacement de 4. Exercice 1 : Raliser une mmoire de capacit 512 mot de 8 bits avec des botiers de 64 mots de 4 bits avec un degr entrelacement de 4.
8 bits Bloc 1
CS
A10
D 70
CS
Bloc 2
D 70
CS
Bloc 3
A82
7 bits
D 70
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Exemple
Raliser une mmoire de 64 mots de 8 bits organis en deux modules entrelac , lentrelacement se fait lintrieur ( D=2). En utilisant des circuits ( botiers ) de 16 mots de 8 bits. La taille du bus dadresses k= 6 ( 64=26) A50
Le nombre de module m=2 , la taille dun module est gale 32 mots. Le nombre de bits pour slectionner un module est gale 1 (A5 ). Le nombre de blocs dans un module D=2 le nombre de bits ncessaire pour slectionner un bloc est gale 1 (A0 ) la taille dun bloc est gale 16 mots un bloc un circuit suffit pour raliser
Nmodule
adresse mot
NBloc
Le nombre de bits ncessaire pour slectionner une mot dans le bloc est gale 4 (A41 )
49 50
Module 0
CS
Bloc 0
D 70
D7 M0
8 bits Bloc 1
CS
A5
M1
Exercice : Raliser une mmoire de 128 Ko ( taille dun mot est 8 bits ) organis en quatre modules entrelacs avec un degr dentrelacement D=4 ( lentrelacement se fait lintrieur des modules), en utilisant des circuits ( botiers ) de 4 Ko mots de 4 bits.
D 70
Module 1
B0
A0
B1
CS
Bloc 0
D7
0
CS
Bloc 1
A41
4 bits
D 70
51
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