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1) Que signifient les sigles CPLD, FPGA et VHDL ? (points négatifs si faux)
3) Quelle est la différence entre un signal et une variable? Dans quelles parties du programme
sont-ils respectivement déclarés? Pour un diviseur de fréquence, va-t-on utiliser un signal ou
une variable ? (justifiez)
4) Quelle est la différence entre les instructions dans un process et celles hors d’un process ?
5) Quelle technique peut-on utiliser en graphique pour stabiliser des signaux de sortie (pour
éviter les "glitchs")? Même question en VHDL.
6) Pourquoi vaut-il mieux utiliser l'entrée enable d'un compteur plutôt que l'entrée horloge
pour une horloge secondaire?
7) Qu’est ce que la structure « pipe-line » ? Son but, ses avantages/défauts ? Illustrez votre
réponse avec un exemple (en l’expliquant).
10) Ecrivez en VHDL (on s'attardera surtout à la structure plutôt qu'à une syntaxe exacte) un
registre à décalage de 3 étages avec des mots d'un octet
8 D Q D Q D Q
8
clk
11) Ecrire en VHDL un compteur de parité d’un mot de 8 bits (sortie d’un bit valant 0 si le
nombre de 0 du mot de 8 bits est pair, 1 sinon).
12) Expliquez ce que fait globalement (PAS ligne par ligne !) cette description suivante :