L3 : Automatique

LES REGISTRES

I- Introduction

Un registre est un circuit logique qui permet la mémorisation de mots binaires de longueur n
bits. Il est donc constitué de n bascules mémorisant chacune 1 bit.

Les registres se distinguent les uns des autres par leur mode de fonctionnement et leur
utilisation. Ils peuvent être classés en deux grandes catégories :
 Les registres de mémorisation
 Les registres à décalage

II- Registres à mémorisation

Un registre à mémorisation est registre du type PIPO ( Parallel In Parallel Out) : Entrées
parallèles- Sorties parallèles. Il va donc avoir n entrées et n sorties. L’information à
mémoriser est chargée simultanément sur les n entrées grâce à un signal de commande que
l’on appelle commande d’écriture(W). Cette information est ensuite conservée dans les
bascules et sera disponible en sortie lorsque une commande de lecture(R) est activée.
Dans ce type de registres les bascules ne sont pas reliées entre elles. A titre d’exemple nous
présentons dans la figure 3-1, le logigramme d’un registre à mémorisation 4 bits.

 Ecriture des données

Lorsque le signal W est actif, les bascules mémorisent l’état des entrées E1, E2, E3 et E4. Le
signal W est ensuite désactivé, ce qui permet de garder les sorties des bascules inchangées et
donc conserver l’information.
 Lecture des données
Lorsque le signal R est activé les sorties des bascules sont disponibles sur les sorties Q1, Q2,
Q3 et Q4 du registre.

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Figure 3-1 : Registre à mémorisation 4 bits

III- Registres à décalage

Dans un registre à décalage les bascules sont attaquées par le même signal d’horloge et sont
reliées de telle façon à ce que l’état logique d’une bascule soit transmis à sa voisine à chaque
impulsion d’horloge.
L’information peut être introduite dans le registre de deux manières différentes :
 Par une entrée série : l’information est présentée séquentiellement bit par bit à l’entrée de
la première bascule. A chaque signal d’horloge un nouveau bit est introduit alors que le
contenu de chaque bascule est décalé vers la bascule voisine. Le décalage peut se faire de
gauche à droite ou de droite à gauche selon que l’entrée série soit sur la bascule la plus à
gauche ou la plus à droite respectivement.
 Par une des entrées parallèles : l’information est présentée simultanément sur les entrées
de toutes les bascules, comme c’est le cas pour les registres de mémorisation. Un système
d’inhibition est rajouté pour éviter que le registre procède à un décalage pendant le
chargement.

III-1 Registre à décalage à entrée série

Le logigramme de la figure 3-2 représente un registre à décalage 4 bits à entrée série réalisé
par la mise en cascade de 4 bascules D. X représente l’entrée série et elle correspond à
l’entrée de la bascule A.

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Les équations logiques définissant ce registre sont les suivantes :
DA=X DB = A DC = B DD = C

CK

Sortie série
X A B C D
DA DB DC DD
A B C D

Sorties parallèles

Figure 3-2 : Registre à décalage 4 bits à entrée série

Ce registre est dit du type SISO(Serial In Serial Out) – Entrée série/ Sortie série, Si la sortie
du registre correspond à la sortie de la bascule D, c’est à dire la sortie de la dernière bascule.

Ce registre est dit du type SIPO(Serial In Parallel Out) – Entrée série/ Sorties parallèles, Si
les sorties du registre sont A, B, C et D, c’est à dire les sorties de toutes les bascules.

Si on suppose que pour t=t0, on a A=B=C=D=0 et que pendant les 4 instants successifs
d’horloge, l’entrée série X prend les valeurs suivantes :
X(t0)= 1 X(t1)= 1 X(t3)=0 X(t4)=1
Alors le fonctionnement de ce registre à décalage peut être schématisé par les différentes
représentations de la figure 3-4. On remarque qu’à chaque instant d’horloge, l’information
contenue dans le registre subit un décalage à droite. Pour cette raison on appelle ce type de
registre : registre à décalage à droite

Si les bascules sont assemblées telles que :

DD=X Dc=D DB=C DA=B
On obtient un registre qui a le même fonctionnement que le registre que l’on vient de
présenter sauf que l’information circule dans le sens contraire, c’est à dire de droite à gauche.
On a dans ce cas un registre à décalage à gauche.

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CK

1 0 0 0 0
T =t0 X A B C D
DA DB DC DD
A B C D

CK

1 1 0 0
A B C D 0
t =t1 X
DA DB DC DD
A B C D

CK

0 0
t=t2 X A 1 B 1 C D 0
DA DB DC DD
A B C D

CK

t=t3 1 0 1 1 0
A B C D
X
DA DB DC DD
A B C D

Figure 3-4 : Fonctionnement d’un registre à décalage à droite 4 bits

Certains registres à décalages peuvent être bidirectionnels c’est à dire capable de décaler à
droite ou à gauche, suivant un signal de commande Y.
Par exemple, si pour :
 Y=0, le registre décale à droite
 Y=1, le registre décale à gauche

Les équations logiques d’un registre à décalage bidirectionnel obeissant à la commande Y

ainsi définie, sont les suivantes :

DA=YX+YB DB=YA+YC Dc=YB+YD DD=YC+YX

D’ou le logigramme avec des multplexeurs de la figure 3-5.

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 L3 : Automatique CK

A B C D
Sortie série DA DC DD Sortie série
DB
décalage à A B C D décalage à
gauche droite

MUX MUX MUX

Y MUX
0 1 0 1 0 1
0 1

Entrée
série X

Figure 3-5 : Registre à décalage 4 bits, bidirectionnel

III-2 Registre à décalage à entrées parallèles

La figure suivante représente un registre à décalage 4 bits avec entrées parallèles et sortie
série ( registre de type PISO ) ou sorties parallèles (registre de type PISO ).

Sorties parallèles

CK

A B C D
DA DB DC DD
Sortie série
A B C D

Pr Clr Pr Clr Pr Clr Pr Clr

EA EB EC ED

Entrées parallèles

Figure 3-6 : Registre à décalage 4 bits à entrées parallèles

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Le chargement de l’information se fait par les entrées asynchrones des bascules. Une
commande L permet de définir le mode de fonctionnement des bascules:

 Lorsque L=0, les entrées asynchrones sont inhibées, les bascules vont fonctionner en
mode décalage à chaque front d’horloge.

 Lorsque L=1, le registre est en mode chargement: l’horloge est inhibée et l’état de
chacune des entrées Ei est chargé dans la bascule correspondante au moyen des entrées
asynchrones supposées actives à 1. Ce qui donne:

Ei=0  Pr =1 et Clr =0  Qi =1
Qi=Ei
Ei=1  Pr =0 et Clr =1  Qi =0

III-3 Registre à décalage universel

Un registre à décalage universel est un registre qui peut fonctionner suivant l’un des deux
modes présenté précédemment, c’est à dire entrée série ou parallèles et sortie série ou
parallèles. Il est donc constitué des entrées, des sorties et des commandes tels que désignés
par le schéma de la figure 3-7.

Sorties parallèles

Sortie série décalage

Entrée série
gauche
Sortie série décalage
droite

Horloge Registre à décalage 4 bits

Commande décalage Commande Entrées parallèles

Chargement / décalage
droite / gauche

Figure 3-7 : Registre à décalage 4 bits, universel

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Exercice
Réaliser avec des bascules D, un registre à décalage à droite 4 bits à entrées parallèles.
Sachant que C1 et C0 représentent deux entrées de commande, le registre doit avoir les
caractéristiques suivantes:
C1 C0 = 00 : Le registre conserve son état précédent
C1 C0 = 01 : Le registre décale à droite, et la valeur de l’entrée série est introduite
dans la bascule de gauche
C1 C0 = 10 : Le registre charge une valeur E1 E2 E3 E4
C1 C0 = 11 : Remise à zéro par les entrées asynchrones Cl

Le registre à décalage à droite 4 bits est réalisé par la mise en cascade de 4 bascules D, dont
les entrées Di (i=1,…4 ) sont connectées comme suit :.

1° Bascule: D1 =X : l’entrée série du registre

2° Bascule: D2 = Q1 : la sortie de la 1° Bascule
3° Bascule: D3 = Q2 : la sortie de la 2° Bascule
4° Bascule: D4 = Q3 : la sortie de la 3° Bascule

Suivant l’état de la commande C1C0, il y a 4 types de fonctionnement :

1. C1C0=00 : Le registre garde la même valeur, c'est-à-dire que les sorties des bascules
restent inchangées : Qi += Qi
.Pour obtenir cela, l’horloge doit rester inactive (=0 )
2. C1C0=01 : Le registre décale le contenu vers la droite et la valeur de X est introduite
dans la bascule de gauche.
Q1 +=X : Q2+ = Q1 Q3+ = Q2 Q4+ = Q3
Pour avoir ce fonctionnement, il suffit d’activer l’horloge, puisque pour la
bascule D, on a : Q + = D. L’horloge sera donc : Ck’=C1C0 Ck
3. C1C0= 10 : Une valeur E1E2 E3 E4 est chargée par les entrées parallèles du registre.
Pour cela, on utilise les entrées asynchrones, comme indiqué précédemment
dans le cours ; c'est-à-dire :
Cli  C1C O Ei PRi  C1C 0 Ei ( i=1,……, 4)
4. C1C0= 11 Le contenu du registre est remis à zéro par les entrées asynchrones Clear :
Cli  C1CO ( i=1,……, 4)

En utilisant un décodeur dont les entrées sont C1 et C0, Le logigramme de ce registre sera
comme indiqué dans la figure suivante :

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CK
CK’

Q1 Q2 Q3 Q4
D1 D3 DD
0

X D2
  

1

C1 Pr Clr
Pr Clr Pr Clr Pr Clr
Décodeur
2

C0
3

E1 E2 E3 E4

Entrées parallèles

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