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PLAN DU COUR:
•LA LOGIQUE A DIODE;
•LA LOGIQUE RTL;
•LA FAMILLE DTL;
•LA FAMILLE TTL;
•LA FAMILLE CMOS.
•COMPATIBILTE ENTRE FAMILLE LOGIQUE:
CAS PARTICULIER COMPATIBILITE CMOS-TTL
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LA LOGIQUE A DIODES
Ve1=VCC ET Ve2=0
Ve1=0 ET Ve2=0
Ve1=Ve2=VCC
Table de vérité
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LA FAMILLE RTL
Le but est d’utiliser des résistances combinées avec un transistor pour
réaliser des fonction logiques. L’avantage de cette famille est l’introduction
de la logique inverse nécessaire pour former une base complète.
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LA FAMILLE RTL
Pour obtenir n’importe quelle fonction à partir des résistances et des
transistors on utilise la porte NOR
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LA LOGIQUE TTL
De la DTL à la TTL La logique TTL dérive de la DTL.
Un transistor Multiémetteur peut
facilement jouer le rôle de
plusieurs diodes (et non pas le
contraire).
Chaque jonction BE représente une
diode de la couche AND, la
jonction BC représente la première
diode (D3 sur le schéma), intercalée
entre la couche AND et
l’inverseur.
La dernière diode (D4 sur le
schéma) peut être substituée par la
jonction BE d’un
transistor.
Il suffit enfin de connecter le
collecteur du transistor à Vcc pour
NAND en TTL éviter de qu’il joue le rôle d’une
antenne.
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LA LOGIQUE TTL
Le passage de l’utilisation des diodes à l’utilisation des transistors permet de :
1. Gagner en espace;
2. Gagner en vitesse;
3. Gagner en sortance: en effet suite à la nécessité de prévoir des résistances en logique
DTL, il faut limiter le nombre des entrées à connecter à une sortie DTL pour ne pas
dégrader les niveaux de tension.
La famille TTL a été lancé en 1964 par la société Texas Instruments. Cette
technologie ne se trouve qu’en version de circuits intégrés.
La TTL utilise des circuits intégrés logiques dont la dénomination est SN74xx:
1. SN : préfixe donné à la société Texas Instruments ;
2. 74 : circuit industriel travaillant entre 0° et 75°C ;
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LA LOGIQUE TTL
CARACTERISTIQUES DE LA TTL:
1. Tension d’alimentation: 5 volts avec un intervalle de tolérance de 0.25volt ([4.75- 5.25
volts] );
2. La consommation des composants TTL n’est pas affectée par la fréquence, cette
consommation est de l’ordre de 1.4 mW/porte pour la série ALS et de l’ordre de 6
mW/porte pour la série F.
3. Niveaux logiques: Les élément TTL acceptent une tension VIL(max) de 0.8V et une
tension VIH(Min) de 2V. Les tensions VOL(max) et VOH(min) sont respectivement
0.4V et 2.4V.
4. Retard de propagation: Pour la plupart des TTL de séries standard, le retard de
propagation type est de 11ns ; celui des portes série F est de 3.3ns
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LA LOGIQUE TTL
Autres Séries TTL:
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LA LOGIQUE TTL
CARACTERISTIQUES DES SERIES LA TTL
5 5 5 5 5 VCC
2.7 2.7 2.4 2.4 2.4 VOH(min)
2 2 2 2 2 VIH(min)
0.5 0.5 0.4 0.3 0.4 VOL(max)
0.8 0.8 0.8 0.8 0.8 VIL(max)
9.5ns 3ns 6ns 33ns 9ns Retard Tp
2mW 23mW 23mW 1mW 10mW consommation
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LA LOGIQUE TTL
TTL à Collecteur Ouvert.
Le nom collecteur ouvert vient du fait que la sortie de la porte
est prise au niveau du collecteur du transistor Q3 sur lequel rien
n’est connecté. Pour obtenir les bons niveaux logiques il faut
qu’une résistance externe de polarisation soit reliée à la source
VCC à partir du collecteur Q3.
Quand Q3 est bloqué, la sortie est haussé jusqu’à +VCC par
le biais de la résistance externe. Quand Q3 conduit, la sortie
est presque au niveau de la masse à cause de la chute de
tension de la résistance.
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LA LOGIQUE TTL
Les avantages de cette famille :
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LA LOGIQUE CMOS
CMOS: ''Complementary Metal Oxide Semi-conductor''.
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LA LOGIQUE CMOS
Série CMOS
Plusieurs séries des portes logiques de types CMOS sont disponibles pour chaque
catégorie de tension d’alimentation. Ces séries de la famille des CMOS diffèrent au
niveau de leurs caractéristiques de performance et sont désignées par le préfixe 74 ou
54, suivi par une ou plusieurs lettres indiquant la série, suivi d’un nombre représentant
.le type d’élément logique
Les séries CMOS de base pour la catégorie 3,3V regroupent les composants :
; 74LVC : CMOS à faible tension
.74ALVC : CMOS Avancés à faible tension
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LA LOGIQUE CMOS
CARACTERISTIQUES DE LA CMOS:
Tension d’alimentation: deux catégories 5volts ou 3.3 volts. Les CMOS à 5 volts peuvent
opérer entre 2 et 6 volts alors que les CMOS de 3.3 volts peuvent opérer entre 2 et 3.6
volts.Il y’a des CMOS qui peuvent être alimentés par des tensions allant jusqu’à 18
volts.
Inconvénient de la CMOS
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COMPATIBILITE
Conditions d’association:
•VOH(min)>VIH(min)
•VOL(max)< VIL(max)
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ICI TERMINE LE COURS
D’AUJOURD’HUI
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PREMIER CAS
RETOUR
20
DEUXIEME CAS
RETOUR
21
TROISIEME CAS
RETOUR
22
TABLE DE VERITE
S= E1 AND E2
Avec les diodes, on peut réaliser les fonctions logiques AND et OR mais pas
la négation ce qui représente un inconvénient pour la logique à diodes
RETOUR
23
INVERSEUR CMOS
Retour
24
Courbes CMOS
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