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Jolle Delacroix
Lordinateur contient diffrents niveaux de mmoire, organiss selon une hirarchie mmoire.
Architecture des machines 2006-2007 Jolle Delacroix 2
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Les diffrents types de mmoire Mmoires vives : RAM (Random Access Memory)
DRAM : mmoire dynamique. Peu couteuses, elles composent la mmoire centrale de lordinateur.
1 cellule mmoire mmorise un bit et est constitue par un transistor et un condensateur le condensateur se dcharge dans le temps. Il convient de recharger chaque cellule priodiquement (1000 fois / s) : le rafraichissement de la mmoire. Se prsente sous la forme de barrette DIMM (Dual Inline Memory Module). Temps daccs : 60 ns (DRAM) 10 ns (SDRAM)
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Les diffrents types de mmoire Mmoires vives : RAM (Random Access Memory)
SRAM : mmoire statique. Plus couteuses et encombrantes, elles composent les caches du processeur.
1 cellule mmoire mmorise un bit et est constitue par 4 6 transistors (circuit de type bascule) Temps daccs : 10 ns
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registre Mmoire SR A M
Mmoire DR A M
Mmoire ROM
Contient les informations Les plus rcemment accdes par le processeur Un sous ensemble de la DRAM
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Mmoire Vive, volatile (lecture/criture) Contient le code et les donnes des programmes excuts par le processeur
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Processeur
Commandes
Donnes
Adresse
Bus
Selection
Tampon dentres/Sorties
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Bus adresse
010
0 1 0
0 1 2 3 4 5 6 7
1- Slection 2-Bus(donnes)
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Bus donnes
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3- Ecriture
Bus adresse
010
0 1 2 3 4 5 6 7
1- Slection
2-Bus(donnes) 3- Ecriture
Bus donnes
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Bus adresse
010
0 1 0
0 1 2 3 4 5 6 7
1- Slection
2-Bus(donnes) 3- Ecriture
Bus donnes
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Donnes
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Adresses
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RAM
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Les mmoires de lordinateur Le principe de hirarchie mmoire : les caches Principe de la hirarchie de mmoire, fonctionnement des caches
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Hirarchie Mmoire
vitesse cout Le plus lev capacit La plus petite 6-35 ns 70 - 120 ns Le moins lev La plus grande
Processeur Registres
Mmoire Cache
Mmoire centrale
La mmoire cache est une mmoire intermdiaire place entre le processeur et la mmoire centrale dont le temps d'accs est de 4 20 fois infrieur celui de la mmoire centrale.
Bus Local
SRAM
DRAM
Bus
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Processeur Registres
info
Mmoire Cache
info
Mmoire Centrale
Bus Local
DRAM
1. L'info cherche est-elle dans le cache ? OUI / Succs (a) : ramener l'info dans le processeur NON / Dfaut (2) : chercher l'info dans la mmoire centrale 2. L'info est-elle en mmoire centrale ? OUI / Succs (b) : ramener l'info dans le cache , puis dans le processeur (a) NON / Dfaut
SRAM
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