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Le séquenceur est un dispositif qui envoie ses commandes aux autres organes de
l’unité centrale au rythme de l’horloge (H).
2. Symbole
de trois registres, servant respectivement à stocker les données (que nous notons
donnée 1 et donnée 2) d'une opération arithmétique et son résultat : leur taille
3 est celle d'un mot mémoire (2 octets dans notre exemple) ;
de l'Unité Arithmétique et Logique (UAL) capable, quand on lui fournit le code
d'une opération arithmétique à exécuter, de prendre les contenus des deux
premiers registres (ceux contenant les données 1 et 2) et de remplir le troisième
registre avec le résultat de cette opération.
2. Symbole
Accumulateur
C. La mémoire centrale
1. Définition
Pour pouvoir effectuer les opérations sur des données et exécuter des programmes l’UC
doit disposer d’un espace de travail. Cette espace de travail s’appelle la mémoire
centrale.
2. Symbole
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D’ADRESSE
MEMOIRE
MATRICE
REGISTRE
D. Les bus
1. Définition
C’est un système d’échange ou groupement des conducteurs permettant de transporter
les données numériques sous formes binaire.
Le bus "ordres" sert à transmettre les demandes d'exécution d'opérations de l'unité de
commande vers l'unité de traitement. Le bus "instructions" fait transiter les instructions
élémentaires des mots mémoire vers le registre d'instruction de l'unité de commande,
et le bus "données/résultats" fait circuler (dans les deux sens) le contenu des mots
mémoires entre la mémoire et les différents registres de l'unité de traitement.
2. Symbole
UNITE DE CONTROLE
SS
R
D
A
E
S
MEMOIRE
O
R
O
T
N
E
C
UNITE DE TRAITEMENT
CENTRALE
PROCESSEUR
3. Types de bus
5 Bus de données : Ils sont chargés de transporter ou d’acheminer des données
brutes sous forme binaire.
Bus de d’adresses: Ils sont chargés de transporter ou d’acheminer des adresses
sous forme binaire.
Bus de contrôle : Ils sont chargés de transporter ou d’acheminer des instructions
de contrôle sous forme binaire.
phase 1 : L'instruction courante, dont l'adresse est stockée dans le CO, est
recopiée dans le registre d'instruction (RI) en transitant par le bus "instructions";
phase 2 : cette instruction courante est décodée à destination de l'UAL ; ainsi le
bus "ordres" transfère le code de l'opération (les 4 premiers bits) et le bus
"données/résultats" transfère dans les registres appelés "donnée 1" et "donnée
2" le contenu des mots mémoire se trouvant aux adresses référencées dans
l'instruction ;
phase 3 : l'UAL exécute l'opération qui lui est demandée en mettant à jour son
registre "résultat" et transfère ce résultat dans la mémoire centrale, à l'adresse
référencée dans l'instruction, en utilisant le bus "données/résultats" ; par ailleurs
le CO est automatiquement incrémenté (c'est-à-dire qu'il est augmenté de 1),
pour signifier que l'instruction suivante à exécuter doit se trouver normalement à
l'adresse qui suit immédiatement la précédente. Un nouveau cycle peut
commencer alors pour la nouvelle instruction courante.
6
Ces cycles sont rythmés par les tops d'horloge, chaque phase correspondant à un
nombre fixe de "tops" successifs. Dans notre exemple, pour la phase 1, qui
nécessite de faire transiter l'instruction courante de la mémoire vers le RI en
utilisant le bus d'instruction, 4 tops d'horloge seront nécessaires (car un mot
mémoire fait 16 bits et le bus n'a une capacité que de 4 bits).
D. Interprétation de l’instruction :
H SEQUENCEUR
CO
7 RI
MEMOIRE
RA
CENTRALE
UAL
R1 R2 RD
UE UE