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I- Rappels et généralités :
On a vu l’année dernière qu’un signal s(t) sinusoïdal de fréquence constante était caractérisé
par :
s (t ) = S m sin( t + )
(t ) = (t + ) est appelée phase instantanée car elle donne la valeur de la phase du sinus à
tout instant (on appelle phase la valeur « de ce qu’il y a à l’intérieur des parenthèses du
sinus »)
La physique utilise également des signaux qui voient leurs fréquences varier dans le temps
p
autour d’une fréquence de référence (que nous noterons dans toute la suite f p = ). C’est
2
par exemple le cas dans les transmissions à modulation de fréquence.
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La phase est alors décrite par : (t ) = ( p t + (t ))
d (t ) d ( p t + (t )) d (t )
(t ) == = p +
dt dt dt
Et pulsation et fréquence sont données par:
1 p 1 d (t ) 1 d (t )
f (t ) = (t ) = + = fp +
2 2 2 dt 2 dt
1 d (t )
exprime l’écart de fréquence par rapport à f p
2 dt
Un signal s(t) qui voit sa fréquence varier autour de f p est alors noté :
s (t ) = S m sin( p t + (t ))
La PLL est un système très largement utilisé dans les systèmes de réception analogique ou
numérique. Une PLL réalise un asservissement de la phase et de la fréquence.
Sa structure générale est la suivante :
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On peut alors proposer la représentation bloc suivante :
vF(p) 2 R ( p)
k OCT
p
- le filtre passe bas donne la valeur moyenne de v(t) et alors une tension vF(t)
proportionnelle au déphasage = E (t ) − R (t ) = E (t ) − R (t ) telle que :
vF (t ) = K D ( E (t ) − R (t )) . En notation de Laplace : v F ( p) = K D ( E ( p) − R ( p))
E ( p) + Filtre v F ( p) = K D ( E ( p) − R ( p))
KD
- passe bas
R ( p)
- une fois la boucle verrouillée ou accrochée, la fréquence d’entrée peut varier dans la
plage de verrouillage sans que cette boucle ne décroche et on a toujours fs = fe
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III- Réalisation expérimentale :
L’objectif est de réaliser un comparateur de phase avec une boucle ouverte de classe 1
a) Montage :
On peut réaliser une PLL à partir du montage suivant :
v E (t ) = VE sin( E (t )) = VE sin( p t + E (t ))
v R (t ) = VR cos(R (t )) = VR cos( p t + R (t ))
Ces tensions sont caractérisées par des fréquences qui varient autour de la fréquence
d E (t )
f p
p dt
fp = avec cependant des variations faibles d’où :
2 d R (t )
f p
dt
i) étude du comparateur
On peut exprimer la tension la sortie du multiplieur qui d’après le constructeur est donnée par:
v (t ) = Kv E (t )v R (t )
soit :
v (t ) = KVEV R sin( p t + E (t )) cos( p t + R (t ))
v (t ) =
KVEV R
2
sin( 2 p t + E (t ) + R (t )) + sin( E (t ) − R (t )
On paramètre le filtre ( = RC ) de manière à ce qu’il ne transmette que les fréquences très
inférieures à f p
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Dans ces conditions, on obtient :
KVEVR
v F (t ) = sin( E (t ) − R (t ) )
2
KVEVR
v F (t ) = ( E (t ) − R (t ))
2
Rq : on verra que cette condition limite la bande de fréquence où la PLL est verrouillée
On écrit alors :
v F (t ) = K D ( E (t ) − R (t ))
KVEVR
Avec : K D =
2
La modélisation bloc du comparateur est donc :
E ( p) KVEVR 1 v F ( p) = K D ( E ( p) − R ( p))
KD =
+
- 2 1 + p
R ( p)
L’OCT est caractérisé par une tension de sortie dont la fréquence vérifie autour de la
fréquence f p :
1 dR (t ) 1 d R (t )
f R (t ) = f p + k OCT v F (t ) = = fp +
2 dt 2 dt
En notation de Laplace :
p
k OCT v R ( p) = R ( p)
2
2k OCT v F ( p )
R ( p) =
p
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b) schéma blocs :
La pulsation étant la dérivé de la phase, on peut modifier le montage précédent pour faire
apparaître la fréquence comme grandeur d’entrée.
1 d E (t ) 1 d E (t ) fp p
f E (t ) = = fp + → f E ( p) = + E ( p)
2 dt 2 dt p 2
fp p
f R ( p) = + R ( p)
p 2
c) Etude statique :
v E (t ) = VE sin( E (t )) = VE sin( p t + E (t ))
v R (t ) = VR cos(R (t )) = VR cos( p t + R (t ))
Et supposé :
( E (t ) − R (t )) 0
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On remarque donc que dans ces conditions, le signal de retour et d’entrée sont déphasé
d’environ . Notre système ne permet pas d’avoir une erreur nulle pour la phase
2
f r ( p) = T ( p)( f e ( p) − f r ( p))
T ( p) 1
H ( p) = =
1 + T ( p) 1
1+
T ( p)
On a donc :
1 1
H ( p) = =
p(1 + p) p p 2
1+ 1+ +
2k OCT K D 2k OCT K D 2k OCT K D
On a donc une boucle d’ordre 2 caractérisée par une pulsation propre et un facteur
d’amortissement :
2kK D
02 =
0 2k OCT K D 1 1 2
m= = =
4kK D 4k OCT K D 4 k OCT K D
Il faut choisir faible pour avoir une bonne stabilité et rapidité cependant il ne faut oublier
que l’on doit filtrer les fréquences inférieures à f p . Il faut donc un compromis.
d) Plage de verrouillage, plage de capture
On dit que la boucle est verrouillée lorsque f E = f R . Cependant la bande de fréquence pour
laquelle la PLL est verrouillée possède deux limites :
Etat de la PLL
Verrouillée
f v
Déverrouillée
f c
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- La plage de verrouillage :
- La plage de capture
La linéarisation est cependant essentielle pour le bon fonctionnement de la PLL. En effet, elle
permet d’avoir un comparateur de phase linéaire (condition essentiel pour tous nos
développements)
Fixer ( E (t ) − R (t )) 0 revient cependant à limiter la zone de travail en fréquence.
Cette bande de fréquence est la plage de capture et est donnée par 2 f V f c où f c est la
fréquence de coupure du filtre.
Il est évident qu’il est préférable de faire travailler la PLL dans la plage de capture car s’il y a
rupture du signal d’entrée alors la PLL peut se verrouiller.
e) Etude dynamique
On peut alimenter la PLL par un signal qui voit sa fréquence varier par saut entre deux valeurs
(modulation FSK2). Ce signal est obtenu par exemple à l’aide d’un OCT alimenté par une
tension modulante à deux états : U . Le schéma bloc complet est donc :
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IV- La PLL numérique :
L’objectif est toujours d’avoir un comparateur de phase avec une boucle ouverte d’ordre 1.
Le comparateur sera réalisé avec une porte OU exclusif.
vE vR v U
0 0 0 E
=1 FPB
0 1 1
1 0 1
1 1 0 R
OCT
On suppose que la boucle est verrouillée, vR(t) est en retard de h secondes alors :
vE(t)
t
vR(t)
Um v(t)
t
T T/2
LLL
2Umh
La valeur moyenne de v(t), obtenue en sortie filtre, est donnée alors par :
T
En raisonnant sur le fondamental on peut alors exprimer le déphasage entre vE(t) et
2h Um
vR(t) : = et la tension filtrée vaut :
T
On a donc bien un comparateur de phase avec une boucle de classe 1 si filtre d’ordre 1. On
aura une erreur statique sur la phase et la fréquence qui seront nulles
V- Synthétiseur de fréquences :
C’est un système qui permet à partir d’une fréquence d’entrée d’obtenir en sortie un
oscillateur réglable en fréquence.
Cette structure utilise donc un oscillateur mère :
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Comparateur filtre OCT
Oscillateur de phase
mère
Diviseur de
fréquence : 1/N
e ( p ) − r ( p ) V ( p) = K D (e ( p) − r ( p))
e ( p ) +
KD 1 U ( p) 2k r ( p )
-
1 + p p
On a alors :
2K D k OCT
- T ( p) = et donc une erreur statique nulle en phase et en fréquence
p (1 + p )
T ( p) 1 1
- H ( p) = = =
1 + T ( p)
1+
1 p p 2
1+ +
T ( p) 2k OCT K D 2k OCT K D
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