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R S E Qt
X X 0 Q t-1 mémoire
0 R 0 S 1 QQt t-1 mémoire
RS àRS
base
à base
de NOR
de NOR
synchronisée
0 0 1 0 1 Q t-11 Setmémoire
État
sur niveau haut
1 0 0 1 1 1 0 Mise à 1 (Set)
Reset
1 1 1 0 1 0 0 Mise à 0 (Reset)
INTERDIT !
1 1 0 INTERDIT !
S Q
R Q
RS à base de NAND synchronisée
RS à base de NAND
sur niveau haut
Bascule RS (synchronisée sur front)
H Détecteur
de front
H R S H Qt
X X Q t-1
0 0 Q t-1
RS à base de NOR synchronisée 0 1 1
sur front montant
1 0 0
1 1 0
H Détecteur
de front S Q
R Q
RS à base de NAND synchronisée
sur front montant
Bascule D
La bascule D est une bascule RS avec une seule entrée D: D = S = R
D S Q D à base de NOR
H E
R Q H Détecteur
de front
Symbole
D Q
H Q D à base de NAND
Table de fonctionnement
D H Qt Détecteur
H
X 0 Qt-1 de front
0 1 0
1 1 1
Bascule JK
Détecteur
H de front
R Q Q
K
H E
J S Q Q
JK à base de NOR
H J K Qt
0 x x Qt-1
J Q Détecteur
1 0 0 Qt-1 H de front
H 1
0 1 0
1 1 0 1
K Q 1 1 1 Qt-1
Symbole Table de
fonctionnement JK à base de NAND
Bascule JK
Cette instabilité est causée par la rétroaction des sorties sur les entrées. Dans le cas de la
bascule JK, la configuration JK=11 ne produit pas un état de sortie fixe, mais un état variable
(Qt-1) selon l’état précédent. Ce processus de complémentation continue tant que la prise de
l’état des entrées est autorisée par le niveau haut du signal d’horloge.
Pr. Hassan Ait Laasri 10/04/2020 7
Bascule JK
Pour corriger ce défaut, les sorties ne doivent pas être changées qu’au niveau bas de signal
d’horloge pour ne pas affecter les entrées. Pour y arriver, il existe deux solutions, soit:
Utilisation d’une bascule JK synchronisée sur front .
Dans ce cas le signal d’horloge vaut 1 pendant une durée très bref (égale au temps de
propagation de porte NON) qui est inférieure au temps de propagation de la bascule. Par
conséquence, la sortie ne soit modifié que pendant l’état bas du signal d’horloge.
Utilisation d’une bascule maître-esclave.
La bascule maître-esclave est conçue spécialement pour régler ce problème en utilisant deux
bascules en cascade. La première permet d’acquérir l’état des entrées au niveau haut.
Cependant, leur sorties sont bloquées par la deuxième qui n’est active qu’à l’état bas du signal
d’horloge. Par conséquence, la sortie ne soit modifiée qu’au niveau bas, et l’entrée n’est prise
qu’au niveau haut. On peut considérer ce comportement comme une synchronisation sur
impulsion.
Note:
À cause de ce défaut, il n’existe pas
pratiquement une bascule JK synchronisée sur
niveau haut.
Elle consiste à utiliser , cette fois-ci, deux bascules RS au lieu d’une seule. La première est
nommée Maître et la deuxième Esclave. L’ Esclave reçoit le complément du signal d’horloge.
Ainsi, pendant le niveau haut de H, le Maître est actif et l’esclave est désactivé. Pendant le
niveau bas, le maître est désactivé et ses sorties sont transmises aux entrées de l’esclave qui
devient actif. Cependant, les sorties de ce dernier ne sont prises en compte par le maître que
pendant le niveau haut suivant .
S Q S Q Q
J
E E
K R Q R Q Q
H
Bascule JK maître-esclave
J S Q S Q Q
Bascule Maître-Esclave à base de NAND E E
K
R Q R Q Q
Le symbole de complément et le round placés sur ces entrées indiquent qu’elles sont actives
à l’état bas. Qt Qt
PRE CLR H J K
Ces entrées ne doivent
0 1 x x x 1 0
pas êtres actives au
même temps. 1 0 x x x 0 1