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TP N°1
Premier montage E1 E2 S
U3:A
E1 1
3 S
E2 2
74LS32
Deuxième montage E1 E2 S
U1:A
E1 1
3 S
E2 2
74LS08
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Troisième montage E1 E2 S
U2:A
E1 1
3 S
E2 2
74LS00
Quatrième montage E1 E2 S
U4:A
E1 2
1 S
E2 3
74LS02
Cinquième montage E1 E2 S
U14:A
E1 1
3 S
E2 2
74LS86
U2:A
E1 1
3
2
U2:B U2:D
4 74LS00 12
6 11 S
5 13
U2:C
74LS00 9 74LS00
8 Donner le nom de la fonction
E2 10
obtenue.
74LS00
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Deuxième montage E1 E2 S
Câbler les composants et compléter la table de vérité
U11:A U4:A
E1 1 2 2
1
3
74LS04
74LS02 U4:C
8
10 S
9
U4:B 74LS02
U11:B 5 Donner le nom de la fonction
4
E2 3 4 6 obtenue.
74LS02
74LS04
opérations booléennes
Câbler le montage et compléter la table de vérité
U2:A
A 2
1 S
3
74LS02
74LS02 U2:C
8
10 S
U2:A 9
2
1 74LS02
E2 3
74LS02
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Câbler le montage et compléter la table de vérité E1 E2 S
U2:A
E1 2 U2:B
1 5
E2 3 4 S
6
74LS02
74LS02
Conclure
4. Universalité de l’opérateur NON ET
Réalisation des trois E1 S
opérations booléennes
Câbler le montage et compléter la table de vérité
U1:A
E1 1
3 S
2
74LS00
U1:A U1:B
E1 1 4
3 6 S
E2 2 5
74LS00 74LS00
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Câbler le montage et compléter la table de vérité E1 E2 S
U1:A
E1 1
3
2
74LS00 U1:B
4
6 S
U1:C 5
10
8 74LS00
E2 9
74LS00
Conclure
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ANNEXE
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Brochage de quelques circuits logiques : famille TTL 74XX
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Brochage de quelques circuits logiques : famille CMOS 40XX
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