Chapitre 2

Multivibrateurs

Les multivibrateurs
(Bascules lectroniques)
2.1 Notions gnrales sur les multivibrateurs :
Un multivibrateur ou bascule lectronique est un dispositif possdant deux tats et capable de basculer
alternativement de l'une de ses positions l'autre sous l'action d'une excitation.
Il existe 3 sortes de multivibrateurs : le bistable, le monostable et l'astable.
Multivibrateur bistable :
C'est une bascule comportant deux tats stables et pouvant passer de l'un l'autre sous l'action d'une
commande extrieure. Une entre Ve1(t) permet de mettre la bascule dans un tat et une autre entre Ve 2 (t)
permet la bascule de passer dans l'autre tat.

L'usage le plus courant de ce type de bascule est la fonction mmoire.

Multivibrateur monostable :
C'est une bascule prsentant d'une part un tat stable, dans lequel elle peut rester indfiniment et, d'autre
part, un tat instable de dure dtermine T appele : dure de ltat instable.
Cette fonction passe de l'tat stable l'tat instable sous l'influence d'une impulsion applique sur
l'entre du circuit. La bascule revient dans l'tat stable lorsque la dure de ltat instable est coule. Cette
dure est impose par les lments R, C du montage.

Le monostable est souvent utilis dans les montages lectroniques pour faire des temporisations.
Multivibrateur astable :
C'est une bascule comportant 2 tats instables et qui bascule priodiquement (priode T) et spontanment
d'un tat l'autre. Cet lment ne possde pas d'entre et fonctionne ds qu'il est mis sous tension.
La priode dpend des composants constituant l'astable, en gnral la priode est dfinie par un
condensateur et une rsistance.

L'astable est utilis dans les montages lectroniques pour fabriquer un signal d'horloge da n s l e s
circuits numriques permettant de synchroniser d'autres fonctions.

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Multivibrateurs

2.2 La commutation :

Dans ce chapitre on sintresse aux circuits de commutations bass sur les transistors, les amplificateurs
oprationnels et les portes logiques.
Dans les circuits multivibrateurs lAO fonctionne en comparateur.
Le transistor bipolaire en commutation (Rappel) :
Le transistor fonctionne en commutation lorsquil nest en tat dquilibre qu ltat satur ou ltat
bloqu. La transition dun tat lautre doit tre trs rapide. Ce mode de fonctionnement est aussi appel
digital ou binaire.
a) Etat bloqu dun transistor :
On obtient ltat de blocage du transistor (IC = 0) lorsque la tension dentre est infrieure VBE.

b) Etat satur dun transistor :

Lorsquon applique sur la base du transistor un courant IB > IBmin (IBmin est la valeur de juste saturation), la
tension entre le collecteur et lmetteur passe sa valeur minimale possible: VCE = VCEsat 0,2v, le courant
collecteur dans ce cas devient constant: IC = ICsat = cte, on dit que le transistor est dans un tat satur.
La condition de saturation du transistor est: IB > ICsat / = IBmin

2.3 Circuit RC en commutation :

a) Introduction :
Llment volutif qui prsente entre ses deux bornes une tension pouvant varier au cours du temps, selon
une loi dtermine, est pratiquement toujours la tension aux bornes dune capacit. Cest donc des lments
o interviennent la charge et la dcharge dun condensateur.
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La charge et la dcharge dun condensateur travers une rsistance sont la base dun important nombre de
phnomnes : gnration dun signal rectangulaire, triangulaire et en dents de scie.
b) Charge et dcharge dun condensateur :
On considre le circuit de charge et de dcharge suivants :

i.

Expression gnrale de la charge et de la dcharge :

Si on appelle Uf la valeur finale du potentiel aux bornes du condensateur Vc et Ui la tension initiale de Vc,
cest dire la tension au dbut du processus de charge ou dcharge, lexpression de Vc(t) scrit :
Vc(t) = Uf - ( Uf - Ui)e (t to)/ , est la constante du temps.
On peut utiliser la mme expression pour dterminer la tension aux bornes de la rsistance VR(t).
Remarque : La valeur finale Uf relative Vc ou VR correspond toujours ic = 0 (ic est le courant
traversant le condensateur).
ii. Charge dun condensateur :
A linstant t = to = 0, on met linterrupteur K en position 1. On suppose que Vc(0) = Uo.
Dtermination de lexpression du potentiel Vc(t) :
Le condensateur C se charge travers R partir de la valeur Ui = Uo donc = RC. On peut dduire la
valeur Uf partir du circuit, on a Uf = Vc( ic = 0) = E Ric = E.
En remplaant Uf, Ui, to, et dans lexpression gnrale de la charge et de la dcharge, on obtient :
t/
Vc(t) = E (E Uo) e

Graphe de Vc(t) (la charge du condensateur nest pas instantane)

On remarque daprs le graphe reprsentant Vc(t) que Vc(0-) = Vc(0+), on en dduit que le condensateur
ne se charge pas instantanment t = to = 0.
Dtermination de lexpression du potentiel VR(t) :
On peut dduire VR(t) partir de lexpression gnrale de la charge et de la dcharge.
On a Uf = VR( ic = 0) = 0, to = 0, = RC.
La valeur initiale Ui peut tre dduite partir des tapes suivantes :
- Lorsquon met K en position 1 t = to = 0, le potentiel VA passe instantanment de Uo
E (VA subit une variation positive de E Uo),

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comme la valeur de Vc ne change pas t = 0, on dit alors que le condensateur passe

instantanment la valeur de la variation positive (E-Uo) VR,
le potentiel VR passe instantanment de la valeur initiale la valeur initiale +
la valeur de la variation positive, cest dire VR passe de 0 0 + (E Uo) = E Uo = Ui.

En remplaant Uf, Ui, to, et dans lexpression gnrale de la charge et de la dcharge, on obtient :
t/
VR(t) = ( E Uo) e

iii.

Dcharge dun condensateur :

Le condensateur tant charg Vc(0) = E = Ui, on met K en position 2 linstant t = to = 0.

Dtermination de lexpression du potentiel Vc(t) :
Le condensateur se dcharge travers R donc = RC. On peut facilement dduire partir du circuit
que Uf = Vc( ic = 0) = 0.
En remplaant Uf, Ui, to, et dans lexpression gnrale de la charge et de la dcharge, on obtient :
t/RC
Vc(t) = E e

Graphe de la dcharge du condensateur.

On remarque daprs le graphe reprsentant Vc(t) que Vc(0-) = Vc(0+), on en dduit que le condensateur
ne se dcharge pas instantanment.
Dtermination de lexpression du potentiel VR(t) :
On peut dduire VR(t) partir de lexpression gnrale de la charge et de la dcharge.
On a Uf = VR( ic = 0) = 0, to = 0, = RC.
La valeur initiale Ui peut tre dduite partir des tapes suivantes :
- Lorsquon met K en position 2 t = to = 0, le potentiel VA passe instantanment de E
0v (VA subit une variation ngative de - E),
- comme Vc(0) ne change pas t = 0, on dit alors que le condensateur passe
instantanment la variation ngative (- E) VR,
- le potentiel VR passe instantanment de la valeur initiale la valeur initiale + la valeur
de la variation ngative, c d VR passe de 0 0 + (- E) = - E = Ui.
En remplaant Uf, Ui, to, et dans lexpression gnrale de la charge et de la dcharge, on obtient :
t/RC
VR(t) = - E e

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Graphe de VR(t) pendant la dcharge du condensateur.

2.4 Le montage bistable transistors
La configuration habituelle dun multivibrateur transistors est reprsente par la figure suivante.

La nature (capacitif ou rsistif) des rseaux de couplages (R.D.C) dtermine le type de multivibrateur.
Le rseau de couplage dans un montage bistable transistor est une rsistance.
a) Montage de principe :

b) Fonctionnement :
Le circuit est ralis avec les conditions suivantes : RC2IB1<<Vcc, RC1IB2<<Vcc et VCEsat < VBE.
On suppose quau dmarrage le transistor T1 est satur et le transistor T2 est bloqu, on a donc :
VCE1= VCEsat et VCE2 =Vcc RC2IB1 Vcc .
Sachant que VCEsat < VBE, lapplication donc du potentiel VCE1= VCEsat sur la base de T2 travers la
rsistance RB2 va forcer le transistor T2 se maintenir en tat de blocage. Le blocage de T2 maintient T1 en
saturation grce lapplication sur la base de T1 du potentiel VCE2 Vcc, travers RB1.
Le montage bistable na que deux situations dquilibres possibles :
Etat 1 : T1 satur (VCE1= VCEsat, IB1 > 0) et T2 bloqu (VCE2 = Vcc, IB2=0)
Etat 2 : T1 bloqu (VCE1 = Vcc, IB1=0) et T2 satur (VCE2= VCEsat, IB2 > 0)

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Il existe deux moyens pour faire changer ltat de sortie de la bistable : soit en saturant le transistor qui se
trouve bloqu ou en bloquant le transistor qui se trouve satur.
c) Forme des signaux :
Exemple :
On applique sur les entres du bistable transistors les formes des signaux e1(t) et e2(t) suivants :

On suppose qu linstant t = 0, VCE1= VCEsat et VCE2 = Vcc. Tracer les signaux de sorties VCE1(t) et
VCE2(t).
Solution :

d) Conditions de fonctionnement du bistable transistor

Pour que les deux transistors puissent tre saturs, il faut que la condition de saturation soit vrifie.
Supposons ltat2 : T1 bloqu (VCE1 = Vcc, IB1=0) et T2 satur (VCE2= VCEsat, IB2 > 0).
Nous avons donc le schma simplifi suivant :

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On a :

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IB2 =

et

IB2min =

La condition de saturation respecter par T2 est : IB2 > IB2min <=>

>

De mme, si on suppose ltat 1, le montage bistable se simplifie au montage suivant :

La condition de saturation respecter par T1 est : IB1 > IB1min <=>

>

e) Applications du bistable.
Le bistable peut tre utilis dans les circuits de mmoire numrique, dans les circuits de commande, dans les
compteurs, les diviseurs de frquencesetc. il constitue la base de plusieurs autres circuits analogiques ou
numriques.
2.5 Montages monostables
2.5.1 Montage monostable A.O :
a) Schma de principe dun monostable AO :

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Lamplificateur oprationnel utilis fonctionne en comparateur : Vs(t) =

Dans ce montage Vref < Vsat et au repos Ve = 0.
b) Fonctionnement du montage :
Commenons par chercher ltat stable de ce monostable. Pour dterminer ltat stable des monostables,
on suppose que les rgimes transitoires ont disparu (il ne doit y avoir ni charge ni dcharge, ce qui
implique que le courant traversant le condensateur est nul, ic = 0).
Au repos : Ve = 0 et ic = 0 => le potentiel V+ qui est gale Vref est suprieur au potentiel V- = Ve = 0, on
en dduit que Vs = Vsat. On a aussi VA = Vref. Ltat stable est caractris par Vs = Vsat.
Pour changer ltat de la sortie, il faut appliquer lentre Ve une impulsion de trs courte dure et
damplitude suprieure V+ = Vref.
A linstant t = 0, on applique Ve > Vref. Puisque V- devient suprieure V+, la sortie Vs passe de +Vsat
Vsat, le condensateur passe instantanment la variation ngative (-2Vsat) VA,
VA passe alors de Vref Vref 2Vsat et V+ passe donc de Vref V+ =

< 0.

On pose V+ =

, - V+ reprsente la variation ngative transmise V+ t = 0.

Ainsi, t = 0, le potentiel V+ passe de Vref Vref - V+ < 0.
Ltat instable est caractris par Vs = - Vsat. Pendant ltat Vs = -Vsat, le condensateur se dcharge
travers R1 + R2, avec une constante de temps = (R1 + R2)C.
Dterminons lexpression de V+(t) pendant ltat Vs = -Vsat:
Appliquons lexpression gnrale de charge et de dcharge V+(t).
On a :
V+(t) = Uf (Uf Ui)
Avec : to = 0, = (R1 + R2)C, Ui = V+(0) = Vref - V+ et
Uf = V+(ic = 0)) = Vref
Do : V+(t) = Vref - V+
On remarque que le potentiel de V+(t) augmente partir de Vref - V+ jusqu atteindre V- = 0 (limpulsion
dentre ayant dj disparu). On a V+ > V- => le potentiel de sortie Vs bascule t = T : Vs passe de - Vsat
+ Vsat, le condensateur passe instantanment la variation positive (+2Vsat) VA, VA passe alors une
variation de + V+ V+, V+ passe donc de 0 0 + V+ > Vref.
Dterminons maintenant lexpression de V+(t) pendant ltat Vs = +Vsat:
Le condensateur se charge travers R1 + R2 avec une
constante de temps = (R1 + R2)C.
Daprs lexpression gnrale de charge et de dcharge
applique V+, on a : V+(t) = Uf (Uf Ui)
Avec : to = T, = (R1 + R2)C, Ui = V+(T) = V+ et
Uf = V+(ic = 0)) = Vref
Do : V+(t) = Vref (Vref - V+
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> V- = 0

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Le potentiel de V+(t) dcroit jusqu atteindre Vref, Vs ne bascule pas puisque V+ reste suprieur Vpendant ltat Vs = +Vsat. On en dduit que ltat Vs = +Vsat est stable.
c) Forme des signaux :
Les chronogrammes suivants rsument le principe de fonctionnement de ce monostable.

d) Calcul de la dure de ltat instable (T):

A linstant t = 0, le potentiel V+(0) = 0 = Vref - V+

=> T =

= (R1+R2)C

2.5.2 Montage monostable portes logique CMOS-NAND :

a) La porte logique CMOS-NAND:
La caractristique idale de la porte CMOS-NAND est donne par le graphe suivant :

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En entre : la tenson dentre peut prendre des valeurs suprieures ou infrieures Vth
Ltat haut "1" correspond Ve > Vth et ltat bas "0", il correspond Ve < Vth .
Limpdance dentre de la porte logique en CMOS est trs grande (Ze => ie 0).
En sortie : la tension de sortie ne peut prendre que deux valeurs possibles 0v ou VDD.
Ltat haut "1" correspond Vs = VDD et ltat bas "0" Vs = 0. Le courant de sortie (is) de la porte
logique est non ngligeable.
b) Exemple dun montage monostable portes logique CMOS-NAND :

Au repos, le potentiel dentre (Ve) est gal VDD.

c) Fonctionnement du Montage :
Au repos le courant ic est nul : ic = 0 => VR = 0 => Vs = VDD. Comme Ve = VDD, on en dduit que
Vs1 = 0 et par consquent : Vc = Vs1 VR = 0. Ltat stable est caractris par Vs = VDD.
Pour changer ltat de sortie, on doit appliquer en entre ( t = 0) une impulsion de trs courte dure et
damplitude Ve < Vth.
A t = 0, le systme passe de ltat stable (Vs = VDD) ltat instable (Vs = 0) :
Ve < Vth => Vs1 passe de 0 VDD (il sagit dune variation instantane est positive de +V DD),
le condensateur transmet cette variation positive VR. Le potentiel VR passe instantanment
de 0 0 + (+VDD) = VDD, la sortie bascule dans ces conditions de VDD 0 (ltat bas de Vs maintient Vs1
ltat haut pendant ltat instable, en sachant que Ve revient trs rapidement VDD aprs lapplication de
limpulsion dentre).
Les conditions initiales de ltat instable sont : Vs = 0, Vs1 = VDD, VR(0) = VDD et Vc(0) = 0.
Ltude suivante permet de dterminer lvolution du potentiel V R en fonction du temps pendant ltat
instable:
Daprs lexpression gnrale de charge et de dcharge applique VR(t), on a :
VR(t) = Uf (Uf Ui)
Avec : to = 0, = RC, Ui = VR(0) = VDD et
Uf = VR(ic = 0) = 0.
Do : VR(t) = VDD
Le potentiel VR(t) dcroit jusqu atteindre le seuil Vth t = T. VR atteint ltat bas, cela provoque le
basculement de la sortie Vs bascule VDD. On en dduit que ltat Vs = 0 est instable.

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Dterminons maintenant ltat correspondant t T :

A t = T, le systme passe de ltat instable (Vs = 0) ltat stable (Vs = VDD). A ce moment Ve = VDD. La
sortie est Vs = VDD et Ve = VDD => Vs1 passe de VDD 0 (il sagit dune variation ngative instantane
gale -VDD), le condensateur transmet cette variation ngative VR, le potentiel VR passe donc
instantanment de Vth Vth + (-VDD)

Les conditions initiales de ltat stable sont : Vs = VDD, Vs1 = 0 et VR(T) =

Pendant ltat stable, le condensateur se dcharge, avec une constante de temps = RC, jusqu lannulation
du courant ic.
Daprs lexpression gnrale de charge et de dcharge, applique VR(t), on a :
VR(t) = Uf (Uf Ui)
Avec : to = T, = RC, Ui = VR(T) =

et

Uf = VR(ic = 0) = 0.
Do : VR(t) =

< Vth quel que soit t.

Pendant ltat stable, le potentiel VR(t) reste au niveau bas quel que soit t, il en rsulte le maintient de la
sortie Vs au niveau haut (Vs = VDD).
d) Forme des signaux :
Les chronogrammes suivants rsument le principe de fonctionnement de ce monostable.

e) Calcul de la dure de ltat instable :

A linstant t = T, VR(T) = Vth

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= VDD

=> T = RC

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2.6 Les montages astables

La ralisation des calculs par le microprocesseur est cadence par ce qu'on appelle un signal d'horloge.
L'horloge est un composant essentiel de l'lectronique numrique : c'est elle qui dtermine la rapidit de
fonctionnement du systme. Elle met un signal carr, succession dtats hauts et d'tats bas. Les circuits en
aval ragissent alors au changement d'tat de l'horloge.
Il est ainsi important de s'intresser la cration d'un tel circuit lectronique auto-oscillant (ou astable) que
l'on peut matriser pour cadencer un montage la frquence dsire.
Nous allons passer en revue un certain nombre de montages multivibrateurs astables.
2.6.1 Astable amplificateur oprationnel.
a) Montage de base :

Astable AO
b) Fonctionnement :
On suppose les conditions initiales suivantes :
A t = to = 0, Vc(0) = 0 et Vs(0) = Vsat. Dans ces conditions, V+(0)

Vsat = Vsat.

1) Phase transitoire :
Au dmarrage ( t = to = 0), le condensateur se charge travers la rsistance R, avec une constante de
temps

= RC, sous Vs = Vsat.

Le potentiel Vc(t) = V-(t) augmente partir de Vc(0) = 0. Cette

augmentation se fait daprs la relation suivante : Vc(t) = Vsat(1 ), puisque : Uf = Vsat et Ui = 0.

+
Ds que Vc(t) atteint, t = t1, le potentiel V = Vsat, la tension de sortie bascule. Le systme passe
alors de ltat Vs = Vsat ltat Vs = - Vsat. Le basculement de Vs provoque le passage instantan de
V+ de la valeur Vsat la valeur Vsat.
2) Etat instable Vs = -Vsat :
A t = t1, on a les conditions suivantes : V+ (t1) = -Vsat, Vs(t1) = -Vsat et Vc(t1) = V- (t1) = Vsat.
Le condensateur se dcharge, travers la rsistance R, avec une constante de temps = RC, sa valeur
finale Vs = -Vsat. Le potentiel Vc(t) dcroit donc partir de Vsat. Cette diminution se fait daprs la
relation suivante: Vc(t) = -Vsat + Vsat(1 +)
, puisque : Uf = -Vsat et Ui = Vc(t1) = Vsat.
+
Ds que Vc(t) atteint V = -Vsat, t = t2, la tension de sortie bascule. Le systme passe alors de ltat
Vs = -Vsat ltat Vs = Vsat. Le basculement de Vs provoque le passage de V+ de - Vsat Vsat.
3) Etat instable Vs = Vsat :
A t = t2, on a les conditions suivantes : V+ (t2) = Vsat, Vs(t2) = Vsat et Vc(t2) = V- (t2) = - Vsat.
Le condensateur se charge travers la rsistance R, avec une constante de temps = RC, sa valeur
finale Vs = Vsat. Le potentiel Vc(t) augmente donc partir de - Vsat. Cette augmentation se fait
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daprs la relation suivante : Vc(t) = Vsat - Vsat(1 +)

, puisque : Uf = Vsat et
+
Ui = Vc(t2) = - Vsat. Ds que Vc(t) atteint V = -Vsat, t = t3, la tension de sortie bascule.
Le systme passe alors de ltat Vs = Vsat ltat Vs = -Vsat. Le basculement de Vs provoque le
passage de V+ de Vsat - Vsat.
Un nouveau cycle se rpte partir de t = t3. Le circuit possde deux tats instables, il passe de ltat
Vs = -Vsat ltat Vs = Vsat et ensuite de ltat Vs = Vsat ltat Vs = -Vsat et ainsi de suite.
4) Forme des signaux :

Dtermination de la priode du signal de sortie Vs(t) :

T = (dure de ltat Vs = -Vsat) + (dure de ltat Vs = Vsat)
T = (t2 - t1) + (t3 - t2) = 2RC ln (

).

2.6.2 Astable portes logiques en CMOS-NAND :

a) Montage de base :

Astable CMOS-NAND

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b) Fonctionnement du montage :
Quand V2(t), en diminuant, arrive au seuil de basculement de l'inverseur (V2(t) < Vth qui correspond
ltat bas) les deux inverseurs basculent.
On suppose qu linstant t = 0, V2(t) atteint Vth, la sortie V3(t) qui se trouvait 0V passe ltat VDD et
V1(t) passe de VDD 0v. Un front ngatif de - VDD est transmis intgralement V2(t) par le condensateur.
V2(t) qui tait un potentiel de + Vth passe donc : +Vth VDD -

1) Etat V3(t) = VDD :

A t = to = 0, on les conditions initiales suivantes : V1(0) = 0v, V2(0) = -VDD/2 et V3(0) = VDD.
Le condensateur se charge travers la rsistance R, avec une constante de temps = RC, sa valeur finale
V3 = VDD. Le potentiel V2(t) = Vc(t) croit exponentiellement daprs la relation suivante :
V2(t) = VDD VDD
, cette quation est dtermine partir de la relation gnrale de charge et de
dcharge, avec : Ui = V2(0) = -VDD/2 et Uf = V2( ic = 0) = V3 = VDD.
Ds que le potentiel V2(t) atteint en augmentant, t = t1, le seuil Vth, donc ltat haut, les deux inverseurs
basculent.
2) Etat V3(t) = 0V :
A t = t1, V3(t) passe 0V et V1(t) VDD. Un front positif de +VDD est transmis intgralement V2(t) par
le condensateur C. V2(t) qui tait un potentiel de + Vth passe donc : +Vth + V DD

VDD.

Le condensateur se dcharge travers la rsistance R, avec une constante de temps = RC, sa valeur
finale V1 = -VDD. Le potentiel V2(t) dcroit donc exponentiellement daprs la relation suivante :
V2(t) = VDD
, cette quation est dtermine partir de la relation gnrale de charge et de
dcharge avec : Ui = V2(t1) = 3VDD/2 et Uf = V2( ic = 0) = VR = 0v.
Ds que le potentiel V2(t) atteint en diminuant, t = t2, le seuil Vth, donc ltat bas, les deux inverseurs
basculent.
Nous sommes revenus au point de dpart de notre explication et un nouveau cycle peut recommencer.
3) Forme des signaux :

4) Priode du signal de sortie :

Montrer que la priode du signal de
sortie est gale :
T = (t1- to) + (t2 - t1) = 2RC ln3.

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2.6.3 Astable circuit intgr.

Il existe une multitude de circuits intgrs (CI) qui sont capables de gnrer des ondes de formes
rectangulaires ou carres et mme dautres formes telles que les signaux triangulaires et sinusodaux.
Considrons comme exemple dtude lastable horloge NE555 suivant :

Astable horloge NE555

Dans la configuration de ce circuit, les broches 2 et 6 (dclencheur et seuil) sont relies ensemble.
Elles constituent deux dtecteurs, lun de 1/3 de Vcc et lautre de 2/3 de Vcc. Le circuit sauto dclenche et
devient un multivibrateur astable. Le condensateur C se charge travers RA et RB, lorsque sa tension atteint
2/3 de Vcc, le comparateur reli la broche 6 se dclenche, ce qui fait passer la sortie ltat bas.
A ce moment l, C se dcharge travers RB seulement. Lorsque sa tension atteint 1/3 de Vcc, le
comparateur reli au dclencheur (broche 2) se dclenche : la sortie passe ltat Vcc et Vc(t) augmente
jusqu 2/3 de Vcc et le cycle recommence. Les chronogrammes de Vc(t) et Vs(t) sont reprsentes par la
figure suivante :

Calcul de T1 : La dure T1 = (t1-to) est le temps que met le condensateur C pour se charger sous Vcc en
partant dun potentiel gale Vcc/3. Ds que Vc(t) atteint 2Vcc/3, Vs bascule ltat bas.
Comme Vc(to = 0) = Ui = Vcc/3 et Vc(t ) = Uf = Vcc => Vc(t) = Vcc 2Vcc/3 e-(t-to)/C(RA+RB)
On a Vc(t1) = 2Vcc/3 => t1 to = C(RA + RB)Ln2.
Calcul de T2 : La dure T2 = (t2-t1) est le temps que met le condensateur C pour se dcharger travers RB
en partant de 2Vcc/3. Ds que Vc(t) atteint Vcc/3 , Vs bascule ltat haut.
Comme Vc(t1) = Ui = 2Vcc/3 et Vc(t ) = Uf = 0 => Vc(t) = 2Vcc/3 e -(t-t1)/CRB
On a Vc(t2) = Vcc/3 => t2 t1 = CRBLn2.
Finalement la priode du signal de sortie est exprime par : T = C(RA + 2RB) Ln2 .
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