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Transistors À Effet de Champs
Transistors À Effet de Champs
Cours:
« Conception Analogique – E2: Electronique analogique »
❖ Introduction :
▪ Un transistor à effet de champ (FET), également connu sous le nom « Field-Effect Transistor », est un composant
électronique utilisé pour amplifier et commuter des signaux électroniques.
▪ Les transistors à effet de champ (FET) utilisent un seul type de porteurs, soit les électrons, soit les trous, contrairement
aux technologies bipolaires qui utilisent les deux types de porteurs.
▪ Le fonctionnement de base d'un transistor à effet de champ repose sur l'existence d'un canal, où les porteurs peuvent se
déplacer sous l'influence d'un champ électrique, similaire à une résistance.
▪ La variation de la tension transversale au canal (Vtrans) permet de contrôler la section du canal, modifiant ainsi sa
résistance et l'intensité du courant qui le traverse.
❖ Introduction :
▪ Les transistors à effet de champ peuvent être utilisés pour créer des résistances commandées par la tension (Vtrans), des
sources de courant commandées par la tension, ou des commutateurs.
▪ Il existe diverses possibilités pour concevoir de tels dispositifs, notamment en agissant sur le type de porteurs, le type de
contrôle du canal (via une jonction de matériaux), et l'état du canal au repos (existence ou absence du canal à Vtrans =
0V).
❖ Introduction :
▪ Les transistors à effet de champ sont classés en fonction de plusieurs critères, d'abord selon le mode de contrôle du
canal, ensuite en fonction du type de porteurs, et enfin en tenant compte de la présence du canal à l'équilibre.
▪ C’est un semi-conducteur à effet de champ à grille isolée de son support, il comporte 4 électrodes : Grille (Gate en
anglais), Drain , Source et son support le substrat (Bulk en anglais).
▪ Il ne peut conduire un courant important que si on applique entre ses 2 électrodes (Grille et Substrat/Source) une tension
supérieure à certain seuil !
▪ Comme son nom l’indique, il s’agit d’une structure physique, son étude est basée sur la théorie des semi conducteurs et
la jonction PN.
▪ C’est la base des circuits intégrés modernes : 90% des puces actuelles sont fabriqués avec des millions de MOS.
➢ MOS à enrichissement (Les plus utilisés) , noté E-MOS (Enhencement ). On étudiera que les transistors
MOS à enrichissement
❖ Technologie CMOS:
▪ Au début, les puces sont réalisées soit avec des NMOS ou avec des PMOS.
❖ Technologie CMOS:
➢ Automobile
➢ Téléphonie mobile
➢ Médicale
➢ Ecran LCD
❖ Autres technologies:
▪ E.C.L (Emitter Coupled Logic) : utilise les transistors bipolaires Non Saturés
❖ Autres technologies:
Préfixe Constructeur
AD, OP Analog Devices
L, TDA STMicroelectronics
MAX Maxim
TL, TLC Texas Instruments
LF, LM National Semiconductor 12
Pr. Mustapha El Alaoui
1 T r a n s i s t o rs à e f f e t d e ch a m p s
❖ Transistor MOS:
▪ Pour faire des circuits, il faut avoir des symboles pour les transistors:
❖ Transistor MOS:
▪ Par convention:
➢ Conducteur: Métal
➢ Isolant: Oxyde
➢ Semiconducteur…
▪ Métal-Oxyde-Semiconducteur (MOS)
➢ On ajoute 2 régions:
❖ Composants MOS:
▪ Dans un barreau de Silicium faiblement dopé N (Si N-), le substrat B (bulk en anglais), disposons deux prises de contact
de Silicium fortement dopées N (Si N+) : la source (S) et le drain (D).
▪ Ces 3 zones sont dopées de même type. Nous pouvons y faire circuler un courant formé majoritairement d'électrons qui
s'écoulent de la source vers le drain, par conduction due au champ électrique longitudinal engendré par VDS.
▪ Les dimensions (la largeur W, la longueur L et l'épaisseur e) de la partie du substrat située entre D et S, et les paramètres
technologiques du matériau dont est fait le substrat, déterminent la résistance équivalente RDS, nous obtenons :
VDS=RDS.IDS.
Pr. Mustapha El Alaoui
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1 T r a n s i s t o rs à e f f e t d e ch a m p s
❖ Composants MOS:
▪ Les deux diodes DS et DB sont respectivement polarisées l'une à 0V l'autre en inverse, aucun courant ne peut
traverser ces dipôles.
❖ Composants MOS:
▪ Sur la structure précédemment décrite, où momentanément, nous appellerons la Source "Émetteur" (E), et le Drain
"Collecteur" (C), créons une troisième connexion la "Base" (B), pour polariser en direct la jonction BE. Nous venons de
construire un transistor bipolaire où la zone P la Base (B).
❖ Composants MOS:
▪ La tension VBE (quelques dixièmes de Volts) commande le courant de la jonction BE (en direct). Des électrons sont
injectés massivement dans la Base où ils sont minoritaires.
▪ La tension VCE (de quelques Volts à quelques dizaines de volts) est telle que la jonction BC est fortement polarisée en
inverse, ce qui "détourne" les électrons du courant IBE injectés dans la Base, vers le Collecteur et crée un courant ICE
entre Collecteur et Émetteur.
▪ Nous avons réalisé un dispositif modulant le courant de sortie ICE, par la tension d'entrée VBE. Il s'agit bien d'une
transconductance, malheureusement il existe un courant parasite (les trous de IBE) en l'entrée (la base).
▪ L'étape suivante consiste à isoler cette entrée afin d'annuler l'intensité du courant parasite d'entrée.
❖ Composants MOS:
Transistor MOS
▪ La quatrième étape consiste à faire croitre, au-dessus de la partie du substrat (du Semi conducteur Si faiblement dopé P)
comprise entre Source et Drain, une couche fine d'isolant : de la silice (Oxyde de Silicium, SiO2). Sur cet isolant
déposons une couche conductrice : du Métal, comme dans le temps, ou du Silicium très fortement dopé donc poly-
cristallin, appelé polysilicium (poly) tel que cela est fait maintenant. Appelons grille (G) la couche conductrice de
polysilicium, et notons les initiales de ces 3 matériaux : MOS
❖ Composants MOS:
Transistor MOS
▪ VTN est la tension de seuil du NMOS. Elle est caractéristique de la technologie dans laquelle le transistor est construit.
Typiquement: +0,2V < VTN < +2V
▪ VTP est la tension de seuil du PMOS. Elle est caractéristique de la technologie dans laquelle il est construit.
Typiquement : -2V < VTP < -0,2V
➢ Technologie CMOS
▪ Une technologie CMOS est un procédé qui permet d'obtenir, dans un même monocristal (sur une même puce de
Silicium), des transistors NMOS et des transistors PMOS.
▪ Le substrat d'une technologie CMOS est faiblement dopé P (nous pouvons y graver directement des NMOS).
▪ Le substrat N (pour graver les PMOS) est une zone faiblement dopée N (Si N-) : le caisson, dans le substrat (Si P-).
▪ Le caisson dopé N- (le substrat B) des PMOS leurs est commun. Il est polarisé à la tension la plus positive
du circuit : VDD
▪ Le substrat (B) dopé P- des NMOS leurs est commun. Il est polarisé à la tension la plus négative du circuit : Vss = 0V
parfois Vss =-VDD,
▪ Le Drain (D) des transistors NMOS est toujours polarisé à une tension supérieure à celle de leur Source (S),
▪ Le Drain (D) des transistors PMOS est toujours polarisé à une tension inférieure à celle de leur Source (S).
Pr. Mustapha El Alaoui
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